MICROCHIP Costas Loop Management User Guide
MICROCHIP Costas Loop Management

Introduzione

In a trasmissione wireless, u Trasmettitore (Tx) è u Receiver (Rx) sò separati da una distanza è isolati elettricamente. Ancu s'è Tx è Rx sò sintonizzati à a stessa frequenza, ci hè un offset di freccia trà e frequenze di u trasportatore per via di a diffarenza ppm trà l'oscillatori utilizati in Tx è Rx. L'offset di freccia hè compensatu cù i metudi di sincronizazione di dati aiutu o senza dati (cecu).

Un Loop Costas hè un metudu basatu in PLL senza dati per a compensazione di l'offset di frequenza di u trasportatore. L'applicazione primaria di i loops Costas hè in i ricevitori wireless. Utilizendu questu, l'offset di freccia trà Tx è Rx hè compensatu senza l'aiutu di toni piloti o simboli. U Costas Loop hè implementatu per e modulazioni BPSK è QPSK cù un cambiamentu in u bloccu di calculu di errore. L'impiegazione di un Loop Costas per a sincronia di fasi o frequenze pò esse risultatu in ambiguità di fasa, chì deve esse corretta per mezu di tecniche cum'è a codificazione differenziale.

Riassuntu

A tabella seguente furnisce un riassuntu di e caratteristiche di Costas Loop.

Table 1. Costas Loop caratteristiche

Versione Core Stu documentu si applica à Costas Loop v1.0.
Famiglie di Dispositivi Supportati
  • SoC Polar Fire®
  • U focu polare
Supportatu Strumenta Flussu Richiede Libero® SoC v12.0 o versioni successive.
Licenza Costas Loop IP clear RTL hè una licenza chjusa è u RTL criptatu hè dispunibule liberamente cù qualsiasi licenza Libero. RTL criptatu: U codice RTL criptatu cumpletu hè furnitu per u core, chì permette à u core per esse instantiatu cù Smart Design. A simulazione, a sintesi è u layout pò esse realizatu cù u software Libero. Clear RTL: U codice fonte RTL cumpletu hè furnitu per u core è i banchi di prova.

Features

Costas Loop hà e seguenti caratteristiche chjave:

  • Supporta modulazioni BPSK è QPSK
  • Parametri di loop sintonizzabili per una larga gamma di frequenze

Implementazione di IP Core in Libero® Design Suite
U core IP deve esse installatu à u Catalogu IP di u software Libero SoC. Questu hè stallatu automaticamente attraversu l'IP
Funzione di aghjurnamentu di u catalogu in u software Libero SoC, o u core IP hè telecaricatu manualmente da u catalogu. Una volta
u core IP hè stallatu in u Catalogu IP di u software Libero SoC, u core hè cunfiguratu, generatu è instantiatu in l'uttellu Smart Design per l'inclusione in a lista di prughjetti Libero.

Utilizazione è prestazione di u dispositivu

I seguenti tabelle listanu l'utilizazione di u dispositivu utilizatu per Costas Loop.

Table 2. Utilization Loop Costas per QPSK

Dettagli di u dispusitivu Risorse Prestazione (MHz) RAM Blocchi di matematica Chip Globals
Famiglia Dispositivu LUT DFF LSRAM μSRAM
SoC PolarFire® MPFS250T 1256 197 200 0 0 6 0
PolarFire MPF300T 1256 197 200 0 0 6 0

Table 3. Utilization Loop Costas per BPSK

Dettagli di u dispusitivu Risorse Prestazione (MHz) RAM Blocchi di matematica Chip Globals
Famiglia Dispositivu LUT DFF LSRAM μSRAM
SoC PolarFire® MPFS250T 1202 160 200 0 0 7 0
U focu polare MPF300T 1202 160 200 0 0 7 0

Impurtante Impurtante: 

  1. I dati in questa tavula sò catturati cù i paràmetri tipici di sintesi è layout. A fonte di u clock di riferimentu CDR hè stata impostata à Dedicatu cù altri valori di cunfiguratore senza cambiatu.
  2. U clock hè limitatu à 200 MHz mentre esegue l'analisi di u tempu per ottene i numeri di rendiment.

Descrizzione Funziunale

Questa sezione descrive i dettagli di implementazione di u Loop Costas.

A figura seguente mostra u schema di bloccu à livellu di u sistema di u Costas Loop.

Figura 1-1. Schema di bloccu à livellu di u sistema di Costas Loop
Descrizzione Funziunale
A latenza trà l'input è output di u Costas cima hè 11 cicli di clock. A latenza THETA_OUT hè di 10 clock
ciculi. Kp (custante di proporzionalità), Ki (custante integrale), u fattore Theta è u fattore LIMIT deve esse fissatu secondu l'ambienti di u rumore è l'offset di freccia esse introduttu. U Costas Loop pigghia un pocu di tempu per bluccà, cum'è in l'operazione PLL. Certi pacchetti ponu esse persi durante u tempu di chjusu iniziale di u Costas Loop.

Architettura

L'implementazione di u Loop Costas richiede i seguenti quattru blocchi:

  • Loop Filter (Controller PI in questa implementazione)
  • Theta Generator
  • Calculu di errore
  • Rotazione Vector

Figura 1-2. Diagramma di blocchi di u ciclu di Costas
Architettura
L'errore per un schema di modulazione specificu hè calculatu basatu annantu à i valori I è Q rotati cù u Modulu di Rotazione Vector. U controller PI calcula a frequenza basatu annantu à l'errore, u guadagnu proporzionale Kp è u guadagnu integrale Ki. L'offset di frequenza massima hè stabilitu cum'è un valore limite per l'uscita di frequenza di u controller PI. U modulu Theta Generator genera l'angolo per integrazione. L'input factor theta determina a pendenza di integrazione è dipende.

à u sampling clock. L'angolo generatu da u Generatore Theta hè utilizatu per rotà i valori di input I è Q. A funzione d'errore hè specifica per un tipu di modulazione. Siccomu u cuntrollu PI hè implementatu in u formatu di u puntu fissu, a scala hè realizatu nantu à e outputs proporzionali è integrali di u cuntrollu PI.
integrazione
In listessu modu, a scala hè implementata per l'integrazione theta.
integrazione

Parametri IP Core è signali d'interfaccia

Questa sezione discute i paràmetri in u configuratore GUI di Costas Loop è i segnali I/O.

Paràmetri di cunfigurazione

A tavula seguente lista a descrizzione di i paràmetri di cunfigurazione utilizati in l'implementazione hardware di Costas Loop. Quessi sò parametri generici sò variati secondu u requisitu di l'applicazione.
Table 2-1. Parametru di cunfigurazione

Signal Name Descrizzione
Tipu di modulazione BPSK o QPSK

Inputs è Output Signals
A tavula seguente lista i porti di input è output di Costas Loop.
Table 2-2. Segnali di input è output

Signal Name Direzzione Tipu di signale Larghezza Descrizzione
CLK_I Input 1 Segnale di u clock
ARST_N_IN Input 1 Segnale di reset asincronu attivu bassu
I_DATA_IN Input Firmatu 16 In fase / input di dati reale
Q_DATA_IN Input Firmatu 16 Input di dati in quadratura / imaginariu
KP_IN Input Firmatu 18 Constant de proportionnalité du régulateur PI
KI_IN Input Firmatu 18 Constant intégrale du régulateur PI
LIMIT_IN Input Firmatu 18 Limite per u controller PI
THETA_FACTOR_IN Input Firmatu 18 Fattore Theta per l'integrazione theta.
I_DATA_OUT Output Firmatu 16 In fase / Reali dati Output
Q_DATA_OUT Output Firmatu 16 Quadrature / Dati imaginariu Output
THETA_OUT Output Firmatu 10 Indice Theta calculatu (0-1023) per a verificazione
PI_OUT Output Firmatu 18 output PI

Diagrammi di u tempu

Questa sezione discute u diagramma di tempu di Costas Loop.
A figura seguente mostra u diagramma di u tempu di Costas Loop.
Figura 3-1. Diagramma di u tempu di u ciclu Costas
Diagramma di u tempu

banc d'essai

Un bancu di teste unificatu hè adupratu per verificà è pruvà Costas Loop chjamatu bancu di teste d'utilizatori. U bancu di prova hè furnitu per verificà a funziunalità di u Costas Loop IP.

Righe di simulazione

Per simulà u core cù u testbench, eseguite i seguenti passi:

  1. Aprite l'applicazione Libero SoC, cliccate nantu à a tabulazione Catalogu, espansione Soluzioni-Wireless, fate doppiu clicu COSTAS LOOP, è dopu cliccate OK. A documentazione assuciata cù l'IP hè listata in Documentazioni.
    Impurtante Impurtante: Se ùn vede micca a tabulazione Catalogu, andate à View > Menu Windows è cliccate Catalogu per rende visibile.
    Figura 4-1. Costas Loop IP Core in Libero SoC Catalog
    Righe di simulazione
  2. Configurate l'IP secondu u vostru esigenza.
    Figura 4-2. GUI di cunfiguratore
    GUI di cunfiguratore
    Promuvà tutti i signali à u livellu più altu è generà u disignu
  3. In a tabulazione Stimulus Hierarchy, cliccate Build Hierarchy.
    Figura 4-3. Custruì a Gerarchia
    Custruì a Gerarchia
  4. Nant'à a tabulazione Stimulus Hierarchy, cliccate right-click the testbench (Costas loop bevy), punta à Simulate Present Design, è dopu cliccate Open Interactively.
    Figura 4-4. Simulazione di Disegnu di Pre-Sintesi
    Disegnu di pre-sintesi
    ModelSim si apre cù u testbench file, cum'è mostra in a figura seguente.
    Figura 4-5. Finestra di simulazione ModelSim
    Finestra di simulazione

Impurtante Impurtante: Se a simulazione hè interrotta per via di u limitu di runtime specificatu in u .do file, Aduprate u cumandamentu run -all per compie a simulazione

Storia di rivisione

A storia di rivisione descrive i cambiamenti chì sò stati implementati in u documentu. I cambiamenti sò listati per rivisione, cuminciendu cù a publicazione più attuale.
Table 5-1. Storia di rivisione

Revisione Data Descrizzione
A 03/2023 Liberazione iniziale

Supportu Microchip FPGA

U gruppu di prudutti Microchip FPGA sustene i so prudutti cù diversi servizii di supportu, cumpresu u Serviziu Clienti,
Centru di Assistenza Tecnica di Clienti, a websitu, è uffizii di vendita in u mondu. I clienti sò suggeriti à visità
Risorse in linea di Microchip prima di cuntattà l'assistenza postu chì hè assai prubabile chì e so dumande sò digià state
rispostu.

Cuntattate u Centru di Assistenza Tecnica attraversu u websitu à www.microchip.com/support. Mencione u Dispositivu FPGA
U numeru di parte, selezziunate a categuria di casu adatta è carica u disignu files mentre crea un casu di supportu tecnicu.

Cuntattate u Serviziu Clienti per un supportu di produttu micca tecnicu, cum'è u prezzu di u produttu, l'aghjurnamenti di u produttu, l'aghjurnamentu
infurmazione, statu di ordine, è auturizazione.

  • Da l'America di u Nordu, chjamate 800.262.1060
  • Da u restu di u mondu, chjamate 650.318.4460
  • Fax, da ogni locu in u mondu, 650.318.8044

Infurmazioni Microchip

U Microchip Websitu

Microchip furnisce supportu in linea via u nostru websitu à www.microchip.com/. Questu website hè usatu per fà files è
infurmazione facilmente dispunibule per i clienti. Alcune di u cuntenutu dispunibule include:

  • Supportu di produttu - Schede tecniche è errata, note d'applicazione è sampi prugrammi, risorse di cuncepimentu, guide d'utilizatori è documenti di supportu hardware, l'ultime versioni di u software è u software archiviatu
  • Assistenza tecnica generale - Domande Frequenti (FAQs), richieste di supportu tecnicu, gruppi di discussione in linea, lista di membri di u prugramma di partner di design Microchip
  • Affari di Microchip - Selettore di prudutti è guide d'ordine, l'ultimi comunicati di stampa Microchip, elencu di seminarii è avvenimenti, liste di uffizii di vendita di Microchip, distributori è rapprisentanti di fabbrica

Serviziu di Notificazione di Cambiamentu di Produttu

U serviziu di notificazione di cambiamentu di produttu di Microchip aiuta à mantene i clienti attuali nantu à i prudutti Microchip. L'abbonati riceveranu una notificazione per e-mail ogni volta chì ci sò cambiamenti, aghjurnamenti, rivisioni o errata in relazione à una famiglia di prudutti specifica o strumentu di sviluppu d'interessu.

Per registrà, andate à www.microchip.com/pcn è seguitate l'istruzzioni di registrazione.

Assistenza Clienti

L'utilizatori di i prudutti Microchip ponu riceve assistenza attraversu parechji canali:

  • Distributore o Rappresentante
  • Uffiziu di Vendita Locale
  • Ingegnere di soluzioni integrate (ESE)
  • Assistenza tecnica

I clienti anu da cuntattà u so distributore, rappresentante o ESE per supportu. L'uffizii di vendita lucali sò ancu dispunibili per aiutà i clienti. Una lista di l'uffizii di vendita è i lochi hè inclusa in stu documentu.

U supportu tecnicu hè dispunibule attraversu u websitu à: www.microchip.com/support

Funzione di prutezzione di codice di i dispositi Microchip

Nota i seguenti dettagli di a funzione di prutezzione di codice nantu à i prudutti Microchip:

  • I prudutti Microchip rispondenu à e specificazioni cuntenute in a so specifica Scheda di Dati Microchip.
  • Microchip crede chì a so famiglia di prudutti hè sicura quandu s'utilice in a manera prevista, in e specificazioni operative, è in cundizioni normali.
  • Microchip valorizza è prutegge in modu aggressivu i so diritti di pruprietà intellettuale. I tentativi di violazione di e funzioni di prutezzione di u codice di u produttu Microchip sò strettamente pruibiti è ponu violà a Digital Millennium Copyright Act.
  • Nè Microchip nè un altru fabricatore di semiconductor pò guarantisci a sicurità di u so codice. A prutezzione di u codice ùn significa micca chì guarantimu chì u pruduttu hè "unbreakable". A prutezzione di u codice hè in constante evoluzione. Microchip hè impegnatu à migliurà continuamente e funzioni di prutezzione di codice di i nostri prudutti

Avvisu Legale

Questa publicazione è l'infurmazioni quì ponu esse aduprate solu cù i prudutti Microchip, cumpresu per cuncepisce, pruvà,
è integra i prudutti Microchip cù a vostra applicazione. L'usu di sta infurmazione in ogni altra manera viola questi
termini. L'infurmazioni riguardanti l'applicazioni di u dispositivu sò furnite solu per a vostra comodità è ponu esse rimpiazzate
da l'aghjurnamenti. Hè a vostra rispunsabilità per assicurà chì a vostra applicazione risponde à e vostre specificazioni. Cuntattate u vostru
uffiziu locale di vendita Microchip per supportu supplementu o, uttene supportu supplementu à www.microchip.com/en us/support/design-help/client-support-services.

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Vendite è serviziu in u mondu sanu

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