MICROCHIP DDR Lire IP
Caractéristiques
- Nom du produit : IP de lecture DDR v2.0
- Compatible avec l'arbitre vidéo IP
- Utilisé pour lire une rafale de données continues à partir de la mémoire DDR
- Généralement utilisé dans les applications vidéo pour lire chaque ligne horizontale de l'image vidéo stockée dans la mémoire DDR
Le DDR Read IP dispose également de ports d'entrée et de sortie dans Arbiter
Le bus d'interface et l'interface AXI4 Stream sont répertoriés dans le manuel d'utilisation.
FAQ
- Quel est le but de DDR Read IP ?
- Quelle est la compatibilité requise pour DDR Read IP ?
- Dans quelles applications la DDR Read IP est-elle généralement utilisée ?
Introduction
DDR Read IP lit une rafale de données continues à partir de la mémoire DDR. L'adresse IP de lecture DDR doit être utilisée avec l'adresse IP Video Arbiter qui convertit les demandes de lecture en transactions AXI4. L'IP de lecture DDR est généralement utilisée dans les applications vidéo pour lire chaque ligne horizontale de l'image vidéo stockée dans la mémoire DDR.
Figure 1. Interface de l'arbitre SmartDesign
Caractéristiques principales
- Généralement utilisé pour lire les lignes d'image vidéo
- Prend en charge la largeur de pixel vidéo de sortie de 8, 16 et 32 bits
- Prend en charge l'interface Video Arbiter de 128, 256 et 512 bits
- Prend en charge l'interface de flux AXI4
Implémentation matérielle
L'IP génère les signaux de commande vers l'IP de l'arbitre vidéo sur la base des entrées utilisateur de l'adresse de début de trame de résolution horizontale. Le front montant de read_en_i initie une transaction de lecture. Les données de l'arbitre vidéo sont stockées dans un CDC FIFO qui convertit les données du domaine d'horloge DDR en domaine d'horloge pixel. Les données sont lues depuis FIFO sur le front descendant de read_en_i et décompressées pour générer des données de pixels. Le read_en_i doit être élevé pendant une durée suffisante pour terminer la transaction de lecture DDR et la durée recommandée est de plusieurs horloges égales à la résolution horizontale. La première ligne est lue à partir de l'adresse définie par frame_start_addr_i, et après chaque transaction de lecture, l'adresse est incrémentée de line_gap_i. L'adresse de lecture est réinitialisée à frame_start_addr_i à chaque signal frame_end_i. Les données de sortie sont élevées pour un nombre d'horloges à résolution horizontale.
Description de la conception
- La figure suivante montre le schéma de brochage de niveau supérieur de DDR Read.
Ports d'entrée et de sortie
Le tableau suivant répertorie les ports d'entrée et de sortie de l'IP de lecture DDR dans l'interface native.
Tableau 1-1. Ports d'entrée et de sortie de la lecture DDR en interface native.
| Nom du port | Taper | Largeur | Description |
| réinitialiser_i | Saisir | — | Signal de réinitialisation asynchrone actif bas à concevoir |
| pixel_clk_i | Saisir | — | Horloge pixel |
| ddr_clk_i | Saisir | — | Horloge DDR du contrôleur de mémoire |
| frame_end_i | Saisir | — | Signal de fin de trame |
| read_fr_i | Saisir | — | Signal d'activation de lecture pour la lecture |
| line_gap_i | Saisir | 16 bits | Espacement entre deux lignes |
| horz_resl_i | Saisir | 16 bits | Résolution horizontale |
| Nom du port | Taper | Largeur | Description |
| h_pan_i | Saisir | 12 bits | Décalage horizontal pour chaque ligne vidéo pour un panoramique horizontal |
| v_pan_i | Saisir | 12 bits | Décalage vertical par rapport à l'adresse de début de la trame pour le panoramique vertical |
| read_ackn_i | Saisir | — | Accusé de réception de la demande de lecture de l'arbitre vidéo |
| read_done_i | Saisir | — | Lire l'entrée d'achèvement de l'arbitre vidéo |
| ddr_data_valid_i | Saisir | — | Lire les données valides de l'arbitre |
| frame_start_addr | Saisir | 8 bits | Adresse de début de l'image vidéo |
| wdata_i | Saisir | Largeur des données d'entrée | Lire les données de l'arbitre |
| read_req_o | Sortir | — | Lire la demande à l'arbitre |
| read_start_addr_o | Sortir | 32 bits | Adresse DDR à partir de laquelle la lecture doit être démarrée |
| burst_size_o | Sortir | 8 bits | Lire la taille de rafale |
| data_valid_o | Sortir | — | Données valides |
| données_o | Sortir | Largeur des données de sortie | Données pour le pipeline vidéo |
Le tableau suivant répertorie les ports d'entrée et de sortie de l'IP de lecture DDR dans le bus de l'interface Arbiter.
Tableau 1-2. Ports d'entrée et de sortie du DDR Read in Arbiter Interface Bus.
| Nom du port | Taper | Largeur | Description |
| RDATA_I | Saisir | Largeur des données d'entrée | Lire les données de l'arbitre |
| RVALID_I | Saisir | — | Lire les données valides de l'arbitre |
| ARREADY_I | Saisir | — | Accusé de réception de l'arbitre de la demande de lecture |
| BUSER_I | Saisir | — | Lire la fin |
| ARADDR_O | Sortir | 32 bits | Adresse DDR à partir de laquelle la lecture doit être démarrée |
| ARVALID_O | Sortir | — | Lire la demande à l'arbitre |
| ARSIZE_O | Sortir | 8 bits | Lire la taille de rafale |
Le tableau suivant répertorie les ports d'entrée et de sortie de l'IP de lecture DDR dans l'interface de flux AXI4.
Tableau 1-3. Ports d'entrée et de sortie de la lecture DDR dans l'interface de flux AXI4.
| Nom du port | Taper | Largeur | Description |
| HORLOGE_I | Saisir | — | Horloge pixel |
| RESET_n_I | Saisir | — | Signal de réinitialisation asynchrone actif bas à concevoir |
| TDATA_O | Sortir | Largeur des données de sortie | Données vidéo de sortie |
| TSTRB_O | Sortir | [Largeur des données de sortie/8 – 1 : 0] | Stroboscope de données vidéo de sortie |
| TKEEP_O | Sortir | [Largeur des données de sortie/8 – 1 : 0] | Conserver les données vidéo de sortie |
| TVALID_O | Sortir | — | Données vidéo de sortie valides |
| TUSER_O | Sortir | 4 bits | Données utilisateur de sortie 0bit = VSYNC
3 bits =Fin de trame |
| Nom du port | Taper | Largeur | Description |
| TLAST_O | Sortir | — | Sortie vidéo fin de trame |
Paramètres de configuration
Le tableau suivant répertorie les paramètres de configuration utilisés dans l'implémentation matérielle DDR Read IP. Il s'agit de paramètres génériques qui peuvent varier en fonction des exigences de l'application.
Tableau 1-4. Paramètres de configuration
| Nom du paramètre | Description |
| Résolution horizontale | Définit la résolution horizontale |
| Largeur des données d'entrée | Définit la largeur des données d'entrée (128, 256 et 512 bits) |
| Largeur des données de sortie | Définit la largeur des données de sortie (8, 16, 24, 32 et 64 bits) |
| Interface d'arbitrage | Options pour sélectionner l'interface Arbiter dans le menu déroulant comme interface native ou interface de bus |
| Interface de données | Options pour sélectionner l'interface de données dans le menu déroulant comme interface de flux native et AXI4 |
Utilisation des ressources
Le tableau suivant répertorie l'utilisation des ressources pour l'IP de lecture DDR dans l'interface native avec la largeur des données d'entrée = 256 et la largeur des données de sortie = 8.
Le bloc DDR Read est implémenté sur le périphérique PolarFire FPGA, package MPF300TS_ES-1FCG1152E.
Tableau 1-5. IP de lecture DDR dans l'interface native
| Ressource | Usage |
| DFF | 502 |
| 4 entrées LUT | 513 |
| MACC | 0 |
| LSRAM18K | 14 |
| Mémoire SRAM | 0 |
Le tableau suivant répertorie l'utilisation des ressources pour l'IP de lecture DDR dans l'interface de bus et le flux AXI4 avec une largeur de données d'entrée = 256 et une largeur de données de sortie = 8.
Tableau 1-6. IP de lecture DDR dans l'interface de bus et le flux AXI4
| Ressource | Usage |
| DFF | 512 |
| 4 entrées LUT | 514 |
| MACC | 0 |
| LSRAM18K | 14 |
| Mémoire SRAM | 0 |
Historique des révisions
L'historique des révisions décrit les modifications apportées au document. Les modifications sont répertoriées par révision, en commençant par la publication la plus récente.
| Révision | Date | Description |
| 1.0 | 03/2022 | Révision initiale. |
Prise en charge des micropuces FPGA
Le groupe de produits Microchip FPGA soutient ses produits avec divers services de support, y compris le service client, le centre de support technique client, un website et bureaux de vente dans le monde entier. Il est conseillé aux clients de visiter les ressources en ligne de Microchip avant de contacter l'assistance, car il est très probable que leurs questions aient déjà reçu une réponse.
Contactez le centre d'assistance technique via le website à www.microchip.com/support. Mentionnez le numéro de pièce du périphérique FPGA, sélectionnez la catégorie de cas appropriée et téléchargez la conception. files lors de la création d'un dossier de support technique. Contactez le service client pour une assistance produit non technique, telle que la tarification des produits, les mises à niveau des produits, les informations de mise à jour, le statut de la commande et l'autorisation.
- Depuis l'Amérique du Nord, appelez le 800.262.1060
- Depuis le reste du monde, appelez le 650.318.4460
- Fax, de n'importe où dans le monde, 650.318.8044
La micropuce Website
Microchip fournit une assistance en ligne via notre website à www.microchip.com/. Ce weble site est utilisé pour faire files et informations facilement accessibles aux clients. Voici quelques-uns des contenus disponibles :
- Support produit - Fiches techniques et errata, notes d'application et samples programmes, les ressources de conception, les guides d'utilisation et les documents de support matériel, les dernières versions logicielles et les logiciels archivés.
- Assistance technique générale – Foire aux questions (FAQ), demandes d'assistance technique, groupes de discussion en ligne, liste des membres du programme partenaire de conception de Microchip.
- Activités de Microchip – Guides de sélection et de commande de produits, derniers communiqués de presse de Microchip, liste des séminaires et des événements, listes des bureaux de vente, des distributeurs et des représentants d'usine de Microchip.
Service de notification de changement de produit
Le service de notification de changement de produit de Microchip aide les clients à rester informés sur les produits Microchip. Les abonnés recevront des notifications par e-mail chaque fois qu'il y aura des modifications, des mises à jour, des révisions ou des errata liés à une famille de produits ou à un outil de développement spécifique.
Pour vous inscrire, rendez-vous sur www.microchip.com/pcn et suivez les instructions d'inscription.
Assistance clientèle
Les utilisateurs de produits Microchip peuvent recevoir de l'aide via plusieurs canaux :
- Distributeur ou représentant
- Bureau de vente local
- Ingénieur Solutions Embarquées (ESE)
- Assistance technique
Les clients doivent contacter leur distributeur, représentant ou ESE pour obtenir de l'aide. Les bureaux de vente locaux sont également disponibles pour aider les clients. Une liste des bureaux et emplacements de vente est incluse dans ce document. L'assistance technique est disponible via le website à: www.microchip.com/support.
Fonction de protection du code des appareils Microchip
Notez les détails suivants concernant la fonction de protection du code sur les produits Microchip :
- Les produits Microchip répondent aux spécifications contenues dans leur fiche technique Microchip particulière.
- Microchip estime que sa gamme de produits est sécurisée lorsqu'elle est utilisée de la manière prévue, dans le cadre des spécifications de fonctionnement et dans des conditions normales.
- Microchip valorise et protège de manière agressive ses droits de propriété intellectuelle. Les tentatives de violation des fonctionnalités de protection du code des produits Microchip sont strictement interdites et peuvent enfreindre le Digital Millennium Copyright Act.
- Ni Microchip ni aucun autre fabricant de semi-conducteurs ne peut garantir la sécurité de son code. La protection du code ne signifie pas que nous garantissons que le produit est « incassable ». La protection du code évolue constamment. Microchip s'engage à améliorer en permanence les fonctionnalités de protection du code de ses produits.
Mentions légales
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Documents / Ressources
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MICROCHIP DDR Lire IP [pdf] Guide de l'utilisateur DDR Lire IP, DDR, Lire IP, IP |
