MICROCHIP DDR Leer IP
Presupuesto
- Nombre del producto: DDR Read IP v2.0
- Compatible con vídeo árbitro IP
- Se utiliza para leer una ráfaga de datos continuos desde la memoria DDR.
- Normalmente se utiliza en aplicaciones de vídeo para leer cada línea horizontal del fotograma de vídeo almacenado en la memoria DDR.
El DDR Read IP también tiene puertos de entrada y salida en Arbiter
El bus de interfaz y la interfaz AXI4 Stream se enumeran en el manual del usuario.
Preguntas frecuentes
- ¿Cuál es el propósito de DDR Read IP?
- ¿Cuál es la compatibilidad requerida para DDR Read IP?
- ¿En qué aplicaciones se suele utilizar DDR Read IP?
Introducción
DDR Read IP lee una ráfaga de datos continuos de la memoria DDR. La IP de lectura DDR se debe utilizar con la IP de Video Arbiter que convierte las solicitudes de lectura en transacciones AXI4. La IP de lectura DDR se utiliza normalmente en aplicaciones de vídeo para leer cada línea horizontal del cuadro de vídeo almacenado en la memoria DDR.
Figura 1. Interfaz del árbitro SmartDesign
Características principales
- Normalmente se utiliza para leer líneas de fotogramas de vídeo.
- Admite anchos de píxeles de salida de vídeo de 8, 16 y 32 bits
- Admite interfaz de árbitro de vídeo de 128, 256 y 512 bits
- Admite la interfaz de transmisión AXI4
Implementación de hardware
La IP genera las señales de control para la IP del árbitro de vídeo en función de las entradas del usuario de la dirección de inicio del cuadro de resolución horizontal. El flanco ascendente de read_en_i inicia una transacción de lectura. Los datos del árbitro de vídeo se almacenan en un CDC FIFO que convierte los datos del dominio de reloj DDR al dominio de reloj de píxeles. Los datos se leen desde FIFO en el flanco descendente de read_en_i y se descomprimen para generar datos de píxeles. read_en_i debe ser alto durante una duración suficiente para completar la transacción de lectura DDR y la duración recomendada es de varios relojes iguales a la resolución horizontal. La primera línea se lee desde la dirección definida por frame_start_addr_i y, después de cada transacción de lectura, la dirección se incrementa en line_gap_i. La dirección de lectura se restablece a frame_start_addr_i en cada señal frame_end_i. Los datos de salida son altos para un número de relojes de resolución horizontal.
Descripción del diseño
- La siguiente figura muestra el diagrama de distribución de pines de nivel superior de DDR Read.
Puertos de entrada y salida
La siguiente tabla enumera los puertos de entrada y salida de DDR Read IP en la interfaz nativa.
Tabla 1-1. Puertos de entrada y salida del DDR leídos en la interfaz nativa.
| Nombre del puerto | Tipo | Ancho | Descripción |
| restablecer_i | Aporte | — | Señal de reinicio asincrónica baja activa para diseñar |
| pixel_clk_i | Aporte | — | Reloj de píxeles |
| ddr_clk_i | Aporte | — | Reloj DDR del controlador de memoria |
| marco_end_i | Aporte | — | Señal de fin de cuadro |
| read_en_i | Aporte | — | Señal de habilitación de lectura para lectura. |
| espacio_linea_i | Aporte | 16 bits | Separación de línea entre dos líneas |
| horz_resl_i | Aporte | 16 bits | Resolución horizontal |
| Nombre del puerto | Tipo | Ancho | Descripción |
| h_pan_i | Aporte | 12 bits | Desplazamiento horizontal para cada línea de video para panorámica horizontal |
| v_pan_i | Aporte | 12 bits | Desplazamiento vertical desde la dirección de inicio del fotograma para panorámica vertical |
| leer_ackn_i | Aporte | — | Acuse de recibo de solicitud de lectura del árbitro de vídeo |
| leer_hecho_i | Aporte | — | Lea la entrada de finalización del árbitro de video |
| ddr_data_valid_i | Aporte | — | Leer datos válidos del Arbiter |
| frame_start_addr | Aporte | 8 bits | Dirección de inicio del fotograma de vídeo |
| wdata_i | Aporte | Ancho de datos de entrada | Leer datos del árbitro |
| read_req_o | Producción | — | Leer la solicitud al árbitro. |
| read_start_addr_o | Producción | 32 bits | Dirección DDR desde donde se debe iniciar la lectura |
| tamaño_ráfaga_o | Producción | 8 bits | Leer tamaño de ráfaga |
| data_valid_o | Producción | — | Datos válidos |
| datos_o | Producción | Ancho de datos de salida | Datos para canalización de vídeos |
La siguiente tabla enumera los puertos de entrada y salida de DDR Read IP en el bus de la interfaz Arbiter.
Tabla 1-2. Puertos de entrada y salida del DDR leídos en el bus de interfaz Arbiter.
| Nombre del puerto | Tipo | Ancho | Descripción |
| RDATA_I | Aporte | Ancho de datos de entrada | Leer datos del árbitro |
| RVALID_I | Aporte | — | Leer datos válidos del Arbiter |
| YA_I | Aporte | — | Acuse de recibo del árbitro de la solicitud de lectura |
| BUSER_I | Aporte | — | Leer finalización |
| ARADDR_O | Producción | 32 bits | Dirección DDR desde donde se debe iniciar la lectura |
| ARVALID_O | Producción | — | Leer la solicitud al árbitro. |
| ARSIZE_O | Producción | 8 bits | Leer tamaño de ráfaga |
La siguiente tabla enumera los puertos de entrada y salida de DDR Read IP en la interfaz de transmisión AXI4.
Tabla 1-3. Puertos de entrada y salida de DDR leídos en la interfaz de flujo AXI4.
| Nombre del puerto | Tipo | Ancho | Descripción |
| RELOJ_I | Aporte | — | Reloj de píxeles |
| RESET_n_I | Aporte | — | Señal de reinicio asincrónica baja activa para diseñar |
| TDATA_O | Producción | Ancho de datos de salida | Salida de datos de vídeo |
| TSTRB_O | Producción | [Ancho de datos de salida/8 – 1: 0] | Luz estroboscópica de datos de vídeo de salida |
| TKEEP_O | Producción | [Ancho de datos de salida/8 – 1: 0] | Mantener datos de video de salida |
| TVALID_O | Producción | — | Datos de salida de vídeo válidos |
| TUSER_O | Producción | 4 bits | Datos de usuario de salida 0 bits = VSYNC
3 bits = final de trama |
| Nombre del puerto | Tipo | Ancho | Descripción |
| TLAST_O | Producción | — | Salida de vídeo al final del cuadro |
Parámetros de configuración
La siguiente tabla enumera los parámetros de configuración utilizados en la implementación del hardware DDR Read IP. Estos son parámetros genéricos y pueden variar según los requisitos de la aplicación.
Tabla 1-4. Parámetros de configuración
| Nombre del parámetro | Descripción |
| Resolución horizontal | Define la resolución horizontal. |
| Ancho de datos de entrada | Define el ancho de los datos de entrada (128, 256 y 512 bits) |
| Ancho de datos de salida | Define el ancho de los datos de salida (8, 16, 24, 32 y 64 bits) |
| Interfaz de árbitro | Opciones para seleccionar la interfaz del árbitro en el menú desplegable como interfaz nativa o de bus |
| Interfaz de datos | Opciones para seleccionar la interfaz de datos en el menú desplegable como interfaz nativa y de transmisión AXI4 |
Utilización de recursos
La siguiente tabla enumera la utilización de recursos para DDR Read IP en la interfaz nativa con el ancho de datos de entrada = 256 y el ancho de datos de salida = 8.
El bloque de lectura DDR se implementa en el dispositivo PolarFire FPGA, paquete MPF300TS_ES-1FCG1152E.
Tabla 1-5. DDR leer IP en interfaz nativa
| Recurso | Uso |
| DFF | 502 |
| 4 LUT de entrada | 513 |
| MACC | 0 |
| LSRAM 18K | 14 |
| Memoria RAM | 0 |
La siguiente tabla enumera la utilización de recursos para DDR Read IP en la interfaz de bus y el flujo AXI4 con un ancho de datos de entrada = 256 y un ancho de datos de salida = 8.
Tabla 1-6. DDR lectura de IP en interfaz de bus y transmisión AXI4
| Recurso | Uso |
| DFF | 512 |
| 4 LUT de entrada | 514 |
| MACC | 0 |
| LSRAM 18K | 14 |
| Memoria RAM | 0 |
Historial de revisiones
El historial de revisiones describe los cambios que se implementaron en el documento. Los cambios se enumeran por revisión, comenzando con la publicación más reciente.
| Revisión | Fecha | Descripción |
| 1.0 | 03/2022 | Revisión Inicial. |
Compatibilidad con microchips FPGA
El grupo de productos FPGA de Microchip respalda sus productos con varios servicios de soporte, incluido el Servicio al cliente, el Centro de soporte técnico al cliente, un websitio y oficinas de ventas en todo el mundo. Se sugiere a los clientes que visiten los recursos en línea de Microchip antes de comunicarse con el soporte, ya que es muy probable que sus consultas ya hayan sido respondidas.
Póngase en contacto con el Centro de Soporte Técnico a través del websitio en www.microchip.com/support. Mencione el número de pieza del dispositivo FPGA, seleccione la categoría de caso adecuada y cargue el diseño. files al crear un caso de soporte técnico. Comuníquese con el Servicio de atención al cliente para obtener soporte no técnico del producto, como precios de productos, actualizaciones de productos, información actualizada, estado de pedidos y autorización.
- Desde América del Norte, llame al 800.262.1060
- Desde el resto del mundo, llame al 650.318.4460
- Fax, desde cualquier parte del mundo, 650.318.8044
el microchip Websitio
Microchip ofrece soporte en línea a través de nuestro websitio en www.microchip.com/. Este webEl sitio se utiliza para hacer files e información fácilmente accesibles para los clientes. Algunos de los contenidos disponibles incluyen:
- Soporte de productos: hojas de datos y erratas, notas de aplicación y sampprogramas de archivos, recursos de diseño, guías de usuario y documentos de soporte de hardware, últimas versiones de software y software archivado.
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- Negocio de Microchip: guías de selección y pedidos de productos, comunicados de prensa más recientes de Microchip, listado de seminarios y eventos, listados de oficinas de ventas, distribuidores y representantes de fábrica de Microchip.
Servicio de Notificación de Cambio de Producto
El servicio de notificación de cambios de productos de Microchip ayuda a mantener a los clientes actualizados sobre los productos de Microchip. Los suscriptores recibirán notificaciones por correo electrónico cada vez que haya cambios, actualizaciones, revisiones o erratas relacionadas con una familia de productos específica o una herramienta de desarrollo de interés.
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Atención al cliente
Los usuarios de productos Microchip pueden recibir asistencia a través de varios canales:
- Distribuidor o Representante
- Oficina de ventas local
- Ingeniero de soluciones integradas (ESE)
- Apoyo técnico
Los clientes deben comunicarse con su distribuidor, representante o ESE para obtener ayuda. oficinas de ventas locales también están disponibles para ayudar a los clientes. En este documento se incluye una lista de oficinas y ubicaciones de ventas. El soporte técnico está disponible a través del websitio en: www.microchip.com/support.
Característica de protección de código de dispositivos de microchip
Tenga en cuenta los siguientes detalles de la función de protección de código en los productos Microchip:
- Los productos de Microchip cumplen con las especificaciones contenidas en su hoja de datos de Microchip particular.
- Microchip cree que su familia de productos es segura cuando se utiliza de la manera prevista, dentro de las especificaciones de funcionamiento y en condiciones normales.
- Microchip valora y protege agresivamente sus derechos de propiedad intelectual. Los intentos de violar las características de protección del código de los productos Microchip están estrictamente prohibidos y pueden violar la Ley de Derechos de Autor del Milenio Digital.
- Ni Microchip ni ningún otro fabricante de semiconductores puede garantizar la seguridad de su código. La protección del código no significa que garanticemos que el producto sea “irrompible”. La protección del código evoluciona constantemente. Microchip se compromete a mejorar continuamente las características de protección del código de nuestros productos.
Aviso legal
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