Guía del usuario de la interfaz de formato T v1.1

Introducción  (Haz una pregunta)

La interfaz IP de formato T ha sido diseñada para proporcionar una interfaz para que los FPGA se comuniquen con varios compatibles. Tamagawa productos como codificadores rotatorios.

Resumen (Haz una pregunta)

La siguiente tabla proporciona un resumen de las características de la interfaz T-Format.
Tabla 1. Características de la interfaz en formato T

Versión principal	Este documento se aplica a la interfaz T-Format v1.1.
Dispositivo compatible Familias	SoC PolarFire® fuego polar RTG4™ IGlú® 2 SmartFusion® 2
Apoyado Herramienta Fluir	Requiere Libero® SoC v11.8 o versiones posteriores.
Licencias	Se proporciona código RTL cifrado completo para el núcleo, lo que permite crear una instancia del núcleo con SmartDesign. La simulación, la síntesis y el diseño se realizan con el software Libero. T-Format Interface tiene licencia con RTL cifrado que debe adquirirse por separado. Para más información, ver Interfaz de formato T.

Características (Hacer una pregunta)

La interfaz T-Format tiene las siguientes características clave:

• Transmite y recibe datos seriales desde la capa física (interfaz RS-485)
• Alinea los datos según el formato T y proporciona estos datos como registros que son leídos por bloques posteriores.
• El dispositivo externo informa de las comprobaciones de errores, como paridad, discrepancia en la comprobación de redundancia cíclica (CRC), errores de transmisión, etc.
• Proporciona una función de alarma que se activa si el número de ocurrencias de fallas excede un umbral configurado
• Proporciona puertos para un bloque generador de CRC externo para que el usuario modifique el polinomio CRC si es necesario.

Implementación de IP Core en Libero Design Suite (Hacer una pregunta)

El núcleo IP debe instalarse en el catálogo de IP del software Libero SoC. Esto se hace automáticamente a través de la función de actualización del catálogo de IP en el software Libero SoC, o el núcleo de IP se descarga manualmente desde el catálogo. Una vez que el núcleo IP está instalado en el catálogo de IP del software Libero SoC, el núcleo se configura, genera y crea una instancia dentro de la herramienta Smart Design para su inclusión en la lista de proyectos Libero.

Utilización y rendimiento del dispositivo (Hacer una pregunta)

La siguiente tabla enumera la utilización del dispositivo utilizada para la interfaz T-Format.
Tabla 2. Utilización de la interfaz de formato T

Detalles del dispositivo		Recursos		Rendimiento (MHz)	RAM		Bloques matemáticos	Globales de chips
Familia	Dispositivo	Tablas de consulta (LUT)	DFF		LSRAM	µSRAM
SoC PolarFire®	MPFS250T	248	256	200	0	0	0	0
fuego polar	MPF300T	236	256	200	0	0	0	0
SmartFusion® 2	M2S150	248	256	200	0	0	0	0

Importante: 

1.  Los datos de esta tabla se capturan utilizando configuraciones típicas de síntesis y diseño. La fuente del reloj de referencia de CDR se configuró en Dedicado con otros valores del configurador sin cambios.
2. El reloj está limitado a 200 MHz mientras se ejecuta el análisis de tiempo para lograr los números de rendimiento.

Descripción funcional (Hacer una pregunta)

Esta sección describe los detalles de implementación de la interfaz T-Format.
La siguiente figura muestra el diagrama de bloques de nivel superior de la interfaz T-Format.
Figura 1-1. Diagrama de bloques de nivel superior de la interfaz IP de formato T

Para obtener detalles completos sobre el formato T, consulte Tamagawa hojas de datos. La siguiente tabla enumera los diversos comandos que se utilizan para solicitar datos del dispositivo externo y sus funciones, y la cantidad de campos de datos devueltos para cada comando.

Tabla 1-1. Comandos para el campo de control

ID de comando	Función	Número de campos de datos en el marco recibido
0	Ángulo del rotor (lectura de datos)	3
1	Datos multivuelta (lectura de datos)	3
2	ID del codificador (lectura de datos)	1
3	Datos de ángulo del rotor y multivuelta (lectura de datos)	8
7	Reiniciar	3
8	Reiniciar	3
C	Reiniciar	3

La siguiente figura muestra el diagrama de bloques a nivel de sistema de la interfaz T-Format.

Figura 1-2. Diagrama de bloques a nivel de sistema de la interfaz de formato T

La siguiente figura muestra el diagrama de bloques funcional de la interfaz T-Format.
Figura 1-3. Diagrama de bloques funcionales de la interfaz IP en formato T

Cada transacción de comunicación en formato T comienza con una transmisión de una trama de control (CF) del solicitante, seguida de una trama recibida desde el dispositivo externo. El bloque del transmisor TF genera datos en serie para enviarlos al dispositivo externo. También genera una señal tx_en_o opcional requerida por algunos convertidores RS-485. El codificador recibe los datos transmitidos y transmite una trama de datos en serie a la IP, que se recibe en el puerto de entrada rx_i del bloque de IP. El bloque TF_CF_DET primero detecta el campo de control e identifica el valor de ID. La longitud de los datos se determina en función del valor de ID recibido y los campos posteriores se reciben y almacenan en los registros respectivos utilizando el bloque TF_DATA_READ. Una vez almacenados los datos completos, los datos de todos los campos excepto el campo CRC se envían a un bloque generador de CRC externo y el CRC calculado generado por este bloque se compara con el CRC recibido. Algunos de los otros errores también se verifican y la señal done_o se afirma ('1' durante un ciclo sys_clk_i) después de cada transacción libre de errores.

1.1 Manejo de errores (Hacer una pregunta)

El bloque identifica los siguientes errores:

• Error de paridad en el campo de control recibido.
• Mala secuencia de inicio en el campo de control recibido
• Mensaje incompleto donde la línea RX está atascada en 0 o atascada en 1
• Discrepancia de CRC entre los datos en el campo CRC recibido y el CRC calculado
• Errores de transmisión, como error de paridad o error de delimitador en el CF transmitido, leídos en los bits 6 y 7 del campo de estado (consulte Tamagawa ficha de datos).

Estos errores, cuando el bloque los identifica, dan como resultado que se incremente un contador de fallas. Cuando el valor del contador de fallas excede el valor umbral configurado (configurado usando g_FAULT_THRESHOLD), se activa la salida alarm_o.
La salida de alarma se desactiva cuando la entrada alarm_clr_i es alta durante un período sys_clk_i. La señal tf_error_o se utiliza para mostrar el tipo de error que ha ocurrido. Estos datos se restablecen a 0 cuando comienza la siguiente transacción (start_i es
'1').
La siguiente tabla describe varios errores y su posición de bit correspondiente en el registro tf_error_o.

Tabla 1-2. terrores Registro Descripción

Poco	Función
5	Error del delimitador de TX: como se indica en el bit 7 del campo de estado
4	Error de paridad TX – como se indica en el bit 6 del campo de estado
3	Discrepancia de CRC entre el campo CRC recibido del esclavo y los datos CRC calculados
2	Mensaje incompleto: error del delimitador que genera tiempo de espera
1	Secuencia de inicio incorrecta en el campo de control recibido: “0010” no recibido antes del tiempo de espera
0	Error de paridad en el campo de control recibido

Parámetros de interfaz de formato T y señales de interfaz (Hacer una pregunta)

Esta sección analiza los parámetros en el configurador GUI de la interfaz T-Format y las señales de E/S.

2.1 Ajustes de configuración(Hacer una pregunta)

La siguiente tabla enumera la descripción de los parámetros de configuración utilizados en la implementación de hardware de la interfaz T-Format. Estos son parámetros genéricos y varían según los requisitos de la aplicación.
Tabla 2-1. Parámetro de configuración

Nombre de la señal	Descripción
g_TIMEOUT_TIME	Define el tiempo de espera entre campos sucesivos en un marco en múltiplos del período sys_clk_i.
g_FAULT_THRESHOLD	Define el valor del umbral de falla: alarm_o se activa cuando el contador de fallas excede este valor.

2.2 Señales de Entradas y Salidas (Hacer una pregunta)

La siguiente tabla enumera los puertos de entrada y salida de la interfaz T-Format.

Tabla 2-2. Entradas y salidas de la interfaz de formato T

Nombre de la señal	Dirección	Descripción
restablecer_i	Aporte	Señal de restablecimiento asíncrono bajo activo para diseñar
sys_clk_i	Aporte	Reloj del sistema
ref_clk_i	Aporte	Reloj de referencia, 2.5 MHz*
inicio_i	Aporte	Startsignal para iniciar la transacción de formato T: debe ser '1' durante un ciclo sys_clk_i
alarma_clr_i	Aporte	Señal de borrado de alarma: debe ser '1' durante un ciclo sys_clk_i
rx_i	Aporte	Entrada de datos en serie desde el codificador
crc_done_i	Aporte	Señal de finalización del bloque CRC externo: debe ser '1' para un ciclo sys_clk_i
cmd_i	Aporte	ID de ControlField que se enviará al codificador
crc_calc_i	Aporte	Salida del bloque generador CRC con bits invertidos, es decir, crc_gen(7) -> crc_calc_i (0), crc_gen(6)-> crc_calc_i(1),  ..  crc_gen(0)-> crc_calc_i(7)
tx_o	Producción	Salida de datos en serie al codificador.
tx_en_o	Producción	Señal de habilitación de transmisión: sube cuando la transmisión está en curso
hecho_o	Producción	Señal de transacción realizada: afirmada como un pulso con un ancho de un ciclo sys_clk_i
alarma_o	Producción	Señal de alarma: afirmada cuando el número de ocurrencias de fallas iguala el valor umbral configurado en g_FAULT_THRESHOLD
inicio_crc_o	Producción	Señal de inicio para bloque de generación de CRC

datos_crc_o	Producción	Bloque de generación de datos para CRC: los datos se proporcionan como: {CF, SF, D0, D1, D2, ..D7} sin delimitadores. En el caso de mensajes más cortos (donde solo D0-D2 tienen datos), los demás campos D3-D7 se toman como 0
tf_error_o	Producción	Registro de errores TF
sí	Producción	Valor de ID del campo de control en el marco recibido*
sf_o	Producción	Campo de estado de la trama recibida*
d0_o	Producción	Campo D0 de la trama recibida*
d1_o	Producción	Campo D1 de la trama recibida*
d2_o	Producción	Campo D2 de la trama recibida*
d3_o	Producción	Campo D3 de la trama recibida*
d4_o	Producción	Campo D4 de la trama recibida*
d5_o	Producción	Campo D5 de la trama recibida*
d6_o	Producción	Campo D6 de la trama recibida*
d7_o	Producción	Campo D7 de la trama recibida*
crc_o	Producción	Campo CRC de la trama recibida*

Nota: Para obtener más información, consulte la Tamagawa ficha de datos.

Diagramas de tiempo (Hacer una pregunta)

Esta sección analiza los diagramas de tiempo de la interfaz de formato T.
La siguiente figura muestra una transacción normal en formato T. La señal done_o se genera al final de cada transacción libre de errores y la señal tf_error_o permanece en 0.
Figura 3-1. Diagrama de tiempos – Transacción normal

La siguiente figura muestra una transacción en formato T con error CRC. La señal done_o no se genera y la señal tf_error_o es 8, lo que indica que se ha producido una discrepancia en CRC. La señal done_o se genera si la siguiente transacción no tiene ningún error.

Figura 3-2. Diagrama de tiempos – Error CRC

Banco de pruebas (Hacer una pregunta)

Se utiliza un banco de pruebas unificado para verificar y probar la interfaz de formato T denominado banco de pruebas de usuario. Se proporciona Testbench para comprobar la funcionalidad de la IP de la interfaz T-Format.

Simulación 4.1 (Hacer una pregunta)
Los siguientes pasos describen cómo simular el núcleo utilizando el banco de pruebas:

1. Abra la aplicación Libero SoC, haga clic en la pestaña Catálogo Libero SoC, expanda Soluciones-MotorControl
2. Haga doble clic en Interfaz de formato T y luego haga clic en Aceptar. La documentación asociada con la IP se enumera en Documentación.
   Importante: Si no ve la pestaña Catálogo, navegue hasta View Menú de Windows y haga clic en Catálogo para hacerlo visible.
   Figura 4-1. Núcleo IP de interfaz de formato T en el catálogo de Libero SoC
3. En la pestaña Jerarquía de estímulos, haga clic con el botón derecho en banco de pruebas (t_format_interface_tb.v), seleccione Simular diseño previo al sintetizador y luego haga clic en Abrir de forma interactiva.
   Importante: Si no ve la pestaña Jerarquía de estímulos, navegue hasta View > Menú de Windows y haga clic en Jerarquía de estímulos para que sea visible.

Figura 4-2. Simulación del diseño previo a la síntesis

ModelSim se abre con el banco de pruebas file como se muestra en la siguiente figura.
Figura 4-3. Ventana de simulación de ModelSim

Importante: Si la simulación se interrumpe debido al límite de tiempo de ejecución especificado en el .do file, use el comando run -all para completar la simulación.

Historial de revisiones (Hacer una pregunta)

El historial de revisiones describe los cambios que se implementaron en el documento. Los cambios se enumeran por revisión, comenzando con la publicación más reciente.
Tabla 5-1. Revisión histórica

Revisión	Fecha	Descripción
A	02/2023	La siguiente es la lista de cambios en la revisión A del documento: • Migré el documento a la plantilla Microchip. • Se actualizó el número de documento a DS50003503A de 50200812. • Agregado 3. Diagramas de tiempo. • Agregado 4. Banco de pruebas.
1.0	02/2018	La revisión 1.0 fue la primera publicación de este documento.

Compatibilidad con microchips FPGA (Hacer una pregunta)

El grupo de productos FPGA de Microchip respalda sus productos con varios servicios de soporte, incluido el Servicio al cliente, el Centro de soporte técnico al cliente, un websitio y oficinas de ventas en todo el mundo. Se sugiere a los clientes que visiten los recursos en línea de Microchip antes de ponerse en contacto con el soporte, ya que es muy probable que sus consultas ya hayan sido respondidas.
Comuníquese con el Centro de Soporte Técnico a través del websitio en www.microchip.com/support. Mencione el número de pieza del dispositivo FPGA, seleccione la categoría de caso adecuada y cargue el diseño files al crear un caso de soporte técnico.
Comuníquese con el Servicio de atención al cliente para obtener soporte no técnico del producto, como precios de productos, actualizaciones de productos, información actualizada, estado de pedidos y autorización.

• Desde América del Norte, llame al 800.262.1060
• Desde el resto del mundo, llame al 650.318.4460
• Fax, desde cualquier parte del mundo, 650.318.8044

Información del microchip (Hacer una pregunta)

el microchip Websitio(Hacer una pregunta)

Microchip ofrece soporte en línea a través de nuestro websitio en www.microchip.com/. Este webEl sitio se utiliza para hacer files e información fácilmente accesibles para los clientes. Algunos de los contenidos disponibles incluyen:

• Soporte de productos: hojas de datos y erratas, notas de aplicación y sampprogramas, recursos de diseño, guías de usuario y documentos de soporte de hardware, últimas versiones de software y software archivado
• Soporte técnico general: preguntas frecuentes (FAQ), solicitudes de soporte técnico, grupos de discusión en línea, lista de miembros del programa de socios de diseño de Microchip
• Negocios de Microchip: selector de productos y guías de pedido, los últimos comunicados de prensa de Microchip, lista de seminarios y eventos, listas de oficinas de ventas, distribuidores y representantes de fábrica de Microchip

Servicio de Notificación de Cambio de Producto (Hacer una pregunta)

El servicio de notificación de cambios de productos de Microchip ayuda a mantener a los clientes actualizados sobre los productos de Microchip. Los suscriptores recibirán una notificación por correo electrónico cada vez que haya cambios, actualizaciones, revisiones o erratas relacionadas con una familia de productos específica o una herramienta de desarrollo de interés.
Para registrarse, vaya a www.microchip.com/pcn y siga las instrucciones de registro.

Atención al cliente (Hacer una pregunta)

Los usuarios de productos Microchip pueden recibir asistencia a través de varios canales:

• Distribuidor o Representante
• Oficina de ventas local
• Ingeniero de soluciones integradas (ESE)
• Apoyo técnico

Los clientes deben comunicarse con su distribuidor, representante o ESE para obtener asistencia. También hay oficinas de ventas locales disponibles para ayudar a los clientes. En este documento se incluye una lista de oficinas de ventas y ubicaciones.
El soporte técnico está disponible a través de websitio en: www.microchip.com/support

Característica de protección de código de dispositivos de microchip (Hacer una pregunta)

Tenga en cuenta los siguientes detalles de la función de protección de código en los productos Microchip:

• Los productos de Microchip cumplen con las especificaciones contenidas en su hoja de datos de Microchip particular.
• Microchip cree que su familia de productos es segura cuando se utiliza de la manera prevista, dentro de las especificaciones de funcionamiento y en condiciones normales.
• Microchip valora y protege agresivamente sus derechos de propiedad intelectual. Los intentos de infringir las funciones de protección del código del producto Microchip están estrictamente prohibidos y pueden violar la Ley de derechos de autor del milenio digital.
• Ni Microchip ni ningún otro fabricante de semiconductores puede garantizar la seguridad de su código. La protección del código no significa que garanticemos que el producto sea “irrompible”. La protección del código evoluciona constantemente. Microchip se compromete a mejorar continuamente las características de protección del código de nuestros productos.

Aviso legal (Hacer una pregunta)

Esta publicación y la información contenida en este documento solo se pueden usar con productos de Microchip, incluso para diseñar, probar e integrar productos de Microchip con su aplicación. El uso de esta información de cualquier otra manera viola estos términos. La información sobre las aplicaciones del dispositivo se proporciona solo para su conveniencia y puede ser reemplazada por actualizaciones. Es su responsabilidad asegurarse de que su aplicación cumpla con sus especificaciones. Comuníquese con su oficina local de ventas de Microchip para obtener soporte adicional u obtenga soporte adicional en www.microchip.com/en-us/support/design-help/client-support-services.
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Marcas comerciales (Hacer una pregunta)

El nombre y logotipo de Microchip, el logotipo de Microchip, Adaptec, AVR, logotipo de AVR, AVR Freaks, BesTime, BitCloud, CryptoMemory, CryptoRF, dsPIC, flexPWR, HELDO, IGLOO, JukeBlox, KeeLoq, Kleer, LANCheck, LinkMD, maXStylus, maXTouch, MediaLB, megaAVR, Microsemi, logotipo de Microsemi, MOST, logotipo de MOST, MPLAB, OptoLyzer, PIC, picoPower, PICSTART, logotipo de PIC32, PolarFire, Prochip Designer, QTouch, SAM-BA, SenGenuity, SpyNIC, SST, logotipo de SST, SuperFlash, Symmetricom , SyncServer, Tachyon, TimeSource, tinyAVR, UNI/O, Vectron y XMEGA son marcas comerciales registradas de Microchip Technology Incorporated en EE. UU. y otros países.
AgileSwitch, APT, ClockWorks, The Embedded Control Solutions Company, EtherSynch, Flashtec, Hyper Speed ​​Control, HyperLight Load, Libero, motorBench, mTouch, Powermite 3, Precision Edge, ProASIC, ProASIC Plus, logotipo de ProASIC Plus, Quiet-Wire, SmartFusion, SyncWorld, Temux, TimeCesium, TimeHub, TimePictra, TimeProvider, TrueTime y ZL son marcas comerciales registradas de Microchip Technology Incorporated en EE. UU. Adjacent Key Suppression, AKS, Analog-for-the-Digital Age, Any Capacitor, AnyIn, AnyOut, Augmented Switching , BlueSky, BodyCom, Clockstudio, CodeGuard, CryptoAuthentication, CryptoAutomotive, CryptoCompanion, CryptoController, dsPICDEM, dsPICDEM.net, coincidencia de promedio dinámico, DAM, ECAN, Espresso T1S, EtherGREEN, GridTime, IdealBridge, programación en serie en circuito, ICSP, INICnet, Paralelo inteligente, IntelliMOS, conectividad entre chips, JitterBlocker, perilla en pantalla, KoD, maxCrypto, maxView, memBrain, Mindi, MiWi, MPASM, MPF, MPLAB Certified logo, MPLIB, MPLINK, MultiTRAK, NetDetach, Omniscient Code Generation, PICDEM, PICDEM.net, PICkit, PICtail, PowerSmart, PureSilicon, QMatrix, REAL ICE, Ripple Blocker, RTAX , RTG4, SAM-ICE, E/S cuádruple serie, simpleMAP, SimpliPHY, SmartBuffer, SmartHLS, SMART-IS, storClad, SQI, SuperSwitcher, SuperSwitcher II, Switchtec, SynchroPHY, Total Endurance, Trusted Time, TSHARC, USBCheck, VariSense, VectorBlox, VeriPHY, ViewSpan, WiperLock, XpressConnect y ZENA son marcas comerciales de Microchip Technology Incorporated en EE. UU. y otros países.
SQTP es una marca de servicio de Microchip Technology Incorporated en EE. UU.
El logotipo de Adaptec, Frequency on Demand, Silicon Storage Technology y Symmcom son marcas comerciales registradas de Microchip Technology Inc. en otros países.
GestIC es una marca registrada de Microchip Technology Germany II GmbH & Co. KG, una subsidiaria de Microchip Technology Inc., en otros países.
Todas las demás marcas comerciales mencionadas en este documento son propiedad de sus respectivas empresas.
© 2023, Microchip Technology Incorporated y sus subsidiarias. Reservados todos los derechos. ISBN: 978-1-6683-2140-9

Sistema de Gestión de Calidad (Hacer una pregunta)

Para obtener información sobre los sistemas de gestión de calidad de Microchip, visite www.microchip.com/calidad.

Ventas y servicio a nivel mundial

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Documentos / Recursos

Software de interfaz de formato T de MICROCHIP [pdf] Guía del usuario MPF300T, Software de interfaz de formato T, Software de interfaz, Software

Referencias

• Manual de usuario