Microchip Technology MIV_RV32 v3.0 IP コア ツールの動的ページ
製品情報
この製品は、32 年 3.0 月にリリースされた MIV_RV2020 vXNUMX です。Microsemi が開発した独自の機密製品です。 リリース ノートでは、IP の機能、機能拡張、システム要件、サポートされるファミリ、実装、既知の問題、および回避策に関する情報が提供されます。
特徴
- MIV_RV32 には次の機能があります。
配送タイプ
MIV_RV32 を使用するのにライセンスは必要ありません。 完全な RTL ソース コードがコアに提供されます。
サポートされている家族
サポートされているファミリは、ユーザー マニュアルの本文には記載されていません。
インストール手順
MIV_RV32 CPZ をインストールするには file、カタログ更新機能を使用するか、CPZ を手動で追加することにより、Libero ソフトウェアを通じて実行する必要があります。 file コア カタログの追加機能を使用します。 インストールすると、Libero プロジェクトに含めるためのデザイン内でコアを構成、生成、インスタンス化できます。 コアのインストール、ライセンス、および一般的な使用方法の詳細については、Libero SoC オンライン ヘルプを参照してください。
ドキュメント
ソフトウェア、デバイス、ハードウェアに関するアップデートと追加情報については、Microsemi SoC 製品グループの知的財産ページをご覧ください。 webサイト： http://www.microsemi.com/products/fpga-soc/design-resources/ip-cores.
MI-V 組み込みエコシステムから詳細情報を取得することもできます。
サポートされているテスト環境
MIV_RV32 にはテストベンチは提供されません。 MIV_RV32 RTL を使用すると、標準の Libero で生成されたテストベンチを使用してプログラムを実行するプロセッサをシミュレートできます。
廃止された機能とデバイス
なし。
既知の制限事項と回避策
次の制限と回避策が MIV_RV32 v3.0 リリースに適用されます。
- TCM の最大サイズは 256 Kb に制限されています。
- システム コントローラーを使用して PolarFire で TCM を初期化するには、ローカル パラメーター l_cfg_hard_tcm0_en が必要です。
この情報は、ユーザーマニュアルから提供されたテキストの抜粋に基づいていることに注意してください。 さらに詳細かつ完全な情報については、完全なユーザー マニュアルを参照するか、Microsemi に直接お問い合わせください。
改訂履歴
改訂履歴には、ドキュメントに実装された変更内容が記述されます。変更内容は、最新の出版物から順に改訂順にリストされます。
改訂 2.0
このドキュメントの改訂 2.0 は 2020 年 32 月に発行されました。以下は変更点の概要です。 コア名を MIV_RV32IMC から MIV_RVXNUMX に変更しました。 この構成に依存しない名前により、将来の追加の RISC-V ISA 拡張機能のサポートの拡張が可能になります。
改訂 1.0
リビジョン 1.0 は、2020 年 XNUMX 月に発行されたこのドキュメントの最初の出版物です。
MIV_RV32 v3.0 リリース ノート
以上view
これらのリリース ノートは、MIV_RV32 v3.0 の実稼働リリースとともに発行されます。 このドキュメントでは、IP の機能、拡張機能、システム要件、サポートされるファミリー、実装、既知の問題と回避策について詳しく説明します。
特徴
MIV_RV32には以下の特徴があります
- 低電力FPGAソフトコア実装向けに設計
- オプションの M および C 拡張機能を備えた RISC-V 標準 RV32I ISA をサポート
- アドレス範囲によってサイズが定義された密結合メモリの可用性
- TCM APB スレーブ (TAS) から TCM
- イメージをロードしてメモリから実行するブート ROM 機能
- 外部割り込み、タイマー割り込み、およびソフト割り込み
- 最大 XNUMX つのオプションの外部割り込み
- ベクトル化および非ベクトル化割り込みのサポート
- J付きのオプションのオンチップデバッグユニットTAG インタフェース
- AHBL、APB3、および AXI3/AXI4 オプションの外部バス インターフェイス
配送タイプ
MIV_RV32 を使用するのにライセンスは必要ありません。 コアには完全な RTL ソース コードが提供されます。
サポートされている家族
- PolarFire SoC®
- PolarFire RT®
- PolarFire®
- RTG4TM
- イグルー®2
- SmartFusion®2
インストール手順
MIV_RV32 CPZ file Libero ソフトウェアにインストールする必要があります。 これは、Libero または CPZ のカタログ更新機能を通じて自動的に行われます。 file コア カタログの追加機能を使用して手動で追加できます。 かつてのCPZ file が Libero にインストールされている場合、コアは Libero プロジェクトに含めるためのデザイン内で構成、生成、インスタンス化できます。 コアのインストール、ライセンス、および一般的な使用方法の詳細については、Libero SoC オンライン ヘルプを参照してください。
ドキュメント
このリリースには、MIV_RV32 ハンドブックと RISC-V 仕様文書のコピーが含まれています。 このハンドブックでは、コア機能について説明し、このコアのシミュレーション、合成、配置配線の方法について段階的に説明し、実装に関する提案も提供します。 IP ドキュメントの入手手順については、Libero SoC オンライン ヘルプを参照してください。 元の手順を説明するデザインガイドも含まれています。ampPolarFire® 用の Libero デザイン。 ソフトウェア、デバイス、ハードウェアに関するアップデートと追加情報については、Microsemi SoC 製品グループの知的財産ページをご覧ください。 webサイト： http://www.microsemi.com/products/fpga-soc/design-resources/ip-cores
MI-V 組み込みエコシステムから詳細情報を取得することもできます。
サポートされているテスト環境
MIV_RV32 にはテストベンチは提供されません。 MIV_RV32 RTL を使用すると、標準の Libero が生成したテストベンチを使用してプログラムを実行するプロセッサをシミュレートできます。
廃止された機能とデバイス
なし。
既知の制限事項と回避策
MIV_RV32 v3.0 リリースに適用される制限事項と回避策は次のとおりです。
- TCM の最大サイズは 256 Kb に制限されています。
- システム コントローラー、miv_rv0_opsrv_cfg_pkg.v 内のローカル パラメーター l_cfg_hard_tcm32_en を使用して PolarFire で TCM を初期化するには file 合成前に 1'b1 に変更する必要があります。 MIV_RV2.7 v32 ハンドブックのセクション 3.0 を参照してください。
- FlashPro 5 を使用した GPIO 経由のデバッグは、最大 10 MHz に制限する必要があります。
- Jに注意してくださいTAG_TRSTN 入力はアクティブ Low になりました。 以前のバージョンでは、この入力はアクティブに High でした。
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ドキュメント / リソース
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