Microchip Technology MIV_RV32 v3.0 IP 코어 도구 동적 페이지
제품 정보
이 제품은 32년 3.0월에 출시된 MIV_RV2020 vXNUMX입니다. Microsemi에서 개발한 독점적이고 기밀 제품입니다. 릴리스 노트는 IP의 기능, 개선 사항, 시스템 요구 사항, 지원되는 제품군, 구현, 알려진 문제 및 해결 방법에 대한 정보를 제공합니다.
특징
- MIV_RV32에는 다음과 같은 기능이 있습니다:
배송 유형
MIV_RV32를 사용하는 데 라이센스가 필요하지 않습니다. 코어에 대한 전체 RTL 소스 코드가 제공됩니다.
지원되는 가족
지원되는 제품군은 사용자 설명서 텍스트에 언급되어 있지 않습니다.
설치 지침
MIV_RV32 CPZ를 설치하려면 file, 카탈로그 업데이트 기능을 사용하거나 수동으로 CPZ를 추가하여 Libero 소프트웨어를 통해 수행해야 합니다. file Add Core 카탈로그 기능을 사용합니다. 설치가 완료되면 코어를 구성, 생성 및 인스턴스화하여 Libero 프로젝트에 포함할 수 있습니다. 코어 설치, 라이선싱 및 일반적인 사용에 대한 자세한 지침은 Libero SoC 온라인 도움말을 참조하십시오.
선적 서류 비치
소프트웨어, 장치 및 하드웨어에 대한 업데이트 및 추가 정보는 Microsemi SoC 제품 그룹의 지적 재산 페이지를 방문하십시오. web대지: http://www.microsemi.com/products/fpga-soc/design-resources/ip-cores.
더 많은 정보는 MI-V 임베디드 생태계에서 얻을 수 있습니다.
지원되는 테스트 환경
MIV_RV32에는 테스트벤치가 제공되지 않습니다. MIV_RV32 RTL은 표준 Libero 생성 테스트벤치를 사용하여 프로그램을 실행하는 프로세서를 시뮬레이션하는 데 사용할 수 있습니다.
중단된 기능 및 장치
없음.
알려진 제한 사항 및 해결 방법
다음 제한 사항 및 해결 방법은 MIV_RV32 v3.0 릴리스에 적용됩니다.
- TCM의 최대 크기는 256Kb로 제한됩니다.
- 시스템 컨트롤러를 사용하여 PolarFire에서 TCM을 초기화하려면 로컬 매개변수 l_cfg_hard_tcm0_en이 필요합니다.
이 정보는 사용자 설명서에서 제공된 텍스트 추출물을 기반으로 합니다. 더 자세하고 완전한 정보는 전체 사용자 설명서를 참조하거나 Microsemi에 직접 문의하세요.
개정 내역
개정 내역은 문서에서 구현된 변경 사항을 설명합니다. 변경 사항은 최신 출판물부터 시작하여 개정별로 나열됩니다.
개정판 2.0
이 문서의 개정판 2.0은 2020년 32월에 게시되었습니다. 다음은 변경 사항의 요약입니다. 코어 이름을 MIV_RV32IMC에서 MIV_RVXNUMX로 변경했습니다. 이 구성 중립적 이름은 추가 RISC-V ISA 확장에 대한 지원을 향후 확장할 수 있게 해줍니다.
개정판 1.0
개정판 1.0은 2020년 XNUMX월에 출판된 이 문서의 첫 번째 간행물입니다.
MIV_RV32 v3.0 릴리스 노트
위에view
이 릴리스 노트는 MIV_RV32 v3.0의 프로덕션 릴리스와 함께 발행됩니다. 이 문서는 IP의 기능, 개선 사항, 시스템 요구 사항, 지원되는 제품군, 구현 및 알려진 문제 및 해결 방법에 대한 세부 정보를 제공합니다.
특징
MIV_RV32에는 다음과 같은 기능이 있습니다.
- 저전력 FPGA 소프트 코어 구현을 위해 설계되었습니다.
- 옵션 M 및 C 확장을 갖춘 RISC-V 표준 RV32I ISA 지원
- 주소 범위로 정의된 크기를 갖춘 밀접하게 결합된 메모리의 가용성
- TCM APB 슬레이브(TAS) - TCM
- 이미지를 로드하고 메모리에서 실행하는 Boot ROM 기능
- 외부, 타이머 및 소프트 인터럽트
- 최대 6개의 선택형 외부 인터럽트
- 벡터화 및 비벡터화 인터럽트 지원
- J를 갖춘 옵션 온칩 디버그 장치TAG 인터페이스
- AHBL, APB3 및 AXI3/AXI4 옵션 외부 버스 인터페이스
배송 유형
MIV_RV32를 사용하는 데 라이센스가 필요하지 않습니다. 코어에 대한 완전한 RTL 소스 코드가 제공됩니다.
지원되는 가족
- 폴라파이어 SoC®
- 폴라파이어 RT®
- 폴라파이어®
- RTG4TM
- 이글루®2
- 스마트퓨전®2
설치 지침
MIV_RV32 CPZ file Libero 소프트웨어에 설치해야 합니다. 이는 Libero의 카탈로그 업데이트 기능이나 CPZ를 통해 자동으로 수행됩니다. file 코어 카탈로그 추가 기능을 사용하여 수동으로 추가할 수 있습니다. 일단 CPZ file Libero에 설치되면 코어를 Libero 프로젝트에 포함하기 위해 설계 내에서 구성, 생성 및 인스턴스화할 수 있습니다. 코어 설치, 라이선싱 및 일반적인 사용에 대한 자세한 지침은 Libero SoC 온라인 도움말을 참조하세요.
선적 서류 비치
이 릴리스에는 MIV_RV32 핸드북과 RISC-V 사양 문서의 사본이 들어 있습니다. 이 핸드북은 핵심 기능을 설명하고 이 코어를 시뮬레이션, 합성, 배치 및 라우팅하는 방법에 대한 단계별 지침과 구현 제안을 제공합니다. IP 문서를 얻는 방법에 대한 지침은 Libero SoC 온라인 도움말을 참조하세요. 또한 설계 가이드도 포함되어 있으며, 이 가이드에서는 example Libero는 PolarFire®를 위한 디자인입니다. 소프트웨어, 장치 및 하드웨어에 대한 업데이트 및 추가 정보는 Microsemi SoC Products Group의 지적 재산 페이지를 방문하세요. web대지: http://www.microsemi.com/products/fpga-soc/design-resources/ip-cores
더 많은 정보는 MI-V 임베디드 생태계에서 얻을 수 있습니다.
지원되는 테스트 환경
MIV_RV32에는 테스트벤치가 제공되지 않습니다. MIV_RV32 RTL은 표준 Libero 생성 테스트벤치를 사용하여 프로그램을 실행하는 프로세서를 시뮬레이션하는 데 사용할 수 있습니다.
중단된 기능 및 장치
없음.
알려진 제한 사항 및 해결 방법
다음은 MIV_RV32 v3.0 릴리스에 적용되는 제한 사항과 해결 방법입니다.
- TCM의 최대 크기는 256Kb로 제한됩니다.
- 시스템 컨트롤러를 사용하여 PolarFire에서 TCM을 초기화하려면 miv_rv0_opsrv_cfg_pkg.v의 로컬 매개변수 l_cfg_hard_tcm32_en을 사용합니다. file 합성 전에 1'b1로 변경해야 합니다. MIV_RV2.7 v32 핸드북의 섹션 3.0을 참조하세요.
- FlashPro 5를 사용하여 GPIO를 통한 디버깅은 최대 10MHz로 제한해야 합니다.
- J를 참고하세요TAG_TRSTN 입력은 이제 액티브 로우입니다. 이전 버전에서는 이 입력이 액티브 하이였습니다.
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Microchip Technology Inc.(Nasdaq: MCHP)의 자회사인 Microsemi Corporation과 그 계열사는 스마트하고 연결되고 안전한 임베디드 제어 솔루션의 선도적 공급업체입니다. 사용하기 쉬운 개발 도구와 포괄적인 제품 포트폴리오를 통해 고객은 위험을 줄이는 동시에 총 시스템 비용과 출시 시간을 단축하는 최적의 설계를 만들 수 있습니다. 이러한 솔루션은 산업, 자동차, 소비자, 항공우주 및 방위, 통신 및 컴퓨팅 시장에서 120,000명 이상의 고객에게 서비스를 제공합니다. 애리조나주 챈들러에 본사를 둔 이 회사는 신뢰할 수 있는 배송 및 품질과 함께 뛰어난 기술 지원을 제공합니다. 자세한 내용은 다음에서 확인하세요. www.microsemi.com.
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문서 / 리소스
 | Microchip Technology MIV_RV32 v3.0 IP 코어 도구 동적 페이지 [PDF 파일] 사용자 매뉴얼 MIV_RV32 v3.0 IP Core 도구 동적 페이지, MIV_RV32 v3.0, IP Core 도구 동적 페이지, Core 도구 동적 페이지, 도구 동적 페이지 |
