Microchip Technology MIV_RV32 v3.0 IP Core Tool Dynamische Seite
Produktinformationen
Das Produkt ist MIV_RV32 v3.0, veröffentlicht im Oktober 2020. Es handelt sich um ein proprietäres und vertrauliches Produkt, das von Microsemi entwickelt wurde. Die Versionshinweise enthalten Informationen zu den Funktionen, Verbesserungen, Systemanforderungen, unterstützten Familien, Implementierungen, bekannten Problemen und Problemumgehungen des IP.
Merkmale
- MIV_RV32 verfügt über die folgenden Funktionen:
Lieferarten
Für die Nutzung von MIV_RV32 ist keine Lizenz erforderlich. Für den Kern wird der komplette RTL-Quellcode bereitgestellt.
Unterstützte Familien
Die unterstützten Familien werden im Benutzerhandbuchtext nicht erwähnt.
Installationsanleitung
So installieren Sie das MIV_RV32 CPZ file, muss dies über die Libero-Software erfolgen, indem entweder die Katalogaktualisierungsfunktion verwendet wird oder die CPZ manuell hinzugefügt wird file mit der Funktion „Kernkatalog hinzufügen“ verwenden. Nach der Installation kann der Kern innerhalb eines Designs zur Einbindung in das Libero-Projekt konfiguriert, generiert und instanziiert werden. Weitere Anweisungen zur Kerninstallation, Lizenzierung und allgemeinen Verwendung finden Sie in der Online-Hilfe von Libero SoC.
Dokumentation
Für Updates und zusätzliche Informationen zu Software, Geräten und Hardware besuchen Sie die Seiten zum geistigen Eigentum der Microsemi SoC Products Group webWebsite: http://www.microsemi.com/products/fpga-soc/design-resources/ip-cores.
Weitere Informationen erhalten Sie auch im eingebetteten MI-V-Ökosystem.
Unterstützte Testumgebungen
Mit MIV_RV32 wird keine Testbench bereitgestellt. Der MIV_RV32 RTL kann verwendet werden, um den Prozessor zu simulieren, der ein Programm unter Verwendung einer standardmäßigen, von Libero generierten Testbench ausführt.
Nicht mehr verfügbare Funktionen und Geräte
Keiner.
Bekannte Einschränkungen und Problemumgehungen
Für die Version MIV_RV32 v3.0 gelten die folgenden Einschränkungen und Problemumgehungen:
- Der TCM ist auf eine maximale Größe von 256 Kb begrenzt.
- Um das TCM in PolarFire mithilfe des Systemcontrollers zu initialisieren, ist ein lokaler Parameter l_cfg_hard_tcm0_en erforderlich.
Bitte beachten Sie, dass diese Informationen auf dem bereitgestellten Textauszug aus der Bedienungsanleitung basieren. Ausführlichere und vollständigere Informationen finden Sie im vollständigen Benutzerhandbuch oder wenden Sie sich direkt an Microsemi.
Änderungsverlauf
Der Revisionsverlauf beschreibt die Änderungen, die im Dokument vorgenommen wurden. Die Änderungen werden nach Revision aufgelistet, beginnend mit der aktuellsten Veröffentlichung.
Revision 2.0
Revision 2.0 dieses Dokuments wurde im Oktober 2020 veröffentlicht. Im Folgenden finden Sie eine Zusammenfassung der Änderungen. Der Kernname wurde von MIV_RV32IMC in MIV_RV32 geändert. Dieser konfigurationsneutrale Name ermöglicht eine zukünftige Erweiterung der Unterstützung für zusätzliche RISC-V ISA-Erweiterungen.
Revision 1.0
Revision 1.0 ist die erste Veröffentlichung dieses Dokuments, die im März 2020 veröffentlicht wurde.
MIV_RV32 v3.0 Versionshinweise
Überview
Diese Versionshinweise werden mit der Produktionsversion von MIV_RV32 v3.0 herausgegeben. Dieses Dokument enthält Details zu den Funktionen, Verbesserungen, Systemanforderungen, unterstützten Familien, Implementierungen sowie bekannten Problemen und Problemumgehungen des IP.
Merkmale
MIV_RV32 verfügt über die folgenden Funktionen
- Entwickelt für FPGA-Softcore-Implementierungen mit geringem Stromverbrauch
- Unterstützt den RISC-V-Standard RV32I ISA mit optionalen M- und C-Erweiterungen
- Verfügbarkeit von eng gekoppeltem Speicher, dessen Größe durch den Adressbereich definiert wird
- TCM APB-Slave (TAS) zum TCM
- Boot-ROM-Funktion zum Laden eines Images und Ausführen aus dem Speicher
- Externe, Timer- und Soft-Interrupts
- Bis zu sechs optionale externe Interrupts
- Unterstützung für vektorisierte und nicht vektorisierte Interrupts
- optionale On-Chip-Debug-Einheit mit einem JTAG Schnittstelle
- Optionale externe Busschnittstellen AHBL, APB3 und AXI3/AXI4
Lieferarten
Für die Nutzung von MIV_RV32 ist keine Lizenz erforderlich. Für den Kern wird ein vollständiger RTL-Quellcode bereitgestellt.
Unterstützte Familien
- PolarFire SoC®
- PolarFire RT®
- PolarFire®
- RTG4TM
- IGLU®2
- SmartFusion®2
Installationsanleitung
Das MIV_RV32 CPZ file muss in der Libero-Software installiert werden. Dies erfolgt automatisch über die Katalogaktualisierungsfunktion in Libero oder CPZ file kann mit der Funktion Kernkatalog hinzufügen manuell hinzugefügt werden. Einmal die CPZ file Ist in Libero installiert, kann der Kern innerhalb eines Designs zur Einbindung in das Libero-Projekt konfiguriert, generiert und instanziiert werden. Weitere Anweisungen zur Kerninstallation, Lizenzierung und allgemeinen Verwendung finden Sie in der Online-Hilfe von Libero SoC.
Dokumentation
Diese Version enthält eine Kopie des MIV_RV32-Handbuchs und der RISC-V-Spezifikationsdokumente. Das Handbuch beschreibt die Kernfunktionalität und gibt Schritt-für-Schritt-Anleitungen zur Simulation, Synthese sowie zur Platzierung und Weiterleitung dieses Kerns sowie Vorschläge zur Implementierung. Anweisungen zum Erhalten der IP-Dokumentation finden Sie in der Online-Hilfe von Libero SoC. Ein Design-Guide ist ebenfalls enthalten, der durch ein Ex führtample Libero-Design für PolarFire®. Für Updates und zusätzliche Informationen zu Software, Geräten und Hardware besuchen Sie die Seiten zum geistigen Eigentum der Microsemi SoC Products Group webWebsite: http://www.microsemi.com/products/fpga-soc/design-resources/ip-cores
Weitere Informationen erhalten Sie auch im eingebetteten MI-V-Ökosystem.
Unterstützte Testumgebungen
Mit MIV_RV32 wird keine Testbench bereitgestellt. Der MIV_RV32 RTL kann verwendet werden, um den Prozessor zu simulieren, der ein Programm unter Verwendung einer von Libero generierten Standardprüfbank ausführt.
Nicht mehr verfügbare Funktionen und Geräte
Keiner.
Bekannte Einschränkungen und Problemumgehungen
Im Folgenden sind die Einschränkungen und Problemumgehungen aufgeführt, die für die Version MIV_RV32 v3.0 gelten.
- Der TCM ist auf eine maximale Größe von 256 Kb begrenzt.
- Um den TCM in PolarFire mithilfe des Systemcontrollers zu initialisieren, ist ein lokaler Parameter l_cfg_hard_tcm0_en in miv_rv32_opsrv_cfg_pkg.v erforderlich file sollte vor der Synthese in 1'b1 geändert werden. Siehe Abschnitt 2.7 im MIV_RV32 v3.0-Handbuch.
- Das Debuggen über GPIO mit FlashPro 5 sollte auf maximal 10 MHz begrenzt sein.
- Bitte beachten Sie das JTAGDer _TRSTN-Eingang ist jetzt aktiv niedrig. In früheren Versionen war dieser Eingang aktiv hoch.
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Microsemi Corporation, eine Tochtergesellschaft von Microchip Technology Inc. (Nasdaq: MCHP), und ihre Tochtergesellschaften sind führende Anbieter intelligenter, vernetzter und sicherer eingebetteter Steuerungslösungen. Ihre benutzerfreundlichen Entwicklungstools und ihr umfassendes Produktportfolio ermöglichen es Kunden, optimale Designs zu erstellen, die das Risiko reduzieren und gleichzeitig die Gesamtsystemkosten und die Markteinführungszeit senken. Diese Lösungen dienen mehr als 120,000 Kunden in den Märkten Industrie, Automobil, Verbraucher, Luft- und Raumfahrt und Verteidigung, Kommunikation und Computer. Das Unternehmen mit Hauptsitz in Chandler, Arizona, bietet hervorragenden technischen Support sowie zuverlässige Lieferung und Qualität. Erfahren Sie mehr unter www.microsemi.com.
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