Fonti IP RX DisplayPort Tx

Display Port RX IP User Guide

Introduzione (Fate una quistione)

DisplayPort Rx IP hè pensatu per riceve video da fonti DisplayPort Tx. Hè destinatu à u PolarFire® Applicazioni FPGA è implementate basate nantu à u protocolu DisplayPort Standard 1.4 di l'Associazione Video Elettronica Standards (VESA). Per più infurmazione nantu à u protocolu VESA, vede VESA. Supporta i tassi standard di 1.62, 2.7, 5.4 è 8.1 Gbps per i display.

Riassuntu (Fate una quistione)

A tabella seguente furnisce un riassuntu di e caratteristiche IP DisplayPort Rx.

Tabella 1. Riassuntu

Versione Core	Stu documentu si applica à DisplayPort Rx v2.1.
Famiglie di Dispositivi Supportati	PolarFire® SoC PolarFire
U Flussu di Strumenta Supportatu	Richiede Libero® SoC v12.0 o versioni successive.
Licenza	U core hè licenziatu chjusu per u testu chjaru RTL. Supporta a generazione di RTL cifrati per a versione Verilog di core senza licenza.

Features (Fate una quistione)

E caratteristiche chjave di DisplayPort Rx sò listate cusì:

• Supportu 1, 2, o 4 Lanes
• Supportu 6, 8 è 10 Bits Per Componente
• Supporta finu à 8.1 Gbps Per Lane
• Supporta u protocolu DisplayPort 1.4
• Supporta solu un Single Video Stream o Modu SST, è u Modu MST ùn hè micca Supportatu
• A trasmissione audio ùn hè micca supportata

Utilizazione è prestazione di u dispositivu (Fate una quistione)

A tavula seguente lista l'utilizazione è u rendiment di u dispusitivu.

Tabella 2. Utilizazione è prestazione di u dispositivu

Famiglia	Dispositivu	LUT	DFF	Prestazione (MHz)	LSRAM	µSRAM	Blocchi di matematica	Chip Global
PolarFire®	MPF300T	30652	14123	200	28	32	0	2

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Implementazione di hardware

1. Implementazione di hardware (Fate una quistione)

A figura seguente mostra l'implementazione di DisplayPort Rx IP.

Figura 1-1. Implementazione di DisplayPort Rx IP

DisplayPort Rx IP include i seguenti:

• Modulu Descrambler
• Modulu di ricevitore di corsia
• Modulu Video Stream Receiver
• Modulu AUX_CH

Descrambler de-scrambles i dati di corsia di input. U receptore Lane demultiplexes ogni tipu di dati in ogni corsia. U Video Stream Receiver riceve pixel video da u receptore di a strada, recupera u signale di u video stream. U modulu AUX_CH riceve u cumandimu AUX Request da u dispositivu sorgente DisplayPort è trasmette AUX Risposta à u dispositivu sorgente DisplayPort.

1.1 Descrizzione Funziunale (Fate una quistione)

Questa sezione descrive a descrizzione di a funzione di u DisplayPort Rx IP.

HPD

L'IP DisplayPort Rx emette u signale HPD secondu i paràmetri di u software di l'applicazione DisplayPort sink. Dopu chì l'IP DisplayPort Rx hè prontu, u software di l'applicazione di lavamanu DisplayPort deve stabilisce u signale HPD à 1. Quandu s'aspittava chì u dispositivu sorgente DisplayPort torna à leghje l'estatus di l'apparecchiu di lavamanu o ri-formazione, u software di l'applicazione DisplayPort sink deve stabilisce un HPD. per generà u signale di interruzzione HPD.

Canale AUX

U dispositivu sorgente DisplayPort comunica u lavamanu DisplayPort attraversu un Canale AUX. U dispusitivu fonte chì invià a transazzione di dumanda à u dispusitivu di lavamanu è u dispusitivu di lavamanu chì manda a transazzione di Rispondi à u Dispositivu fonte. DisplayPort Rx implementa u trasmettitore di transazzione AUX è ricevitore. Per u trasmettitore di transazzione AUX, u software di applicazione DisplayPort sink furnisce tutti i byte di cuntenutu di transazzione AUX, l'IP DisplayPort Rx genera u bitstream di transazzione. Per u receptore di transazzione AUX, DisplayPort Rx IP riceve a transazzione è estrae tutti i bytes à u software di l'applicazione DisplayPort. U Link Policy Maker è u Stream Policy Maker deve esse implementatu in u software di l'applicazione DisplayPort.

Trasmissione Video Stream

U DisplayPort Rx IP supporta RGB 4: 4: 4, è supporta solu un flussu video unicu. Dopu chì a furmazione hè fatta è u flussu di video hè pronta, u DisplayPort Rx IP principia à trasmette u flussu di video. Dopu a furmazione, l'IP DisplayPort Rx deve esse attivatu per riceve video. L'IP DisplayPort Rx ùn include micca una funzione di ricuperazione di u video clock. L'utilizatore deve ricuperà u video clock fora di l'IP DisplayPort Rx o aduprà un clock di frequenza abbastanza alta fissa per emette i dati di u flussu di video.

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Applicazione IP DisplayPort Rx

2. Applicazione IP DisplayPort Rx (Fate una quistione) A figura seguente mostra a tipica applicazione DisplayPort Rx IP.

Figura 2-1. Applicazione tipica per DisplayPort Rx IP

Cum'è mostra in a figura precedente, u bloccu transceiver riceve quattru dati di corsi. Ci sò quattru FIFO asincroni per sincronizà tutte e dati di corsi in un duminiu di clock. Questi dati di quattru corsie sò decodificati à u codice 8B in i moduli di decodificatori 8B10B. L'IP DisplayPort Rx riceve dati di corsi 8B è dati di flussu di video in output; travaglia ancu cù u software RISC-V per finisce a furmazione è Link Policy Maker. I dati di u flussu di video recuperati sò processati in u modulu di Trattamentu di l'Image è genera output nantu à l'interfaccia di output RGB.

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Parametri DisplayPort Rx è signali di l'interfaccia

3. Parametri DisplayPort Rx è signali di l'interfaccia (Fate una quistione) 

Questa sezione discute i paràmetri in u configuratore GUI DisplayPort Tx è i segnali I / O. 

3.1 Paràmetri di cunfigurazione (Fate una quistione)

A tabella seguente lista a descrizzione di i paràmetri di cunfigurazione utilizati in l'implementazione hardware di DisplayPort Rx. Quessi sò parametri generici è variati secondu u requisitu di l'applicazione.

Table 3-1. Parametri di cunfigurazione

Nome	Default	Descrizzione
Prufundità di u buffer di linea	2048	Profundità di buffer di linea di output Deve esse più grande di u numeru di pixel di linea
Numero di corsi	4	Supporta 1, 2 è 4 corsie

3.2 Inputs è Output Signals (Fate una quistione)

A tavula seguente lista i porti di input è output di DisplayPort Rx IP.

Table 3-2. Porti di input è output di DisplayPort Rx IP

Interfaccia	Larghezza		Descrizzione di direzzione
vclk_i	1	Input	Video clock
dpclk_i	1	Input	DisplayPort IP clock di travagliu Hè DisplayPortLaneRate/40 Per esample, DisplayPort lane rate hè 2.7 Gbps, dpclk_i hè 2.7 Gbps/40 = 67.5 MHz
aux_clk_i	1	Input	AUX Channel clock, hè 100 MHz
pclk_i	1	Input	Clock di l'interfaccia APB
prst_n_i	1	Input	Segnale di reset low-attivu sincronizatu cù pclk_i
paddr_i	16	Input	indirizzu APB
pwrite_i	1	Input	Segnale di scrittura APB
psel_i	1	Input	Segnale di selezzione APB
pena_i	1	Input	Segnale di attivazione APB
pwdata_i	32	Input	APB scrive dati
prdata_o	32	Output	Dati di lettura APB
pready_o	1	Output	APB lettura di dati prontu signale
int_o	1	Output	Segnale di interruzzione à u CPU
vsync_o	1	Output	VSYNC per u flussu video di output Hè sincronu cù vclk_i.
hsync_o	1	Output	HSYNC per u flussu di video di output Hè sincronu cù vclk_i.
pixel_val_o	1/2/4	Output	Indica a validazione di pixel in u portu pixel_data_o, sincronia cù vclk_i

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Parametri DisplayPort Rx è signali di l'interfaccia

………..cuntinuà  Descrizzione di direzzione di larghezza di l'interfaccia
pixel_data_o	48/96/192	Output	Dati di pixel di flussu di video in output, puderia esse 1, 2 o 4 pixel paralleli. hè sincronu cù vclk_i. Per 4 pixel paralleli, • bit[191:144] per 1st pixel • bit[143:96] per 2nd pixel • bit[95:48] per 3rd pixel • bit[47:0] per 4th pixel Ogni pixel usa 48 bits, per RGB, bit [47:32] hè R, bit [31:16] hè G, bit [15:0] hè B. Ogni cumpunente di culore usa i bits BPC più bassi. Per esample, RGB cù 24 bit per pixel, bit[7:0] hè B, bit[23:16] hè G, bit[39:32] hè R, tutti l'altri bit sò riservati.
hpd_o	1	Output	Segnale di output HPD
aux_tx_en_o	1	Output	Segnale di attivazione di dati AUX Tx
aux_tx_io_o	1	Output	Dati AUX Tx
aux_rx_io_i	1	Input	Dati AUX Rx
dp_lane_k_i	Numero di corsi * 4	Input	Indicazione K di dati di corsi d'ingressu DisplayPort Hè sincronu cù dpclk_i. • Bit[15:12] per Lane0 • Bit[11:8] per Lane1 • Bit[7:4] per Lane2 • Bit[3:0] per Lane3
dp_lane_data_i	Numaru di corsie * 32	Input	Dati di corsi di input DisplayPort Hè sincronu cù dpclk_i. • Bit[127:96] per Lane0 • Bit[95:64] per Lane1 • Bit[63:32] per Lane2 • Bit[31:0] per Lane3
mvid_val_o	1	Output	Indica se mvid_o è nvid_o sò dispunibili, hè sincronu cù dpclk_i.
mvid_o	24	Output	Mvid Hè sincronu cù dpclk_i.
nvid_o	24	Output	Nvid Hè sincronu cù dpclk_i.
	xcvr_rx_ready_i Numero di corsi	Input	Transceiver signali pronti
pcs_err_i	Numero di corsi	Input	Segnali d'errore di decodificatore Core Pcs
pcs_rstn_o	1	Output	Reset decoder Core Pcs
lane0_rxclk_i	1	Input	Lane0 clock da Transceiver
lane1_rxclk_i	1	Input	Lane1 clock da Transceiver
lane2_rxclk_i	1	Input	Lane2 clock da Transceiver
lane3_rxclk_i	1	Input	Lane3 clock da Transceiver

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Diagrammi di u tempu

4. Diagrammi di u tempu (Fate una quistione)

Comu mostra in a figura, hsync_o hè affirmatu per parechji ciculi prima di ogni linea. Se ci sò n linee in un quadru video, ci sò n hsync_o affirmate. Prima di a prima linea è a prima affirmata hsync_o, vsync_o hè affirmata per parechji cicli. A pusizione è a larghezza di VSYNC è HSYNC sò cunfigurati da u software.

Figura 4-1. Diagramma di timing per u segnale di l'interfaccia di u flussu di video in output

Configurazione IP DisplayPort Rx

5. Configurazione IP DisplayPort Rx (Fate una quistione)

Questa sezione descrive i vari parametri di cunfigurazione IP DisplayPort Rx.

5.1 HPD (Fate una quistione)

Quandu u dispositivu di sink DisplayPort hè prontu è cunnessu à u dispositivu sorgente DisplayPort, u software di l'applicazione DisplayPort deve affirmà u signale HPD à 1 scrivendu 0x01 in u registru 0x0140. U software di l'applicazione di lavamanu DisplayPort deve monitorizà u statutu di u dispositivu di lavabo. Se u dispositivu sink hà bisognu di un dispositivu fonte per leghje i registri DPCD, u software di u sink device deve mandà una interruzzione HPD scrivendu 0x01 in u registru 0x0144, dopu scrive 0x00 in 0x0144.

5.2 Riceve a transazzione di richiesta AUX (Fate una quistione)

Quandu u DisplayPort Rx IP hà ricevutu una transazzione AUX Request è l'interruzzione hè attivata, u software deve riceve l'interruzzione di l'avvenimentu NewAuxReply. U software deve eseguisce i seguenti passi per leghje a transazzione AUX Request ricevuta da u DisplayPort IP:

1. Leghjite u registru 0x012C per sapè a durata (RequestBytesNum) di a transazzione AUX ricevuta.

2. Leghjite u registru 0x0124 RequestBytesNum volte per ottene tutti i bytes di a transazzione AUX ricevuta.

3. AUX Request transazzione COMM [3: 0] hè u primu bit di byte di lettura [7: 4].

4. L'indirizzu DPCD hè ((FirstByte[3:0]<<16) | (SecondByte[7:0]<<8) | (ThirdByte[7:0])).

5. U campu AUX Request Length hè FourthByte [7: 0].

6. Per DPCD scrittura Request transazzione, tutti i bytes dopu à u campu di lunghezza sò scriviri dati. 5.3 Trasmette a transazzione di risposta AUX (Fate una quistione)

Dopu avè ricivutu una transazzione AUX Request, u software deve cunfigurà u DisplayPort Rx IP per trasmette una transazzione AUX Reply u più prestu pussibule. U software hè rispunsevule per determinà tutti i bytes di transazzione di Rispondi, chì includenu u tipu di Risposta.

Per trasmette una Risposta AUX, u software deve eseguisce i seguenti passi:

1. Sè a transazzione AUX Reply cumpresi i dati di lettura DPCD, scrivite tutti i dati di lettura in u registru 0x010C byte per byte. Se ùn ci sò micca dati di lettura DPCD da trasmette, saltate stu passu.

2. Determina quanti bytes di lettura DPCD (AuxReadBytesNum). Se nessun byte di lettura DPCD, AuxReadBytesNum hè 0.

3. Determina u tipu di risposta AUX (ReplyComm).

4. Scrivite ((AuxReadBytesNum<<16) | ReplyComm) in u registru 0x0100.

5.4 Formazione DisplayPort Lanes (Fate una quistione)

À a prima furmazione stage, u dispusitivu surghjente DisplayPort trasmette TPS1 per fà u dispusitivu di lavamanu DisplayPort attaccatu pè ottene LANEx_CR_DONE.

À a seconda furmazione stage, u dispusitivu surghjente DisplayPort trasmette TPS2/TPS3/TPS4 pè ottene u dispusitivu di lavanda DisplayPort attaccatu pè ottene LANEx_EQ_DONE, LANEx_SYMBOL_LOCKED, è INTERLANE_ALIGN_DONE.

LANEx_CR_DONE indica chì u FPGA Transceiver CDR hè chjusu. LANEx_SYMBOL_LOCKED indica chì u decodificatore 8B10B decode 8B bytes currettamente.

Prima di a prucedura di furmazione, u software di l'applicazione DisplayPort deve lascià u dispusitivu fonte. L'IP DisplayPort Rx supporta TPS3 è TPS4.

Quandu u dispusitivu surghjente manda TPS3/TPS4 (u dispositivu fonte scrive DPCD_0x0102 per indicà a trasmissione TPS3/TPS4), u software deve eseguisce i seguenti passi per verificà se a furmazione hè fatta:

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Configurazione IP DisplayPort Rx

1. Scrivite u numeru di corsi abilitati in u registru 0x0000.

2. Scrivite 0x00 in u registru 0x0014 per disattivà u descrambler per TPS3. Scrivite 0x01 per attivà u descrambler per TPS4.

3. Aspittendu finu à chì u dispusitivu surghjente leghje DPCD_0x0202 è DPCD_0x0203 registri DPCD.

4. Leghjite u registru 0x0038 per sapè s'ellu i corsi IP DisplayPort Rx anu ricevutu TPS3. Pone LANEx_EQ_DONE à 1 quandu TPS3 hè ricevutu.

5. Leghjite u registru 0x0018 per sapè s'ellu tutti i corsi sò allinati. Pone INTERLANE _ALIGN_DONE à 1 se tutti i corsi sò allinati.

In a prucedura di furmazione, u software puderia avè bisognu di cunfigurà i paràmetri di Transceiver SI è a tarifa di a corsia di Transceiver.

5.5 Video Stream Receiver (Fate una quistione)

Dopu chì a furmazione hè finita, u DisplayPort Rx IP deve attivà u ricevitore di flussu video. Per attivà u ricevitore video, u software deve eseguisce a cunfigurazione seguente:

1. Scrivite 0x01 in u registru 0x0014 per attivà u descrambler.

2. Scrivite 0x01 in u registru 0x0010 per attivà u video stream receiver.

3. Leghjite MSA da u registru 0x0048 à registrà 0x006C finu à chì i valori MSA significativu sò truvati.

4. Scrivite FrameLinesNumber in u registru 0x00C0. Scrivite LinePixelsNumber in u registru 0x00D8. Per esample, se sapemu chì hè 1920 × 1080 flussu video da MSA, allora scrivite 1080 in u registru 0x00C0 è scrivite 1920 in u registru 0x00D8.

5. Leghjite u registru 0x01D4 per verificà se u quadru di flussu video ricuperatu hà aspittatu HWidth è VHeight previstu.

6. Leghjite u registru 0x01F0 per sguassà è scaccià u valore di lettura perchè stu registru registra u statutu da l'ultima lettura.

7. Aspittendu circa 1 seconde o parechji sicondi, Read register 0x01F0 novu. Verificate u bit [5] per verificà se u flussu video ricuperatu HWidth hè chjusu. 1 significa sbloccatu è 0 significa chjusu. Verificate u bit [21] per verificà se u flussu di video VHeight hè chjusu. 1 significa sbloccatu è 0 significa chjusu.

5.6 Registru Definizione (Fate una quistione)

A tabella seguente mostra i registri interni definiti in DisplayPort Tx IP.

Table 5-1. Registri IP DisplayPort Rx

Bits di indirizzu		Nome		Type Default	Descrizzione
0x0000	[2:0]	Enabled_Lanes_Number	RW	0x4	I corsi attivati ​​sò 4 corsi, 2 corsi, o 1 corsia
0x0004	[2:0]	Out_Parallel_Pixel_Number	RW	0x4	U numeru di pixel paralleli à l'interfaccia di output di flussu video
0x0010	[0]	Video_Stream_Enable	RW	0x0	Abilita u ricevitore di flussu video
0x0014	[0]	Descramble_Enable	RW	0x0	Abilita u descrambler
0x0018	[0]	InterLane_Alignment_Status RO		0x0	Indica se i corsi sò allinati
0x001C	[1]	Alignment_Error	RC	0x0	Indica s'ellu ci hè un errore in a prucedura di allineamentu
	[0]	New_alignment	RC	0x0	Indica s'ellu ci era un novu avvenimentu di allinamentu. Quandu i corsi ùn sò micca allinati, un novu allinamentu hè previstu. Quandu i corsi sò allinati è ci era un novu allinamentu, significa chì i corsi sò fora di l'allineamentu è allinati di novu.
0x0038		[14:12] Lane3_RX_TPS_Mode	RO	0x0	Lane3 hà ricevutu u modu TPSx. 2 significa TPS2, 3 significa TPS3, è 4 significa TPS4.

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Configurazione IP DisplayPort Rx

………..cuntinuà  Indirizzu Bits Nome Tipu Default Description
	[10:8]	Lane2_RX_TPS_Mode	RO	0x0	Lane2 hà ricevutu u modu TPSx
	[6:4]	Lane1_RX_TPS_Mode	RO	0x0	Lane1 hà ricevutu u modu TPSx
	[2:0]	Lane0_RX_TPS_Mode	RO	0x0	Lane0 hà ricevutu u modu TPSx
0x0044	[7:0]	Rx_VBID	RO	0x00	Ricevutu VBID
0x0048	[15:0]	MSA_Htotale	RO	0x0	Ricevutu MSA_HTotal
0x004C	[15:0]	MSA_VTotal	RO	0x0	Ricevutu MSA_VTotal
0x0050	[15:0]	MSA_HStart	RO	0x0	Ricevutu MSA_HStart
0x0054	[15:0]	MSA_VStart	RO	0x0	Ricevutu MSA_VStart
0x0058	[15]	MSA_VSync_Polarity	RO	0x0	Ricevutu MSA_VSYNC_Polarity
	[14:0]	MSA_VSync_Width	RO	0x0	Ricevutu MSA_VSYC_Width
0x005C	[15]	MSA_HSync_Polarity	RO	0x0	Ricevutu MSA_HSYNC_Polarity
	[14:0]	MSA_HSync_Width	RO	0x0	Ricevutu MSA_HSYNC_Width
0x0060	[15:0]	MSA_HWidth	RO	0x0	Ricevutu MSA_HWidth
0x0064	[15:0]	MSA_VHeight	RO	0x0	Ricevutu MSA_VHeight
0x0068	[7:0]	MSA_MISC0	RO	0x0	Ricevutu MSA_MISC0
0x006C	[7:0]	MSA_MISC1	RO	0x0	Ricevutu MSA_MISC1
0x00C0	[15:0]	Video_Frame_Line_Number	RW	0x438	U numeru di linii in un quadru video ricevutu
0x00C4	[15:0]	Video_VSYNC_Larghezza	RW	0x0004	Definisce a larghezza di VSYNC di u video di output in cicli vclk_i
0x00C8	[15:0]	Video_HSYNC_Larghezza	RW	0x0004	Definisce a larghezza HSYNC di u video di output in cicli vclk_i
0x00CC	[15:0]	VSYNC_À_HSYNC_Larghezza	RW	0x0008	Definisce a distanza trà VSYNC è HSYNC in cicli vclk_i
0x00D0	[15:0]	HSYNC_To_Pixel_Width	RW	0x0008	Definisce a distanza trà HSYNC è pixel di prima linea in cicli
0x00D8	[15:0]	Video_line_pixels	RW	0x0780	U numaru di pixel in una linea video ricevuta
0x0100		[23:16] AUX_Tx_Data_Byte_Num	RW	0x00	U numeru di byte di dati di lettura DPCD in a Risposta AUX
	[3:0]	AUX_Tx_Command	RW	0x0	U Comm [3: 0] in AUX Risposta (Tipu di Risposta)
0x010C	[7:0]	AUX_Tx_Writing_Data	RW	0x00	Scrivite tutti i byte di dati di lettura DPCD per a Risposta AUX
0x011C	[15:0]	Tx_AUX_Reply_Num	RC	0x0	U numeru di transazzioni AUX Reply da trasmette
0x0120	[15:0]	Rx_AUX_Request_Num	RC	0x0	U numeru di transazzioni AUX Request da riceve
0x0124	[7:0]	AUX_Rx_Read_Data	RO	0x00	Leghjite tutti i byte di a transazzione AUX Request ricevuta
0x012C	[7:0]	AUX_Rx_Request_Length	RO	0x00	U numeru di bytes in a transazzione AUX Request ricevuta
0x0140	[0]	HPD_Status	RW	0x0	Definite u valore di output HPD
0x0144	[0]	Mandate_HPD_IRQ	RW	0x0	Scrivite à 1 per mandà una interruzzione HPD
0x0148	[19:0]	HPD_IRQ_Larghezza	RW		0x249F0 Definisce l'ampiezza di l'impulsu di bassa attivazione HPD IRQ in cicli aux_clk_i
0x0180	[0]	IntMask_Total_Interrupt	RW	0x1	Interrupt Mask: interruzzione tutale
0x0184	[1]	IntMask_NewAuxRequest	RW	0x1	Interrupt Mask: Ricevutu una nova Richiesta AUX
	[0]	IntMask_TxAuxDone	RW	0x1	Maschera di interruzzione: Trasmettite a risposta AUX fatta
Saulės sistemos kardaninis velenas	[15]	Int_TotalInt	RC	0x0	Interruzzione : interruzzione tutale
	[1]	Int_NewAuxRequest	RC	0x0	Interrupt: Ricevutu una nova Richiesta AUX
	[0]	Int_TxAuxDone	RC	0x0	Interruzzione: Trasmissione AUX Risposta fatta
0x01D4		[31:16] Video_Output_LineNum	RO	0x0	U numeru di linii in un quadru di video output
	[15:0]	Video_Output_PixelNum	RO	0x0	U numaru di pixel in una linea di video output
0x01F0	[21]	Video_LineNum_Unlock	RC	0x0	1 significa chì u numeru di linee di frame video di output ùn hè micca chjusu
	[5]	Video_PixelNum_Unlock	RC	0x0	1 significa chì u numeru di pixel di u video di output ùn hè micca chjusu

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Configurazione IP DisplayPort Rx

5.7 Cunfigurazione di u Driver (Fate una quistione)

Pudete truvà u driver files in i seguenti

caminu: ..\ \component\Microchip\SolutionCore\dp_receiver\ \Driver.

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banc d'essai

6. banc d'essai (Fate una quistione)

Testbench hè furnitu per verificà a funziunalità di u DisplayPort Rx IP. DisplayPort Tx IP hè utilizatu per verificà a funziunalità DisplayPort Rx IP.

6.1 Righe di simulazione (Fate una quistione)

Per simulà u core cù u testbench, fate i seguenti passi:

1. In u Catalogu Libero SoC (View > Windows > Catalogu), espansione Soluzioni-Video , drag-and-drop the DisplayPort Rx, è dopu cliccate OK. Vede a figura seguente.

Figura 6-1. Display Controller in Libero SoC Catalog

2. SmartDesign hè custituitu di interconnessioni DisplayPort Tx è DisplayPort Rx. Per generà u SmartDesign per a simulazione IP DisplayPort Rx, cliccate Prughjettu Liberu > Eseguite script. Navigate à u script ..\ \component\Microchip\SolutionCore\dp_receiver\ \scripts\Dp_Rx_SD.tcl, è dopu cliccate Corri .

Figura 6-2. Eseguite Script per DisplayPort Rx IP

U SmartDesign appare. Vede a figura seguente.

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banc d'essai

Figura 6-3. Schema di SmartDesign

3. Nantu à u Files tab, cliccate simulazione > Importà Files. Figura 6-4. Importà Files

dp_receiver_C0

prdata_o_0[31:0] pready_o_0

4. Importà u tc_rx_videostream.txt, tc_rx_tps.txt, tc_rx_hpd.txt, tc_rx_aux_request.txt, è tc_rx_aux_reply.txt file da u

a strada seguita: ..\ \component\Microchip\SolutionCore\dp_receiver\ \ Stimulu.

5. À impurtà un differente file, cercate u cartulare chì cuntene i necessarii file, è cliccate Apertu. L'impurtatu file hè listatu sottu simulazione, vede a figura seguente.

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banc d'essai

Figura 6-5. Impurtatu Files Lista in u cartulare di simulazione

6. Nantu à u Gerarchia di stimulu tab, cliccate displayport_rx_tb (displayport_rx_tb. v). Punta à Simulazione di Pre-Synth Design, è dopu cliccate Apertura interattiva

Figura 6-6. Testbench di simulazione

ModelSim si apre cù u testbench file cum'è mostra in a figura seguente.

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banc d'essai

Figura 6-7. Forma d'onda DisplayPort Rx ModelSim

Impurtante: Se a simulazione hè interrotta per via di u limitu di runtime specificatu in u DO file, aduprà u corre - tutti cumanda per compie a simulazione.

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Storia di rivisione

7. Storia di rivisione (Fate una quistione)

A storia di rivisione descrive i cambiamenti chì sò stati implementati in u documentu. I cambiamenti sò listati per rivisione, cuminciendu cù a publicazione più attuale.

Table 7-1. Storia di rivisione

Revisione	Data	Descrizzione
A	06/2023	Liberazione iniziale di u documentu.

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Supportu Microchip FPGA 

U gruppu di prudutti Microchip FPGA sustene i so prudutti cù diversi servizii di supportu, cumpresu u serviziu di u cliente, u centru di supportu tecnicu di u cliente, un websitu, è uffizii di vendita in u mondu. I clienti sò suggeriti à visità e risorse in linea di Microchip prima di cuntattà l'assistenza postu chì hè assai prubabile chì e so dumande sò digià rispostu.

Cuntattate u Centru di Assistenza Tecnica attraversu u websitu à www.microchip.com/support. Mencione u numeru di parte di u dispositivu FPGA, selezziunate a categuria di casu adatta è carica u disignu files mentre crea un casu di supportu tecnicu.

Cuntattate u Serviziu Clienti per un supportu di produttu micca tecnicu, cum'è u prezzu di u produttu, l'aghjurnamenti di u produttu, l'infurmazioni di l'aghjurnamentu, u statu di l'ordine è l'autorizazione.

• Da l'America di u Nordu, chjamate 800.262.1060

• Da u restu di u mondu, chjamate 650.318.4460

• Fax, da ogni locu in u mondu, 650.318.8044

Infurmazioni Microchip 

U Microchip Websitu

Microchip furnisce supportu in linea via u nostru websitu à www.microchip.com/. Questu website hè usatu per fà files è l'infurmazioni facilmente dispunibili à i clienti. Alcune di u cuntenutu dispunibule include:

• Supportu di u produttu – Schede tecniche e errate, note d’applicazione e sampi prugrammi, risorse di cuncepimentu, guide d'utilizatori è documenti di supportu hardware, l'ultime versioni di u software è u software archiviatu

• Assistenza tecnica generale - Domande frequenti (FAQ), richieste di supportu tecnicu, gruppi di discussione in linea, lista di membri di u prugramma di partenarii di design Microchip

• Affari di Microchip - Selettore di prudutti è guide d'ordine, ultimi comunicati di stampa Microchip, lista di seminarii è avvenimenti, liste di uffizii di vendita di Microchip, distributori è rapprisentanti di fabbrica

Serviziu di Notificazione di Cambiamentu di Produttu

U serviziu di notificazione di cambiamentu di produttu di Microchip aiuta à mantene i clienti attuali nantu à i prudutti Microchip. L'abbonati riceveranu una notificazione per e-mail ogni volta chì ci sò cambiamenti, aghjurnamenti, rivisioni o errata in relazione à una famiglia di prudutti specifica o strumentu di sviluppu d'interessu.

Per registrà, andate à www.microchip.com/pcn è seguitate l'istruzzioni di registrazione. Assistenza Clienti

L'utilizatori di i prudutti Microchip ponu riceve assistenza attraversu parechji canali: • Distributore o Rappresentante

• Uffiziu di Vendita Locale

• Ingegnere di soluzioni integrate (ESE)

• Support Tecnicu

I clienti anu da cuntattà u so distributore, rappresentante o ESE per supportu. L'uffizii di vendita lucali sò ancu dispunibili per aiutà i clienti. Una lista di l'uffizii di vendita è i lochi hè inclusa in stu documentu.

U supportu tecnicu hè dispunibule attraversu u websitu à: www.microchip.com/support Funzione di prutezzione di codice di i dispositi Microchip

Nota i seguenti dettagli di a funzione di prutezzione di codice nantu à i prudutti Microchip:

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• I prudutti Microchip scontranu i specificazioni cuntenuti in u so particulare Microchip Data Sheet.

• Microchip crede chì a so famiglia di prudutti hè sicura quandu s'utilice in u modu previstu, in e specificazioni operative, è in cundizioni normali.

• Microchip valori è aggressivu prutege i so diritti di pruprietà intellettuale. I tentativi di violazione di e funzioni di prutezzione di u codice di u produttu Microchip sò strettamente pruibiti è ponu violà a Digital Millennium Copyright Act.

• Nè Microchip nè un altru fabricatore di semiconductor pò guarantisci a sicurità di u so codice. A prutezzione di u codice ùn significa micca chì guarantimu chì u pruduttu hè "unbreakable". A prutezzione di u codice hè in constante evoluzione. Microchip hè impegnatu à migliurà continuamente e funzioni di prutezzione di codice di i nostri prudutti.

Avvisu Legale

Questa publicazione è l'infurmazioni quì ponu esse aduprate solu cù i prudutti Microchip, cumpresu per cuncepisce, pruvà è integrà i prudutti Microchip cù a vostra applicazione. L'usu di sta infurmazione in ogni altra manera viola questi termini. L'infurmazioni riguardanti l'applicazioni di u dispositivu sò furnite solu per a vostra comodità è ponu esse rimpiazzate da l'aghjurnamenti. Hè a vostra rispunsabilità per assicurà chì a vostra applicazione risponde à e vostre specificazioni. Cuntattate u vostru uffiziu di vendita Microchip locale per supportu supplementu o, uttene supportu supplementu à www.microchip.com/en-us/support/design-help/client-support-services.

QUESTA INFORMAZIONE hè furnita da u microchip "AS IS". MICROCHIP NON FACCIA RIPRESENTAZIONI O GARANTIE DI ALCUNA TIPI, SIA ESPRESSA O IMPLICITA, SCRITTA O ORALE, STATUTARIA O ALTRE, RELATIVA A L'INFORMAZIONI INCLUSI, MA NON LIMITATE A ALCUNA GARANZIA IMPLICITA DI NON VIOLAZIONE, POSSIBILITÀ E PARTECIPABILITÀ PER A COMMERCIALE, A PUBLICIDAD, A PUBLICIDAD. GARANTIE RELATATI À A SO CONDIZIONE, QUALITÀ, O PRESTAZIONI.

IN NESSUN CASU MICROCHIP SERA RESPONSABILE PER QUALSIASI PERDITA INDIRETTA, SPECIALE, PUNITIVE, INCIDENTALE, O CONSEGUENTE, DANNI, COSTO, O SPESE DI QUALUNQUE TIPI RELATATI À L'INFORMAZIONI O U U U U U SO, IN QUANTO CAUSATE, ANCHE QUANTO ESE ADVERTIMENTO. PUSSIBILITÀ OR I DANNI SONT PREVISIBILI. À LA MESSA ALTERNATA PERMISSATA DA LEGGE, A RESPONSABILITÀ TOTALE DI MICROCHIP PER TUTTE LE RECLAMAZIONI IN QUALSIA MANIERA RELATATA À L'INFORMAZIONI O U U SO USU NON SUPERARÀ L'IMPORTU DI TARIFFE, SE CUALQUIE, CHE AVRAI PAGATA DIRETTAMENTE À MICROCHIP PER L'INFORMAZIONI.

L'usu di i dispositi Microchip in l'applicazioni di supportu di vita è / o di sicurezza hè interamente à u risicu di u cumpratore, è u cumpratore accetta di difende, indemnizà è mantene innocu Microchip da qualsiasi danni, rivendicazioni, vestiti, o spese risultanti da tali usu. Nisuna licenza hè trasmessa, implicitamente o altrimenti, sottu à alcunu diritti di pruprietà intellettuale di Microchip, salvu s'ellu ùn hè micca dichjaratu altrimenti.

Marchi

U nome è u logu Microchip, u logu Microchip, Adaptec, AVR, logo AVR, AVR Freaks, BesTime, BitCloud, CryptoMemory, CryptoRF, dsPIC, flexPWR, HELDO, IGLOO, JukeBlox, KeeLoq, Kleer, LANCheck, LinkMD, maXStyluuchs, MediaLB, megaAVR, Microsemi, Microsemi logo, MOST, MOST logo, MPLAB, OptoLyzer, PIC, picoPower, PICSTART, PIC32 logo, PolarFire, Prochip Designer, QTouch, SAM-BA, SenGenuity, SpyNIC, SST, SST Logo, SuperFlash, Symmetricom , SyncServer, Tachyon, TimeSource, tinyAVR, UNI/O, Vectron è XMEGA sò marchi registrati di Microchip Technology Incorporated in i Stati Uniti è in altri paesi.

AgileSwitch, APT, ClockWorks, The Embedded Control Solutions Company, EtherSynch, Flashtec, Hyper Speed ​​Control, HyperLight Load, Libero, motorBench, mTouch, Powermite 3, Precision Edge, ProASIC, ProASIC Plus, ProASIC Plus logo, Quiet- Wire, SmartFusion, SyncWorld, Temux, TimeCesium, TimeHub, TimePictra, TimeProvider, TrueTime è ZL sò marchi registrati di Microchip Technology Incorporated in i Stati Uniti.

Suppressione di chjave adiacente, AKS, Analog-for-the-Digital Age, Any Capacitor, AnyIn, AnyOut, Augmented Switching, BlueSky, BodyCom, Clockstudio, CodeGuard, CryptoAuthentication, CryptoAutomotive, CryptoCompanion, CryptoController, dsPICDEM, dsPICDEM, Dynamic.

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Corrispondenza media, DAM, ECAN, Espresso T1S, EtherGREEN, GridTime, IdealBridge, Programmazione Seriale In-Circuit, ICSP, INICnet, Parallelazione Intelligente, IntelliMOS, Connettività Inter-Chip, JitterBlocker, Knob-on-Display, KoD, maxCrypto, maxView, memBrain, Mindi, MiWi, MPASM, MPF, MPLAB Certified logo, MPLIB, MPLINK, MultiTRAK, NetDetach, Omniscient Code Generation, PICDEM, PICDEM.net, PICkit, PICtail, PowerSmart, PureSilicon, QMatrix, REAL ICE, Ripple Blocker, , RTG4, SAM ICE, Serial Quad I/O, simpleMAP, SimpliPHY, SmartBuffer, SmartHLS, SMART-IS, storClad, SQI, SuperSwitcher, SuperSwitcher II, Switchtec, SynchroPHY, Total Endurance, Trusted Time, TSHARC, USBCheck, VariSense, VectorBlox , VeriPHY, ViewSpan, WiperLock, XpressConnect è ZENA sò marchi di Microchip Technology Incorporated in i Stati Uniti è in altri paesi.

SQTP hè una marca di serviziu di Microchip Technology Incorporated in i Stati Uniti

U logu Adaptec, Frequency on Demand, Silicon Storage Technology è Symmcom sò marchi registrati di Microchip Technology Inc. in altri paesi.

GestIC hè una marca registrata di Microchip Technology Germany II GmbH & Co. KG, una filiale di Microchip Technology Inc., in altri paesi.

Tutti l'altri marchi citati quì sò pruprietà di e so cumpagnie rispettive. © 2023, Microchip Technology Incorporated è e so filiali. Tutti i diritti riservati. ISBN : 978-1-6683-2664-0

Sistema di Gestione di Qualità

Per infurmazione nantu à i Sistemi di Gestione di Qualità di Microchip, visitate www.microchip.com/quality.

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Vendite è serviziu in u mondu sanu

AMERICA ASIA / ASIA PACIFIC / EUROPA PACIFIC

Uffiziu Corporate

2355 West Chandler Blvd. Chandler, AZ 85224-6199 Tel: 480-792-7200

Fax: 480-792-7277

Assistenza tecnica:

www.microchip.com/support

Web Indirizzu: www.microchip.com

Atlanta

Duluth, GA

Tel: 678-957-9614

Fax: 678-957-1455

Austin, TX

Tel: 512-257-3370

Boston

Westborough, MA

Tel: 774-760-0087

Fax: 774-760-0088

Chicago

Itasca, IL

Tel: 630-285-0071

Fax: 630-285-0075

Dallas

Addison, TX

Tel: 972-818-7423

Fax: 972-818-2924

Detroit

Novi, MI

Tel: 248-848-4000

Houston, TX

Tel: 281-894-5983

Indianapolis

Noblesville, IN

Tel: 317-773-8323

Fax: 317-773-5453

Tel: 317-536-2380

Los Angeles

Mission Viejo, CA

Tel: 949-462-9523

Fax: 949-462-9608

Tel: 951-273-7800

Raleigh, NC

Tel: 919-844-7510

New York, NY

Tel: 631-435-6000

San Jose, CA

Tel: 408-735-9110

Tel: 408-436-4270

Canada - Toronto

Tel: 905-695-1980

Fax: 905-695-2078

Australia - Sydney Tel: 61-2-9868-6733 Cina - Pechino

Tel: 86-10-8569-7000 Cina - Chengdu

Tel: 86-28-8665-5511 Cina - Chongqing Tel: 86-23-8980-9588 Cina - Dongguan Tel: 86-769-8702-9880 Cina - Guangzhou Tel: 86-20-8755-8029 Cina - Hangzhou Tel: 86-571-8792-8115 Cina - Hong Kong SAR Tel: 852-2943-5100 Cina - Nanjing

Tel: 86-25-8473-2460 Cina - Qingdao

Tel: 86-532-8502-7355 Cina - Shanghai

Tel: 86-21-3326-8000 Cina - Shenyang Tel: 86-24-2334-2829 Cina - Shenzhen Tel: 86-755-8864-2200 Cina - Suzhou

Tel: 86-186-6233-1526 Cina - Wuhan

Tel: 86-27-5980-5300 Cina - Xian

Tel: 86-29-8833-7252 Cina - Xiamen

Tel: 86-592-2388138 Cina - Zhuhai

Tel: 86-756-3210040

India - Bangalore

Tel: 91-80-3090-4444

India - New Delhi

Tel: 91-11-4160-8631

India - Pune

Tel: 91-20-4121-0141

Giappone - Osaka

Tel: 81-6-6152-7160

Giappone - Tokyo

Tel: 81-3-6880- 3770

Corea - Daegu

Tel: 82-53-744-4301

Corea - Seoul

Tel: 82-2-554-7200

Malasia - Kuala Lumpur

Tel: 60-3-7651-7906

Malasia - Penang

Tel: 60-4-227-8870

Filippine - Manila

Tel: 63-2-634-9065

Singapore

Tel: 65-6334-8870

Taiwan - Hsin Chu

Tel: 886-3-577-8366

Taiwan - Kaohsiung

Tel: 886-7-213-7830

Taiwan - Taipei

Tel: 886-2-2508-8600

Tailanda - Bangkok

Tel: 66-2-694-1351

Vietnam - Ho Chi Minh

Tel: 84-28-5448-2100

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Austria - Wels

Tel: 43-7242-2244-39

Fax: 43-7242-2244-393

Danimarca - Copenhague

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Finlandia - Espoo

Tel: 358-9-4520-820

Francia - Parigi

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Fax: 33-1-69-30-90-79

Germania - Garching

Tel: 49-8931-9700

Germania - Haan

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Germania - Heilbronn

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Germania - Karlsruhe

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Germania - Rosenheim

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Israele - Ra'anana

Tel: 972-9-744-7705

Italia - Milan

Tel: 39-0331-742611

Fax: 39-0331-466781

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Tel: 31-416-690399

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Norvegia - Trondheim

Tel: 47-72884388

Pulonia - Varsavia

Tel: 48-22-3325737

Romania - Bucarest

Tel: 40-21-407-87-50

Spagna - Madrid

Tel: 34-91-708-08-90

Fax: 34-91-708-08-91

Svezia - Gothenberg

Tel: 46-31-704-60-40

Svezia - Stoccolma

Tel: 46-8-5090-4654

UK - Wokingham

Tel: 44-118-921-5800

Fax: 44-118-921-5820

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Documenti / Risorse

MICROCHIP IP RX DisplayPort Tx Sources [pdfGuida di l'utente IP RX DisplayPort Tx Sources, DisplayPort Tx Sources, Tx Sources, Sources

Referenze

• Manuale d'usu