ATMEL ATtiny11 Microcontrôleur 8 bits avec Flash 1K Byte
Caractéristiques
- Utilise l'architecture AVR® RISC
- Architecture RISC 8 bits hautes performances et basse consommation
- 90 instructions puissantes - La plupart des exécutions de cycle d'horloge unique
- 32 x 8 registres de travail à usage général
- Débit jusqu'à 8 MIPS à 8 MHz
Programme non volatile et mémoire de données
- 1K octet de mémoire de programme Flash
- Programmable dans le système (ATtiny12)
- Endurance : 1,000 11 cycles d'écriture/effacement (ATtiny12/XNUMX)
- 64 octets de mémoire de données EEPROM programmable dans le système pour ATtiny12
- Endurance: 100,000 cycles d'écriture / d'effacement
- Verrou de programmation pour le programme Flash et la sécurité des données EEPROM
Caractéristiques périphériques
- Interruption et réveil sur changement de broche
- Un temporisateur/compteur 8 bits avec prédiviseur séparé
- Comparateur analogique sur puce
- Minuterie de chien de garde programmable avec oscillateur sur puce
Caractéristiques spéciales du microcontrôleur
- Modes de veille et de mise hors tension à faible consommation
- Sources d'interruption externes et internes
- Programmable dans le système via le port SPI (ATtiny12)
- Circuit de réinitialisation à la mise sous tension amélioré (ATtiny12)
- Oscillateur RC calibré interne (ATtiny12)
Spécification
- Technologie de processus CMOS basse consommation et haute vitesse
- Fonctionnement entièrement statique
Consommation électrique à 4 MHz, 3 V, 25 °C
- Actif: 2.2 mA
- Mode inactif: 0.5 mA
- Mode de mise hors tension: <1 A
Paquets
- PDIP et SOIC à 8 broches
Vol d'exploitationtages
- 1.8 – 5.5V pour ATtiny12V-1
- 2.7 – 5.5 V pour ATtiny11L-2 et ATtiny12L-4
- 4.0 – 5.5V pour ATtiny11-6 et ATtiny12-8
Niveaux de vitesse
- 0 – 1.2 MHz (ATtiny12V-1)
- 0 à 2 MHz (ATtiny11L-2)
- 0 à 4 MHz (ATtiny12L-4)
- 0 à 6 MHz (ATtiny11-6)
- 0 à 8 MHz (ATtiny12-8)
Configuration des broches
Surview
L'ATtiny11/12 est un microcontrôleur CMOS 8 bits basse consommation basé sur l'architecture AVR RISC. En exécutant des instructions puissantes en un seul cycle d'horloge, l'ATtiny11/12 atteint des débits proches de 1 MIPS par MHz, permettant au concepteur du système d'optimiser la consommation d'énergie par rapport à la vitesse de traitement. Le noyau AVR combine un jeu d'instructions riche avec 32 registres de travail à usage général. Tous les 32 registres sont directement connectés à l'unité arithmétique et logique (ALU), permettant d'accéder à deux registres indépendants en une seule instruction exécutée en un cycle d'horloge. L'architecture résultante est plus efficace en matière de code tout en atteignant des débits jusqu'à dix fois plus rapides que les microcontrôleurs CISC conventionnels.
Tableau 1. Description des pièces
| Appareil | Éclair | Mémoire EEPROM | Registre | Voltaget gamme | Fréquence |
| ATtiny11L | 1K | – | 32 | 2.7 – 5.5 V | 0-2 MHz |
| ATtiny11 | 1K | – | 32 | 4.0 – 5.5 V | 0-6 MHz |
| ATtiny12V | 1K | 64 B | 32 | 1.8 – 5.5 V | 0-1.2 MHz |
| ATtiny12L | 1K | 64 B | 32 | 2.7 – 5.5 V | 0-4 MHz |
| ATtiny12 | 1K | 64 B | 32 | 4.0 – 5.5 V | 0-8 MHz |
L'ATtiny11/12 AVR est pris en charge avec une suite complète d'outils de développement de programmes et de systèmes, notamment : des assembleurs de macros, des débogueurs/simulateurs de programmes, des émulateurs en circuit,
et trousses d'évaluation.
Schéma fonctionnel ATtiny11
Voir Figure 1 à la page 3. L'ATtiny11 offre les fonctionnalités suivantes : 1 32 octets de mémoire Flash, jusqu'à cinq lignes d'E/S à usage général, une ligne d'entrée, 8 registres de travail à usage général, un temporisateur/compteur 11 bits, un et des interruptions externes, une minuterie de surveillance programmable avec oscillateur interne et deux modes d'économie d'énergie sélectionnables par logiciel. Le mode inactif arrête le processeur tout en permettant au temporisateur/compteurs et au système d'interruption de continuer à fonctionner. Le mode de mise hors tension enregistre le contenu du registre mais gèle l'oscillateur, désactivant toutes les autres fonctions de la puce jusqu'à la prochaine interruption ou réinitialisation matérielle. Les fonctions de réveil ou d'interruption lors du changement de broche permettent à l'ATtiny8 d'être très réactif aux événements externes, tout en présentant la consommation d'énergie la plus faible en mode de mise hors tension. L'appareil est fabriqué à l'aide de la technologie de mémoire non volatile haute densité d'Atmel. En combinant un processeur RISC 11 bits avec Flash sur une puce monolithique, l'Atmel ATtinyXNUMX est un microcontrôleur puissant qui fournit une solution hautement flexible et économique à de nombreuses applications de contrôle embarquées.
Figure 1. Le schéma fonctionnel ATtiny11
Schéma fonctionnel ATtiny12
Figure 2 à la page 4. L'ATtiny12 offre les fonctionnalités suivantes : 1 K octets de mémoire Flash, 64 octets d'EEPROM, jusqu'à six lignes d'E/S à usage général, 32 registres de travail à usage général, un temporisateur/compteur 8 bits, une mémoire interne et interruptions externes, minuteur de surveillance programmable avec oscillateur interne et deux modes d'économie d'énergie sélectionnables par logiciel. Le mode inactif arrête le processeur tout en permettant au temporisateur/compteurs et au système d'interruption de continuer à fonctionner. Le mode de mise hors tension enregistre le contenu du registre mais gèle l'oscillateur, désactivant toutes les autres fonctions de la puce jusqu'à la prochaine interruption ou réinitialisation matérielle. Les fonctions de réveil ou d'interruption lors du changement de broche permettent à l'ATtiny12 d'être très réactif aux événements externes, tout en présentant la consommation d'énergie la plus faible en mode de mise hors tension. L'appareil est fabriqué à l'aide de la technologie de mémoire non volatile haute densité d'Atmel. En combinant un processeur RISC 8 bits avec Flash sur une puce monolithique, l'Atmel ATtiny12 est un microcontrôleur puissant qui fournit une solution hautement flexible et économique à de nombreuses applications de contrôle embarquées.
Figure 2. Le schéma fonctionnel ATtiny12
Description des broches
- Vol d'approvisionnementtage broche.
- Broche de terre.
Le port B est un port d'E/S 6 bits. PB4..0 sont des broches d'E/S qui peuvent fournir des pull-ups internes (sélectionnés pour chaque bit). Sur ATtiny11, PB5 est une entrée uniquement. Sur ATtiny12, PB5 est une entrée ou une sortie à drain ouvert. Les broches du port sont à trois états lorsqu'une condition de réinitialisation devient active, même si l'horloge ne fonctionne pas. L'utilisation des broches PB5..3 comme entrées ou broches d'E/S est limitée, en fonction des paramètres de réinitialisation et d'horloge, comme indiqué ci-dessous.
Tableau 2. Fonctionnalité PB5..PB3 par rapport aux options de synchronisation de l'appareil
| Option de synchronisation de l'appareil | PB5 | PB4 | PB3 |
| Réinitialisation externe activée | Utilisé(1) | -(2) | – |
| Réinitialisation externe désactivée | Entrée(3)/E/S(4) | – | – |
| Cristal externe | – | Utilisé | Utilisé |
| Cristal basse fréquence externe | – | Utilisé | Utilisé |
| Résonateur Céramique Externe | – | Utilisé | Utilisé |
| Oscillateur RC externe | – | E/S(5) | Utilisé |
| Horloge externe | – | E/S | Utilisé |
| Oscillateur RC interne | – | E/S | E/S |
Remarques
- Utilisé » signifie que la broche est utilisée à des fins de réinitialisation ou d'horloge.
- signifie que la fonction de broche n'est pas affectée par l'option.
- L'entrée signifie que la broche est une broche d'entrée de port.
- Sur ATtiny11, PB5 est une entrée uniquement. Sur ATtiny12, PB5 est une entrée ou une sortie à drain ouvert.
- I/O signifie que la broche est une broche d'entrée/sortie de port.
XTAL1 Entrée de l'oscillateur inverseur amplificateur et entrée du circuit de fonctionnement de l'horloge interne.
XTAL2 Sortie de l'oscillateur inverseur amplifier.
RÉINITIALISER Entrée de réinitialisation. Une réinitialisation externe est générée par un niveau bas sur la broche RESET. Les impulsions de réinitialisation supérieures à 50 ns génèrent une réinitialisation, même si l'horloge ne fonctionne pas. Des impulsions plus courtes ne sont pas garanties pour générer une réinitialisation.
Résumé du registre ATtiny11
| Adresse | Nom | Morceau 7 | Morceau 6 | Morceau 5 | Morceau 4 | Morceau 3 | Morceau 2 | Morceau 1 | Morceau 0 | Page |
| 3F$ | SREG | I | T | H | S | V | N | Z | C | page 9 |
| 3 € | Réservé | |||||||||
| $ 3D | Réservé | |||||||||
| 3 $C | Réservé | |||||||||
| 3 milliards de dollars | GIMSK | – | INT0 | PCIE | – | – | – | – | – | page 33 |
| 3 A $ | GIFR | – | INTF0 | PCIF | – | – | – | – | – | page 34 |
| 39 XNUMX $ | TIMSK | – | – | – | – | – | – | TOIE0 | – | page 34 |
| 38 XNUMX $ | TIFR | – | – | – | – | – | – | TOV0 | – | page 35 |
| 37 XNUMX $ | Réservé | |||||||||
| 36 XNUMX $ | Réservé | |||||||||
| 35 XNUMX $ | MCUCR | – | – | SE | SM | – | – | ISC01 | ISC00 | page 32 |
| 34 XNUMX $ | MCUSR | – | – | – | – | – | – | EXTRF | PORF | page 28 |
| 33 XNUMX $ | TCCR0 | – | – | – | – | – | CS02 | CS01 | CS00 | page 41 |
| 32 XNUMX $ | TCNT0 | Minuterie/Compteur0 (8 bits) | page 41 | |||||||
| 31 XNUMX $ | Réservé | |||||||||
| 30 XNUMX $ | Réservé | |||||||||
| … | Réservé | |||||||||
| 22 XNUMX $ | Réservé | |||||||||
| 21 XNUMX $ | WDTCR | – | – | – | WDTOE | WDE | WDP2 | WDP1 | WDP0 | page 43 |
| 20 XNUMX $ | Réservé | |||||||||
| 1F$ | Réservé | |||||||||
| 1 € | Réservé | |||||||||
| $ 1D | Réservé | |||||||||
| 1 $C | Réservé | |||||||||
| 1 milliards de dollars | Réservé | |||||||||
| 1 A $ | Réservé | |||||||||
| 19 XNUMX $ | Réservé | |||||||||
| 18 XNUMX $ | PORTB | – | – | – | PORTB4 | PORTB3 | PORTB2 | PORTB1 | PORTB0 | page 37 |
| 17 XNUMX $ | DDRB | – | – | – | DDB4 | DDB3 | DDB2 | DDB1 | DDB0 | page 37 |
| 16 XNUMX $ | NIP | – | – | PINB5 | PINB4 | PINB3 | PINB2 | PINB1 | PINB0 | page 37 |
| 15 XNUMX $ | Réservé | |||||||||
| … | Réservé | |||||||||
| 0 A $ | Réservé | |||||||||
| 09 XNUMX $ | Réservé | |||||||||
| 08 XNUMX $ | ACSR | ACD | – | ACO | ACI | ACIE | – | ACIS1 | ACIS0 | page 45 |
| … | Réservé | |||||||||
| 00 XNUMX $ | Réservé | |||||||||
Remarques
- Pour la compatibilité avec les futurs périphériques, les bits réservés doivent être écrits à zéro en cas d'accès. Les adresses mémoire d'E / S réservées ne doivent jamais être écrites.
- Certains des drapeaux d'état sont effacés en leur écrivant un 00 logique. Notez que les instructions CBI et SBI fonctionneront sur tous les bits du registre d'E / S, réécrivant un un dans n'importe quel indicateur lu comme défini, effaçant ainsi l'indicateur. Les instructions CBI et SBI fonctionnent uniquement avec les registres $1 à $XNUMXF.
Résumé du registre ATtiny12
| Adresse | Nom | Morceau 7 | Morceau 6 | Morceau 5 | Morceau 4 | Morceau 3 | Morceau 2 | Morceau 1 | Morceau 0 | Page |
| 3F$ | SREG | I | T | H | S | V | N | Z | C | page 9 |
| 3 € | Réservé | |||||||||
| $ 3D | Réservé | |||||||||
| 3 $C | Réservé | |||||||||
| 3 milliards de dollars | GIMSK | – | INT0 | PCIE | – | – | – | – | – | page 33 |
| 3 A $ | GIFR | – | INTF0 | PCIF | – | – | – | – | – | page 34 |
| 39 XNUMX $ | TIMSK | – | – | – | – | – | – | TOIE0 | – | page 34 |
| 38 XNUMX $ | TIFR | – | – | – | – | – | – | TOV0 | – | page 35 |
| 37 XNUMX $ | Réservé | |||||||||
| 36 XNUMX $ | Réservé | |||||||||
| 35 XNUMX $ | MCUCR | – | POUD | SE | SM | – | – | ISC01 | ISC00 | page 32 |
| 34 XNUMX $ | MCUSR | – | – | – | – | WDRF | BORF | EXTRF | PORF | page 29 |
| 33 XNUMX $ | TCCR0 | – | – | – | – | – | CS02 | CS01 | CS00 | page 41 |
| 32 XNUMX $ | TCNT0 | Minuterie/Compteur0 (8 bits) | page 41 | |||||||
| 31 XNUMX $ | OSCAL | Registre d'étalonnage de l'oscillateur | page 12 | |||||||
| 30 XNUMX $ | Réservé | |||||||||
| … | Réservé | |||||||||
| 22 XNUMX $ | Réservé | |||||||||
| 21 XNUMX $ | WDTCR | – | – | – | WDTOE | WDE | WDP2 | WDP1 | WDP0 | page 43 |
| 20 XNUMX $ | Réservé | |||||||||
| 1F$ | Réservé | |||||||||
| 1 € | Écouter | – | – | Registre d'adresse EEPROM | page 18 | |||||
| $ 1D | EEDR | Registre de données EEPROM | page 18 | |||||||
| 1 $C | EECR | – | – | – | – | ÉTRANGE | EEMWE | EEWE | ERE | page 18 |
| 1 milliards de dollars | Réservé | |||||||||
| 1 A $ | Réservé | |||||||||
| 19 XNUMX $ | Réservé | |||||||||
| 18 XNUMX $ | PORTB | – | – | – | PORTB4 | PORTB3 | PORTB2 | PORTB1 | PORTB0 | page 37 |
| 17 XNUMX $ | DDRB | – | – | DDB5 | DDB4 | DDB3 | DDB2 | DDB1 | DDB0 | page 37 |
| 16 XNUMX $ | NIP | – | – | PINB5 | PINB4 | PINB3 | PINB2 | PINB1 | PINB0 | page 37 |
| 15 XNUMX $ | Réservé | |||||||||
| … | Réservé | |||||||||
| 0 A $ | Réservé | |||||||||
| 09 XNUMX $ | Réservé | |||||||||
| 08 XNUMX $ | ACSR | ACD | AINBG | ACO | ACI | ACIE | – | ACIS1 | ACIS0 | page 45 |
| … | Réservé | |||||||||
| 00 XNUMX $ | Réservé | |||||||||
Note
- Pour la compatibilité avec les futurs périphériques, les bits réservés doivent être écrits à zéro en cas d'accès. Les adresses mémoire d'E / S réservées ne doivent jamais être écrites.
- Certains des drapeaux d'état sont effacés en leur écrivant un 00 logique. Notez que les instructions CBI et SBI fonctionneront sur tous les bits du registre d'E / S, réécrivant un un dans n'importe quel indicateur lu comme défini, effaçant ainsi l'indicateur. Les instructions CBI et SBI fonctionnent uniquement avec les registres $1 à $XNUMXF.
Résumé du jeu d'instructions
| Mnémotechnique | Opérandes | Description | Opération | Drapeaux | #Horloges |
| INSTRUCTIONS ARITHMÉTIQUES ET LOGIQUES | |||||
| AJOUTER | Chemin, Arr. | Ajouter deux registres | Rd ¬ Rd + Ar | Z, C, N, V, H | 1 |
| ADC | Chemin, Arr. | Ajouter avec Carry deux registres | Rd ¬ Rd + Rr + C | Z, C, N, V, H | 1 |
| SOUS | Chemin, Arr. | Soustraire deux registres | Rd ¬ Rd – Arr | Z, C, N, V, H | 1 |
| SUBI | chemin, K | Soustraire la constante du registre | Rd ¬ Rd – K | Z, C, N, V, H | 1 |
| SBC | Chemin, Arr. | Soustraire avec transporter deux registres | Rd ¬ Rd – Rr – C | Z, C, N, V, H | 1 |
| SBCI | chemin, K | Soustraire avec Carry Constant de Reg. | Rd ¬ Rd – K – C | Z, C, N, V, H | 1 |
| ET | Chemin, Arr. | Registres AND logiques | Rd ¬ Rd · Ar | Z, N, V | 1 |
| ANDI | chemin, K | Registre ET logique et constante | Rd ¬ Rd · K | Z, N, V | 1 |
| OR | Chemin, Arr. | Registres OR logiques | Rd ¬ Rd v Rr | Z, N, V | 1 |
| ORI | chemin, K | Registre OU logique et constante | Rd ¬ Rd v K | Z, N, V | 1 |
| EOR | Chemin, Arr. | Registres OR exclusifs | Rd ¬ RdÅRr | Z, N, V | 1 |
| COM | Rd | Complément à soi | Chemin ¬ $FF – Chemin | Z, C, N, V | 1 |
| NEG | Rd | Complément à deux | Chemin ¬ 00 $ – Chemin | Z, C, N, V, H | 1 |
| SBR | Rd, K | Définir le (s) bit (s) dans le registre | Rd ¬ Rd v K | Z, N, V | 1 |
| CBR | Rd, K | Effacer le (s) bit (s) dans le registre | Rd ¬ Rd · (FFh – K) | Z, N, V | 1 |
| INC | Rd | Incrément | Rd ¬ Rd + 1 | Z, N, V | 1 |
| DÉC | Rd | Décrémenter | Chemin ¬ Chemin – 1 | Z, N, V | 1 |
| TST | Rd | Test pour zéro ou moins | Chemin ¬ Chemin · Chemin | Z, N, V | 1 |
| CLR | Rd | Effacer le registre | Rd ¬ RdÅRd | Z, N, V | 1 |
| SER | Rd | Définir le registre | Rd ¬ $FF | Aucun | 1 |
| INSTRUCTIONS DE LA SUCCURSALE | |||||
| RJMP | k | Saut relatif | CP ¬ CP + k + 1 | Aucun | 2 |
| RAPPEL | k | Appel de sous-programme relatif | CP ¬ CP + k + 1 | Aucun | 3 |
| RET | Retour de sous-programme | PC ¬ PILE | Aucun | 4 | |
| RÉSEAUX | Retour interrompu | PC ¬ PILE | I | 4 | |
| CPSE | Rd, Rr | Comparer, ignorer si égal | si (Rd = Rr) PC ¬ PC + 2 ou 3 | Aucun | 1/2 |
| CP | Rd, Rr | Comparer | Rd - Rr | Z, N, V, C, H | 1 |
| PCC | Rd, Rr | Comparez avec Carry | Rd - Rr - C | Z, N, V, C, H | 1 |
| IPC | Rd, K | Comparer S'inscrire avec Immédiat | Rd - K | Z, N, V, C, H | 1 |
| SBRC | Rr, b | Ignorer si le bit du registre est effacé | si (Rr(b)=0) PC ¬ PC + 2 ou 3 | Aucun | 1/2 |
| SBRS | Rr, b | Ignorer si le bit du registre est défini | si (Rr(b)=1) PC ¬ PC + 2 ou 3 | Aucun | 1/2 |
| SBIC | P, b | Ignorer si le bit du registre d'E / S est effacé | si (P(b)=0) PC ¬ PC + 2 ou 3 | Aucun | 1/2 |
| SIB | P, b | Ignorer si le bit du registre d'E / S est défini | si (P(b)=1) PC ¬ PC + 2 ou 3 | Aucun | 1/2 |
| BRBS | s, k | Branche si l'indicateur d'état est défini | si (SREG(s) = 1) alors PC¬PC + k + 1 | Aucun | 1/2 |
| BRBC | s, k | Succursale si l'indicateur d'état est effacé | si (SREG(s) = 0) alors PC¬PC + k + 1 | Aucun | 1/2 |
| BREQ | k | Branche si égale | si (Z = 1) alors PC ¬ PC + k + 1 | Aucun | 1/2 |
| BRN | k | Branche si non égale | si (Z = 0) alors PC ¬ PC + k + 1 | Aucun | 1/2 |
| BRCS | k | Branche si ensemble de transport | si (C = 1) alors PC ¬ PC + k + 1 | Aucun | 1/2 |
| BRCC | k | Succursale si transport autorisé | si (C = 0) alors PC ¬ PC + k + 1 | Aucun | 1/2 |
| BRSH | k | Succursale si identique ou supérieure | si (C = 0) alors PC ¬ PC + k + 1 | Aucun | 1/2 |
| BRLO | k | Branche si inférieure | si (C = 1) alors PC ¬ PC + k + 1 | Aucun | 1/2 |
| IMRB | k | Branche si moins | si (N = 1) alors PC ¬ PC + k + 1 | Aucun | 1/2 |
| BRPL | k | Branche si Plus | si (N = 0) alors PC ¬ PC + k + 1 | Aucun | 1/2 |
| BRGE | k | Succursale si supérieure ou égale, signée | si (N Å V= 0) alors PC ¬ PC + k + 1 | Aucun | 1/2 |
| BRLT | k | Branche si inférieure à zéro, signée | si (N Å V= 1) alors PC ¬ PC + k + 1 | Aucun | 1/2 |
| BRHS | k | Branche si la moitié porte le drapeau | si (H = 1) alors PC ¬ PC + k + 1 | Aucun | 1/2 |
| BRHC | k | Branche si le drapeau à moitié porté est effacé | si (H = 0) alors PC ¬ PC + k + 1 | Aucun | 1/2 |
| BRTS | k | Branche si T drapeau défini | si (T = 1) alors PC ¬ PC + k + 1 | Aucun | 1/2 |
| BRTC | k | Branche si le drapeau T effacé | si (T = 0) alors PC ¬ PC + k + 1 | Aucun | 1/2 |
| BRV | k | Branche si l'indicateur de débordement est défini | si (V = 1) alors PC ¬ PC + k + 1 | Aucun | 1/2 |
| BRVC | k | Branche si l'indicateur de débordement est effacé | si (V = 0) alors PC ¬ PC + k + 1 | Aucun | 1/2 |
| BRIE | k | Branchement si l'interruption est activée | si ( I = 1) alors PC ¬ PC + k + 1 | Aucun | 1/2 |
| BRIDGE | k | Branchement si l'interruption est désactivée | si ( I = 0) alors PC ¬ PC + k + 1 | Aucun | 1/2 |
| Mnémotechnique | Opérandes | Description | Opération | Drapeaux | #Horloges |
| INSTRUCTIONS DE TRANSFERT DE DONNÉES | |||||
| LD | Rd,Z | Charger le registre indirect | Rd ¬ (Z) | Aucun | 2 |
| ST | Z,Rr | Registre du magasin Indirect | (Z) ¬ Rr | Aucun | 2 |
| Mouvement | Chemin, Arr. | Se déplacer entre les registres | Rd ¬ Rr | Aucun | 1 |
| LDI | chemin, K | Charger immédiatement | Rd ¬ K | Aucun | 1 |
| IN | Chemin, P | Au port | Rd ¬ P | Aucun | 1 |
| DEHORS | P, Rr | Port de sortie | P ¬ Rr | Aucun | 1 |
| LPM | Charger la mémoire de programme | R0 ¬ (Z) | Aucun | 3 | |
| INSTRUCTIONS POUR LES BITS ET LES BITS-TEST | |||||
| SBI | P, b | Définir le bit dans le registre d'E / S | E/S(P,b) ¬ 1 | Aucun | 2 |
| CBI | P, b | Effacer le bit dans le registre d'E / S | E/S(P,b) ¬ 0 | Aucun | 2 |
| LSL | Rd | Décalage logique vers la gauche | Rd(n+1) ¬ Rd(n), Rd(0) ¬ 0 | Z, C, N, V | 1 |
| LSR | Rd | Décalage logique vers la droite | Rd(n) ¬ Rd(n+1), Rd(7) ¬ 0 | Z, C, N, V | 1 |
| RÔLE | Rd | Pivoter à gauche par le portage | Rd(0) ¬ C, Rd(n+1) ¬ Rd(n), C ¬ Rd(7) | Z, C, N, V | 1 |
| ROR | Rd | Tourner à droite à travers le transport | Rd(7) ¬ C, Rd(n) ¬ Rd(n+1), C ¬ Rd(0) | Z, C, N, V | 1 |
| ASR | Rd | Décalage arithmétique vers la droite | Rd(n) ¬ Rd(n+1), n = 0..6 | Z, C, N, V | 1 |
| ÉCHANGER | Rd | Échanger des grignotages | Rd(3..0) ¬ Rd(7..4), Rd(7..4) ¬ Rd(3..0) | Aucun | 1 |
| BSET | s | Ensemble de drapeau | SREG(s) ¬ 1 | SREG (s) | 1 |
| BCLR | s | Drapeau Effacer | SREG(s) ¬ 0 | SREG (s) | 1 |
| BST | Rr, b | Bit Store du registre à T | T ¬ Rr(b) | T | 1 |
| BLD | Chemin, b | Charge de bits de T à enregistrer | Rd(b) ¬ T | Aucun | 1 |
| SECONDE | Ensemble de transport | C ¬ 1 | C | 1 | |
| CLC | Effacer le transport | C ¬ 0 | C | 1 | |
| SÉN | Définir un indicateur négatif | N ¬ 1 | N | 1 | |
| CLN | Effacer l'indicateur négatif | N ¬ 0 | N | 1 | |
| ZES | Définir le drapeau zéro | Z ¬ 1 | Z | 1 | |
| CLZ | Effacer le drapeau zéro | Z ¬ 0 | Z | 1 | |
| SEI | Activation de l'interruption globale | je ¬ 1 | I | 1 | |
| CLI | Désactivation d'interruption globale | je ¬ 0 | I | 1 | |
| SES | Définir le drapeau de test signé | S ¬ 1 | S | 1 | |
| CLS | Effacer l'indicateur de test signé | S ¬ 0 | S | 1 | |
| SEV | Ensemble de débordement de complément à deux | V ¬ 1 | V | 1 | |
| CLV | Effacer le débordement du complément Twos | V ¬ 0 | V | 1 | |
| ENSEMBLE | Définir T dans SREG | T ¬ 1 | T | 1 | |
| CLT | Effacer T dans SREG | T ¬ 0 | T | 1 | |
| SEH | Définir le demi-drapeau de transport dans SREG | H ¬ 1 | H | 1 | |
| CLH | Effacer le drapeau de demi-portage dans SREG | H ¬ 0 | H | 1 | |
| NON | Aucune opération | Aucun | 1 | ||
| DORMIR | Dormir | (voir la description spécifique pour la fonction Sleep) | Aucun | 1 | |
| Le WDR | Réinitialisation du chien de garde | (voir descr. spécifique pour WDR/timer) | Aucun | 1 | |
Informations de commande
ATtiny11
| Alimentation électrique | Vitesse (MHz) | Code de commande | Emballer | Plage de fonctionnement |
|
2.7 – 5.5 V |
2 |
ATtiny11L-2PC ATtiny11L-2SC | 8P3
8S2 |
Commerciale (0°C à 70°C) |
| ATtiny11L-2PI
ATtiny11L-2SI ATtiny11L-2SU(2) |
8P3
8S2 8S2 |
Industriel (-40°C à 85°C) |
||
|
4.0 – 5.5 V |
6 |
ATtiny11-6PC ATtiny11-6SC | 8P3
8S2 |
Commerciale (0°C à 70°C) |
| ATtiny11-6PI ATtiny11-6PU(2)
ATtiny11-6SI ATtiny11-6SU(2) |
8P3
8P3 8S2 8S2 |
Industriel (-40°C à 85°C) |
Remarques
- La classe de vitesse fait référence à la fréquence d'horloge maximale lors de l'utilisation d'un cristal externe ou d'un lecteur d'horloge externe. L'oscillateur RC interne a la même fréquence d'horloge nominale pour toutes les classes de vitesse.
- Alternative d'emballage sans plomb, conforme à la directive européenne sur la restriction des substances dangereuses (directive RoHS). Également sans halogénure et entièrement vert.
| Type de paquet | |
| 8P3 | Boîtier en plastique double en ligne (PDIP) à 8 fils, 0.300 ″ de large |
| 8S2 | 8 fils, 0.200 ″ de large, petit contour en aile de mouette en plastique (EIAJ SOIC) |
ATtiny12
| Alimentation électrique | Vitesse (MHz) | Code de commande | Emballer | Plage de fonctionnement |
|
1.8 – 5.5 V |
1.2 |
ATtiny12V-1PC ATtiny12V-1SC | 8P3
8S2 |
Commerciale (0°C à 70°C) |
| ATtiny12V-1PI ATtiny12V-1PU(2)
ATtiny12V-1SI ATtiny12V-1SU(2) |
8P3
8P3 8S2 8S2 |
Industriel (-40°C à 85°C) |
||
|
2.7 – 5.5 V |
4 |
ATtiny12L-4PC ATtiny12L-4SC | 8P3
8S2 |
Commerciale (0°C à 70°C) |
| ATtiny12L-4PI ATtiny12L-4PU(2)
ATtiny12L-4SI ATtiny12L-4SU(2) |
8P3
8P3 8S2 8S2 |
Industriel (-40°C à 85°C) |
||
|
4.0 – 5.5 V |
8 |
ATtiny12-8PC ATtiny12-8SC | 8P3
8S2 |
Commerciale (0°C à 70°C) |
| ATtiny12-8PI ATtiny12-8PU(2)
ATtiny12-8SI ATtiny12-8SU(2) |
8P3
8P3 8S2 8S2 |
Industriel (-40°C à 85°C) |
Remarques
- La classe de vitesse fait référence à la fréquence d'horloge maximale lors de l'utilisation d'un cristal externe ou d'un lecteur d'horloge externe. L'oscillateur RC interne a la même fréquence d'horloge nominale pour toutes les classes de vitesse.
- Alternative d'emballage sans plomb, conforme à la directive européenne sur la restriction des substances dangereuses (directive RoHS). Également sans halogénure et entièrement vert.
| Type de paquet | |
| 8P3 | Boîtier en plastique double en ligne (PDIP) à 8 fils, 0.300 ″ de large |
| 8S2 | 8 fils, 0.200 ″ de large, petit contour en aile de mouette en plastique (EIAJ SOIC) |
Informations sur l'emballage
8P3
DIMENSIONS COMMUNES
(Unité de mesure = pouces)
| SYMBOLE | MIN | NOM | MAX | NOTE |
| A | 0.210 | 2 | ||
| A2 | 0.115 | 0.130 | 0.195 | |
| b | 0.014 | 0.018 | 0.022 | 5 |
| b2 | 0.045 | 0.060 | 0.070 | 6 |
| b3 | 0.030 | 0.039 | 0.045 | 6 |
| c | 0.008 | 0.010 | 0.014 | |
| D | 0.355 | 0.365 | 0.400 | 3 |
| D1 | 0.005 | 3 | ||
| E | 0.300 | 0.310 | 0.325 | 4 |
| E1 | 0.240 | 0.250 | 0.280 | 3 |
| e | 0.100 BSC | |||
| eA | 0.300 BSC | 4 | ||
| L | 0.115 | 0.130 | 0.150 | 2 |
Remarques
- Ce dessin est fourni à titre indicatif uniquement ; reportez-vous au dessin JEDEC MS-001, variante BA pour plus d'informations.
- Les dimensions A et L sont mesurées avec le paquet assis dans le plan d'assise JEDEC Gauge GS-3.
- Les dimensions D, D1 et E1 n'incluent pas les bavures ou les saillies du moule. L'éclat de moule ou les saillies ne doivent pas dépasser 0.010 pouce.
- E et eA mesurés avec les fils contraints d'être perpendiculaires à la référence.
- Les pointes pointues ou arrondies sont préférées pour faciliter l'insertion.
- Les dimensions maximales b2 et b3 n'incluent pas les protubérances Dambar. Les protubérances de la barre de barrage ne doivent pas dépasser 0.010 (0.25 mm).
DIMENSIONS COMMUNES
(Unité de mesure = mm)
| SYMBOLE | MIN | NOM | MAX | NOTE |
| A | 1.70 | 2.16 | ||
| A1 | 0.05 | 0.25 | ||
| b | 0.35 | 0.48 | 5 | |
| C | 0.15 | 0.35 | 5 | |
| D | 5.13 | 5.35 | ||
| E1 | 5.18 | 5.40 | 2 3 | |
| E | 7.70 | 8.26 | ||
| L | 0.51 | 0.85 | ||
| q | 0° | 8° | ||
| e | 1.27 BSC | 4 | ||
Remarques
- Ce dessin est fourni à titre indicatif uniquement ; reportez-vous au dessin EIAJ EDR-7320 pour plus d'informations.
- Le décalage des matrices supérieure et inférieure et les bavures de résine ne sont pas inclus.
- Il est recommandé que les cavités supérieure et inférieure soient égales. S'ils sont différents, la plus grande dimension doit être considérée.
- Détermine la vraie position géométrique.
- Les valeurs b,C s'appliquent à la borne plaquée. L'épaisseur standard de la couche de placage doit mesurer entre 0.007 et 021 mm.
Historique des révisions de la fiche technique
Veuillez noter que les numéros de page indiqués dans cette section font référence à ce document. Les numéros de révision font référence à la révision du document.
Rév. 1006F-06/07
- Non recommandé pour un nouveau design ”
Rév. 1006E-07/06
- Disposition des chapitres mise à jour.
- Mise à jour de la mise hors tension dans « Modes de veille pour l'ATtiny11 » à la page 20.
- Mise à jour de la mise hors tension dans « Modes de veille pour l'ATtiny12 » à la page 20.
- Tableau 16 mis à jour à la page 36.
- Mise à jour de « Octet de calibrage dans ATtiny12 » à la page 49.
- Mise à jour des « Informations de commande » à la page 10.
- Mise à jour des « Informations sur l'emballage » à la page 12.
Rév. 1006D-07/03
- Valeurs VBOT mises à jour dans le Tableau 9 à la page 24.
Rév. 1006C-09/01
- N / A
Siège social international
- Société Atmel 2325 Orchard Parkway San Jose, CA 95131 États-Unis Tél. : 1(408) 441-0311 Fax : 1(408) 487-2600
- Atmel Asie Room 1219 Chinachem Golden Plaza 77 Mody Road Tsimshatsui East Kowloon Hong Kong Tél. : (852) 2721-9778 Fax : (852) 2722-1369
- Atmel Europe Le Krebs 8, Rue Jean-Pierre Timbaud BP 309 78054 Saint-Quentin-en- Yvelines Cedex France Tél : (33) 1-30-60-70-00 Fax : (33) 1-30-60-71-11
- Atmel Japon 9F, Tonetsu Shinkawa Bldg. 1-24-8 Shinkawa Chuo-ku, Tokyo 104-0033 Japon Tél. : (81) 3-3523-3551 Fax : (81) 3-3523-7581
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