メールボックス クライアント Intel® FPGA IP リリース ノート
メールボックス クライアント Intel® FPGA IP リリース ノート
Intel® Prime Design Suite ソフトウェア バージョンは v19.1 までです。Intel Quartus Prime Design Suite ソフトウェア バージョン 19.2 以降では、Intel FPGA IP に新しいバージョン管理スキームが導入されています。
FPGA IPバージョンはIntel Quartus®と一致します
インテル FPGA IP バージョン (XYZ) 番号は、インテル Quartus Prime ソフトウェアの各バージョンで変わる可能性があります。 変更:
- X は、IP のメジャー リビジョンを示します。 インテル Quartus Prime ソフトウェアを更新する場合、IP を再生成する必要があります。
- Y は、IP に新しい機能が含まれていることを示します。 IP を再生成して、これらの新機能を含めます。
- Z は、IP に小さな変更が含まれていることを示します。 IP を再生成して、これらの変更を含めます。
関連情報
- インテル Quartus Prime Design Suite アップデートのリリースノート
- インテル FPGA IP コアの紹介
- Mailbox Client インテル FPGA IP ユーザーガイド
- ナレッジベース内の他の IP コアの正誤表
1.1. メールボックス クライアント Intel FPGA IP v20.2.0
表 1. v20.2.0 2022.09.26
| インテル Quartus プライム版 |
説明 | インパクト |
| 22.3 | セキュア デバイス マネージャー (SDM) で使用するために、Nios® V プロセッサーで LibRSU サポートを追加しました。 | — |
1.2. メールボックス クライアント Intel FPGA IP v20.1.2
表 2. v20.1.2 2022.03.28
| インテル Quartus プライム版 |
説明 | インパクト |
| 22. | CONFIG_STATUS コマンドの応答を更新し、構成クロック ソースに関する情報が含まれるようになりました。 | 構成時にタイル refclk が存在しない状態で FPGA の構成を可能にします。 |
| 割り込みステータス レジスタ (ISR) と割り込みイネーブル レジスタ (IER) が強化され、コマンド/応答および読み取り/書き込み FIF0 の保護が追加されました。 | ||
| このコマンドはこの IP では使用できないため、メールボックス コマンド REBOOT_HPS は削除されました。 |
Intel Corporation。無断複写・転載を禁じます。Intel、Intel ロゴ、その他の Intel マークは、Intel Corporation またはその子会社の商標です。Intel は、FPGA および半導体製品が Intel の標準保証に従って現在の仕様どおりに動作することを保証しますが、製品およびサービスは予告なく変更されることがあります。Intel は、Intel が書面で明示的に同意した場合を除き、ここに記載されている情報、製品、またはサービスを適用または使用したことに起因する責任または義務を一切負いません。Intel のお客様は、公開されている情報に依拠する前、および製品またはサービスを注文する前に、デバイスの最新版仕様を入手することをお勧めします。
*その他の名称およびブランドは、一般に各社の所有物である場合があります。
1.3. メールボックス クライアント Intel FPGA IP v20.1.1
表 3. v20.1.1 2021.12.13
| インテル Quartus プライム版 |
説明 | インパクト |
| 21.4 | • 暗号サービス固有のパラメータ名を 暗号化サービスを有効にする HAS_OFFLOAD • safeclib memcpy実装を汎用的なものに置き換える HAL ドライバーの memcpy。 |
— |
1.4. メールボックス クライアント Intel FPGA IP v20.1.0
表 4. v20.1.0 2021.10.04
| インテル Quartus プライム版 |
説明 | インパクト |
| 21.3 | 暗号化をサポートするためにHAS_OFFLOADパラメータを追加しました オフロード。この機能は Intel Agilex™ デバイスでのみ使用できます。 |
設定すると、IPは 暗号化AXIイニシエーターインターフェース。 |
| リリースノートの部品番号をRN-1201から変更しました。 RN-1259。 |
— |
1.5. メールボックス クライアント Intel FPGA IP v20.0.2
表 5. v20.0.2 2021.03.29
| Intel Quartus Prime バージョン | 説明 | インパクト |
| 21. | Mailbox Client Intel FPGA IP リセットアサーションのイベント中にタイマー 1 およびタイマー 2 遅延レジスタをリセットするためのサポートが追加されました。 | Intel Quartus Prime ソフトウェア バージョン 1 および 2 では、タイマー 20.2 およびタイマー 20.4 レジスタの使用に影響はありません。 再生する必要があります メールボックスクライアントIntel FPGA IPをIntelから移行する場合 Quartus Prime ソフトウェア バージョン 20.4 以前から Intel Quartus Prime ソフトウェア バージョン 21.1 へ。 |
| Mailbox Client Intel FPGA IP IRQ 信号と Nios II プロセッサ IRQ 信号間の接続機能を有効にするサポートが追加されました。 | この機能を有効にするには、Intel Quartus Prime ソフトウェア バージョン 21.1 に移行し、Mailbox Client Intel FPGA IP を再生成する必要があります。 |
1.6. メールボックス クライアント Intel FPGA IP v20.0.0
表 6. v20.0.0 2020.04.13
| インテル Quartus プライム版 |
説明 | インパクト |
| 20. | 完全なコマンドにパケットの終了が含まれていなかったことを示す EOP_TIMEOUT 割り込みのサポートが追加されました。 | これらの割り込みを使用して、不完全なトランザクションのエラー検出を処理できます。 |
| SDM 内でエラーが発生したことを示す BACKPRESSURE_TIMEOUT 割り込みのサポートが追加されました。 |
1.7. メールボックス クライアント Intel FPGA IP v19.3
表 7. v19.3 2019.09.30
| インテル Quartus プライム版 |
説明 | インパクト |
| 19. | インテル Agilex デバイスのデバイス サポートが追加されました。 | この IP を Intel Agilex デバイスで使用できるようになりました。 |
| ヘッダーに指定されたコマンドの長さが実際に送信されたコマンドと一致しないことを示す COMMAND_INVALID 割り込みのサポートが追加されました。 | この割り込みを使用して、誤って指定されたコマンドを識別できます。 | |
| この IP の名前を Intel FPGA Stratix 10 Mailbox Client から Mailbox Client Intel FPGA IP に変更しました。 | このIPは、現在Intel Stratix® 10とIntel Agilexデバイスの両方をサポートしています。新しい名前を使用して、Intel Quartus Primeソフトウェアまたは web. | |
| 新しい IP バージョン構造を追加しました。 | IP バージョン番号は、Intel Quartus Prime ソフトウェアのバージョンによって変わる場合があります。 |
1.8. Intel FPGA Stratix 10 メールボックス クライアント v17.1
表 8. v17.1 2017.10.30
| インテル Quartus プライム版 |
説明 | インパクト |
| 17. | 初回リリース。 | — |
1.9. メールボックス クライアント Intel FPGA IP ユーザーガイド アーカイブ
このユーザー ガイドの最新版および以前のバージョンについては、Mailbox Client Intel FPGA IP ユーザー ガイドを参照してください。IP またはソフトウェア バージョンがリストされていない場合は、以前の IP またはソフトウェア バージョンのユーザー ガイドが適用されます。
IP バージョンは、v19.1 までの インテル Quartus Prime Design Suite ソフトウェアのバージョンと同じです。 インテル Quartus Prime Design Suite ソフトウェアのバージョン 19.2 以降から、IP コアには新しい IP バージョニング スキームがあります。
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