Placa de desenvolvimento WiFi ESPRESSIF ESP32 Wroom-32D ESP32D

Este documento descreve as diferenças entre a revisão do chip v3.0 e as revisões anteriores do chip ESP32.

Notas de Lançamento

Notificação de alteração de documentação

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Certificação

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Mudanças de design no chip

A Espressif lançou a revisão do chip ESP32 v3.0 que apresenta alterações no nível do wafer com base nas revisões anteriores do chip ESP32. As alterações de design introduzidas na revisão do chip ESP32 v3.0 são:

1. Corrigido “Devido ao tempo de inicialização do flash, uma redefinição espúria do watchdog ocorre quando o ESP32 é ligado ou desperta do sono profundo”. Detalhes do problema podem ser encontrados no item 3.8 da Errata do SoC da Série ESP32.
2. PSRAM Cache Bug Fix: Corrigido “Quando a CPU acessa a SRAM externa em uma determinada sequência, podem ocorrer erros de leitura e gravação”. Detalhes do problema podem ser encontrados no item 3.9 da Errata do SoC da Série ESP32.
3. Corrigido “Quando cada CPU lê certos espaços de endereços diferentes simultaneamente, pode ocorrer um erro de leitura”. Detalhes do problema podem ser encontrados no item 3.10 da Errata do SoC da Série ESP32.
4. Estabilidade otimizada do oscilador de cristal de 32.768 KHz. O problema foi relatado pelo cliente de que há uma baixa probabilidade de que no hardware de revisão do chip v1.0, o oscilador de cristal de 32.768 KHz não possa iniciar corretamente.
5. Corrigidos problemas de injeção de falhas relacionados à inicialização segura e à criptografia de flash. Referência: Comunicado de segurança sobre injeção de falhas e proteções eFuse (CVE-2019-17391) e Comunicado de segurança Espressif sobre injeção de falhas e inicialização segura (CVE-2019-15894)
6. Melhoria: Alterada a taxa de transmissão mínima suportada pelo módulo TWAI de 25 kHz para 12.5 kHz.
7. Permitiu que o modo Download Boot fosse desativado permanentemente programando o novo bit eFuse UART_DOWNLOAD_DIS. Quando este bit é programado para 1, o modo Download Boot não pode ser usado e a inicialização falhará se os pinos de amarração estiverem definidos para este modo. O software programa esse bit gravando no bit 27 de EFUSE_BLK0_WDATA0_REG e lê esse bit lendo o bit 27 de EFUSE_BLK0_RDATA0_REG. A desabilitação de gravação para este bit é compartilhada com a desabilitação de gravação para o campo flash_crypt_cnt eFuse.

Impacto nos projetos do cliente

Esta seção destina-se a ajudar nossos clientes a entender o impacto do uso da revisão do chip v3.0 em um novo design ou da substituição da versão mais antiga do SoC pela revisão do chip v3.0 no design existente.

Caso de uso 1: atualização de hardware e software
Este é o caso de uso em que o novo projeto está sendo iniciado ou a atualização de hardware e software em um projeto existente é uma opção possível. Nesse caso, o projeto pode se beneficiar da proteção contra ataques de injeção de falhas e também pode levar vantagemtage do novo mecanismo de inicialização segura e correção de bug do cache PSRAM com desempenho PSRAM ligeiramente aprimorado.

1. Alterações de design de hardware:
   Siga as diretrizes de design de hardware do ESP32 mais recentes. Para otimização do problema de estabilidade do oscilador de cristal de 32.768 KHz, consulte a seção Oscilador de cristal para obter mais informações.
2. Alterações no design do software:
   1. Selecione Configuração mínima para Rev3: Vá para menuconfig > Configuração do componente > ESP32-specific e defina a opção Minimum Supported ESP32 Revision como “Rev 3”.
   2. Versão do software: recomendamos o uso de inicialização segura baseada em RSA do ESP-IDF v4.1 e posterior. A versão de lançamento do ESP-IDF v3.X também pode funcionar com aplicativos com inicialização segura original V1.

Caso de uso 2: somente atualização de hardware
Este é o caso de uso em que os clientes têm um projeto existente que pode permitir a atualização de hardware, mas o software precisa permanecer o mesmo nas revisões de hardware. Neste caso, o projeto obtém o benefício de segurança para ataques de injeção de falhas, correção de bug do cache PSRAM e problema de estabilidade do oscilador de cristal de 32.768KHz. O desempenho da PSRAM continua o mesmo.

1. Alterações de design de hardware:
   Siga as diretrizes de design de hardware do ESP32 mais recentes.
2. Alterações no design do software:
   O cliente pode continuar a usar o mesmo software e binário para o produto implantado. O mesmo binário de aplicativo funcionará na revisão de chip v1.0 e na revisão de chip v3.0.

Especificação de etiqueta

• A etiqueta do ESP32-D0WD-V3 é mostrada abaixo:

  
• A etiqueta do ESP32-D0WDQ6-V3 é mostrada abaixo:

  

Informações para pedidos

Para encomendar produtos, consulte: ESP Product Selector.

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Documentos / Recursos

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Referências

• Manual do usuário