Placa de desarrollo WiFi ESPRESSIF ESP32 Wroom-32D ESP32D

Este documento describe las diferencias entre la revisión del chip v3.0 y las revisiones anteriores del chip ESP32.

Notas de la versión

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Cambios de diseño en el chip

Espressif ha lanzado la revisión del chip ESP32 v3.0 que presenta cambios a nivel de oblea basados ​​en revisiones anteriores del chip ESP32. Los cambios de diseño introducidos en la revisión del chip ESP32 v3.0 son:

1. Se corrigió "Debido al tiempo de inicio del flash, se produce un reinicio falso del perro guardián cuando se enciende el ESP32 o se despierta del modo de suspensión profunda". Los detalles del problema se pueden encontrar en el elemento 3.8 en la errata del SoC de la serie ESP32.
2. Corrección de errores de caché de PSRAM: se corrigió "Cuando la CPU accede a la SRAM externa en una secuencia determinada, pueden ocurrir errores de lectura y escritura". Los detalles del problema se pueden encontrar en el elemento 3.9 en la errata del SoC de la serie ESP32.
3. Se corrigió "Cuando cada CPU lee ciertos espacios de direcciones diferentes simultáneamente, puede ocurrir un error de lectura". Los detalles del problema se pueden encontrar en el elemento 3.10 en la errata del SoC de la serie ESP32.
4. Estabilidad optimizada del oscilador de cristal de 32.768 KHz. El problema fue informado por el cliente de que existe una baja probabilidad de que en el hardware de revisión de chip v1.0, el oscilador de cristal de 32.768 KHz no pueda iniciarse correctamente.
5. Se corrigieron los problemas de inyección de fallas relacionados con el arranque seguro y el cifrado flash. Referencia: Aviso de seguridad sobre inyección de errores y protecciones eFuse (CVE-2019-17391) y Aviso de seguridad de Espressif sobre inyección de errores y arranque seguro (CVE-2019-15894)
6. Mejora: Cambió la velocidad de transmisión mínima admitida por el módulo TWAI de 25 kHz a 12.5 kHz.
7. Se permitió que el modo de arranque de descarga se deshabilite permanentemente mediante la programación del nuevo bit eFuse UART_DOWNLOAD_DIS. Cuando este bit está programado en 1, el modo de arranque de descarga no se puede usar y el arranque fallará si los pines de conexión están configurados para este modo. El software programa este bit escribiendo en el bit 27 de EFUSE_BLK0_WDATA0_REG y lee este bit leyendo el bit 27 de EFUSE_BLK0_RDATA0_REG. La desactivación de escritura para este bit se comparte con la desactivación de escritura para el campo flash_crypt_cnt eFuse.

Impacto en proyectos de clientes

Esta sección está destinada a ayudar a nuestros clientes a comprender el impacto de usar la revisión de chip v3.0 en un nuevo diseño o reemplazar la versión anterior del SoC con la revisión de chip v3.0 en un diseño existente.

Caso de uso 1: actualización de hardware y software
Este es el caso de uso en el que se inicia el nuevo proyecto o la actualización de hardware y software en un proyecto existente es una opción posible. En tal caso, el proyecto puede beneficiarse de la protección contra el ataque de inyección de fallas y también puede tomar ventaja.tage del nuevo mecanismo de arranque seguro y corrección de errores de caché de PSRAM con un rendimiento de PSRAM ligeramente mejorado.

1. Cambios en el diseño de hardware:
   Siga las pautas de diseño de hardware ESP32 más recientes. Para optimizar el problema de estabilidad del oscilador de cristal de 32.768 KHz, consulte la sección Oscilador de cristal para obtener más información.
2. Cambios en el diseño del software:
   1. Seleccione Configuración mínima para Rev3: Vaya a menuconfig > Conponent config > ESP32-específico, y configure la opción Revisión mínima admitida de ESP32 en "Rev 3".
   2. Versión de software: se recomienda utilizar el arranque seguro basado en RSA desde ESP-IDF v4.1 y posterior. La versión de lanzamiento ESP-IDF v3.X también puede funcionar con la aplicación con arranque seguro original V1.

Caso de uso 2: solo actualización de hardware
Este es el caso de uso en el que los clientes tienen un proyecto existente que puede permitir la actualización de hardware, pero el software debe permanecer igual en todas las revisiones de hardware. En este caso, el proyecto se beneficia de la seguridad frente a los ataques de inyección de fallos, la corrección de errores de caché de PSRAM y el problema de estabilidad del oscilador de cristal de 32.768 KHz. Sin embargo, el rendimiento de PSRAM sigue siendo el mismo.

1. Cambios en el diseño de hardware:
   Siga las últimas pautas de diseño de hardware ESP32.
2. Cambios en el diseño del software:
   El cliente puede continuar usando el mismo software y binario para el producto implementado. El mismo binario de aplicación funcionará tanto en la revisión de chip v1.0 como en la revisión de chip v3.0.

Especificación de etiqueta

• La etiqueta de ESP32-D0WD-V3 se muestra a continuación:

  

• La etiqueta de ESP32-D0WDQ6-V3 se muestra a continuación:

  

Información de pedidos

Para realizar pedidos de productos, consulte: Selector de productos ESP.

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Documentos / Recursos

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Referencias

• Manual de usuario