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Microcontrôleur basé sur NXP LPC55S0x M33

Produit de microcontrôleur basé sur NXP-LPC55S0x-M33

Informations sur le document

Mots clés

  • LPC55S06JBD64. LPC55S06JHI48, LPC55S04JBD64, LPC55S04JHI48,
  • LPC5506JBD64, LPC5506JHI48, LPC5504JBD64, LPC5504JHI48,
  • LPC5502JBD64, LPC5502JHI48

Abstrait

  • Errata LPC55S0x/LPC550x

Historique des révisions

Tour Date Description
1.3 20211110 Ajout de la note CAN-FD.1 dans la section 3.3 "CAN-FD.1 : l'abandon de la transaction de bus peut se produire lorsque le périphérique CAN-FD utilise un alias sécurisé".
1.2 20210810 Ajout de VBAT_DCDC.1 : Section 3.2 « VBAT_DCDC.1 : Le temps de montée minimum de l'alimentation doit être de 2.6 ms ou moins pour Tamb = -40 C, et de 0.5 ms ou moins pour Tamb = 0 C pour
+105 °C »
1.1 20201006 Deuxième version.
1.0 20200814 Version initiale.

Identification du produit

Le boîtier LPC55S0x/LPC550x HTQFP64 porte le marquage supérieur suivant :

  • Première ligne : LPC55S0x/LPC550x
  • Deuxième ligne : JBD64
  • Troisième ligne : xxxx
  • La quatrième ligne : xxxx
  • La cinquième ligne : zzzyywwxR
    • yyww : code de date avec yy = année et ww = semaine.
    • xR : révision A de l'appareil

Le boîtier LPC55S0x/LPC550x HVQFN48 porte le marquage supérieur suivant :

  • Première ligne : LPC55S0x/LPC550x
  • Deuxième ligne : JHI48
  • Troisième ligne : xxxxxxx
  • La quatrième ligne : xxxx
  • Cinquième ligne : zzzyywwxR
    • yyww : code de date avec yy = année et ww = semaine.
    • xR : révision A de l'appareil

Errata terminéview

Tableau des problèmes fonctionnels

Tableau 1.       Tableau des problèmes fonctionnels
Fonctionnel              Brève description des problèmes Identifiant de révision Description détaillée
ROM.1 La ROM ne parvient pas à entrer en mode ISP lorsque l'image est corrompue avec des pages flash dans un état effacé ou non programmé. A Section 3.1
VBAT_DCDC.1 Le temps de montée minimum de l'alimentation doit être de 2.6 ms ou moins pour Tamb = -40 C, et de 0.5 ms ou moins pour Tamb = 0 C à +105 C. A Section 3.2
CAN-FD.1 L'abandon de la transaction du bus peut se produire lorsque le périphérique CAN-FD utilise un alias sécurisé. A Section 3.3.

Tableau des écarts AC/DC Microcontrôleur basé sur NXP-LPC55S0x-M33-fig-1

Notes d'errata Microcontrôleur basé sur NXP-LPC55S0x-M33-fig-2

Détail des problèmes fonctionnels

ROM.1 : la ROM ne parvient pas à entrer en mode ISP lorsque l'image est corrompue avec des pages flash dans un état effacé ou non programmé

Introduction
Sur le LPC55S0x/LPC550x, si l'image est corrompue avec des pages flash dans un état effacé ou non programmé, la ROM peut ne pas entrer automatiquement en mode ISP.

Problème
Lorsque le démarrage sécurisé est activé dans CMPA et que la mémoire flash contient une page de mémoire effacée ou non programmée dans la région de mémoire spécifiée par le champ de taille d'image dans l'en-tête de l'image, l'appareil n'entre pas automatiquement en mode ISP à l'aide du mécanisme de secours, comme dans le cas d'un échec de démarrage pour une image invalide. Ce problème se produit lorsque l'image de l'application n'est que partiellement écrite ou effacée mais qu'un en-tête d'image valide est toujours présent en mémoire.

Solution de contournement
Effectuez un effacement en masse pour supprimer l'image incomplète et corrompue en utilisant l'une des méthodes suivantes :

  • Exécutez la commande d'effacement à l'aide de Debug L'appareil entrera directement en mode ISP après avoir quitté la boîte aux lettres.
  • Entrez en mode ISP à l'aide de la commande Debug Mailbox et utilisez la commande flash-erase.
  • Réinitialisez l'appareil et entrez en mode ISP à l'aide de l'ISP Utilisez la commande flash-erase pour effacer l'image corrompue (incomplète).

VBAT_DCDC.1 : Le temps de montée minimum de l'alimentation doit être de 2.6 ms ou moins pour Tamb = -40 C, et de 0.5 ms ou moins pour Tamb = 0 C à +105 C

Introduction
La fiche technique ne spécifie aucune exigence de mise sous tension pour l'alimentation sur la broche VBAT_DCDC.

Problème
L'appareil peut ne pas toujours démarrer si le temps de montée minimum de l'alimentation ramp est de 2.6 ms ou plus rapide pour Tamb = -40 C, et de 0.5 ms ou plus rapide pour Tamb = 0 C à +105 C.

Solution de contournement
Aucun.

CAN-FD.1 : l'abandon de la transaction de bus peut se produire lorsque le périphérique CAN-FD utilise un alias sécurisé

Introduction
Contrairement au CM33, pour les autres maîtres AHB (CAN-FD, USB-FS, DMA), le niveau de sécurité de la transaction est fixé en fonction du niveau attribué au maître dans le registre SEC_AHB->MASTER_SEC_LEVEL. Ainsi, si l'application doit restreindre le CAN-FD pour sécuriser, les étapes suivantes sont nécessaires :

  • Définissez le niveau de sécurité de CAN-FD sur secure-user (0x2) ou secure privilege (0x3) dans le registre SEC_AHB->MASTER_SEC_LEVEL.
  • Attribuez un niveau d'utilisateur sécurisé ou de privilège sécurisé pour l'espace de registre CAN-FD dans le registre SEC_AHB-> SEC_CTRL_AHB_PORT8_SLAVE1.
  • Affectez un niveau d'utilisateur sécurisé ou de privilège sécurisé pour la RAM de messages.

Example:
Si 16 Ko de banque SRAM 2 (0x2000_C000) sont utilisés pour la RAM de message CAN. Définissez ensuite les règles dans le registre SEC_AHB-> SEC_CTRL_RAM2_MEM_RULE0 sur secure-user (0x2) ou secure privilege (0x3).

Problème
La mémoire partagée utilisée par le contrôleur CAN-FD et la CPU doit être accessible à l'aide d'un alias sécurisé avec le bit d'adresse 28 défini (ex.ampfichier 0x3000_C000). Cependant, lorsque CAN-FD effectue une transaction de bus à l'aide d'un alias sécurisé (bit d'adresse 28 défini), la transaction est abandonnée.

Solution de contournement

  • Lorsque la CPU accède au registre CAN-FD ou à la RAM de messages, elle doit toujours utiliser un alias sécurisé, c'est-à-dire 0x3000_C000 pour la manipulation de la RAM de messages. .
  • Pour toute structure utilisée par le périphérique CAN-FD pour récupérer ou écrire, la mémoire doit être configurée pour utiliser 0x2000_C000 afin que les transactions de bus fonctionnent. Le pilote logiciel CAN-FD doit définir le «registre d'adresse de base de la RAM de message (MRBA, décalage 0x200)» avec l'adresse physique de la RAM au lieu de l'alias sécurisé.

Détail des déviations AC/DC

Aucun errata connu.

Détail des notes d'errata

Aucun errata connu.

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Documents / Ressources

Microcontrôleur basé sur NXP LPC55S0x M33 [pdf] Manuel de l'utilisateur
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Références

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