Microsemi IGLOO2 HPMS 단일 오류 수정/이중 오류 감지 사용 설명서

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1 Microsemi IGLOO2 HPMS 단일 오류 수정/이중 오류 감지

2 소개

Microsemi IGLOO2 HPMS 단일 오류 수정/이중 오류 감지

소개

IGLOO2 HPMS에는 임베디드 DDR 컨트롤러(HPMS DDR)가 있습니다. 이 DDR 컨트롤러는 오프칩 DDR 메모리를 제어하기 위한 것입니다. HPMS DDR 컨트롤러는 HPMS(HPDMA 사용) 및 FPGA 패브릭에서 액세스할 수 있습니다.
System Builder를 사용하여 HPMS DDR이 포함된 시스템 블록을 구축할 때 System Builder는 항목 및 선택 사항을 기반으로 HPMS DDR 컨트롤러를 구성합니다.
사용자가 별도로 HPMS DDR을 구성할 필요가 없습니다. 자세한 내용은 IGLOO2 System Builder 사용 설명서를 참조하십시오.
시스템 빌더

구성 옵션

그림 1-1과 같이 System Builder SECDED 페이지에서 EDAC 옵션을 구성할 수 있습니다.

그림 1-1 • EDAC 구성

EDAC_ERROR 버스 노출 - 이 옵션을 사용하여 설계에서 사용할 수 있는 FPGA 패브릭에 EDAC_ERROR 버스 신호를 노출합니다.
EDAC 활성화 - 이 옵션을 사용하여 다음 각 블록에 대해 EDAC 기능을 활성화합니다.

eSRAM_0

eSRAM_1
MDDR

eSRAM의 경우 EDAC 인터럽트는 다음 네 가지 방법 중 하나로 구성할 수 있습니다(그림 1-2 참조).

없음(인터럽트 없음)

1비트 오류(1비트 오류가 있을 때 중단)
2비트 오류(2비트 오류가 있을 때 중단)

1비트 및 2비트 오류(1비트 오류 및 2비트 오류가 모두 발생하면 중단됨)

그림 1-2 • EDAC 인터럽트 활성화

포트 설명

표 2-1 • 포트 설명

포트 이름	방향	인주?	설명
EDAC_버스[0]	밖으로	아니요	(ESRAM0_EDAC_1E & ESRAM0_EDAC_1E_EN) \|\| (ESRAM0_EDAC_2E 및 ESRAM0_EDAC_2E_EN)
EDAC_버스[1]	밖으로	아니요	(ESRAM1_EDAC_1E & ESRAM1_EDAC_1E_EN) \|\| (ESRAM1_EDAC_2E 및 ESRAM1_EDAC_2E_EN)
EDAC_버스[7]	밖으로	아니요	MDDR_ECC_INT 및 MDDR_ECC_INT_EN

제품 지원

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문서 / 리소스

Microsemi IGLOO2 HPMS 단일 오류 수정/이중 오류 감지 [PDF 파일] 사용자 가이드
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참고문헌

사용자 설명서