Microsemi IGLOO2 HPMS シングルエラー訂正 / ダブルエラー検出
導入
IGLOO2 HPMS には、DDR コントローラ (HPMS DDR) が組み込まれています。 この DDR コントローラは、オフチップ DDR メモリを制御するためのものです。 HPMS DDR コントローラーは、HPMS (HPDMA を使用) および FPGA ファブリックからアクセスできます。
System Builder を使用して HPMS DDR を含むシステム ブロックを構築すると、System Builder は入力と選択に基づいて HPMS DDR コントローラーを構成します。
ユーザーによる個別の HPMS DDR 設定は必要ありません。 詳細については、IGLOO2 System Builder ユーザー ガイドを参照してください。
システムビルダー
設定オプション
図 1-1 に示すように、System Builder の SECDED ページから EDAC オプションを設定できます。
図1-1 • EDACの設定
Expose EDAC_ERROR Bus – このオプションを使用して、EDAC_ERROR バス信号をデザインで使用できる FPGA ファブリックに公開します。
EDAC を有効にする – このオプションを使用して、次の各ブロックの EDAC 機能を有効にします。
- 電子SRAM_0
- 電子SRAM_1
- MDDR の
eSRAM の場合、EDAC 割り込みは次の 1 つの方法のいずれかで構成できます (図 2-XNUMX を参照)。
- なし（割り込みなし）
- 1ビットエラー（1ビットエラー発生時に割り込み）
- 2ビットエラー（2ビットエラー発生時に割り込み）
- 1 ビットおよび 2 ビット エラー (1 ビット エラーと 2 ビット エラーの両方が発生した場合に割り込み)
図1-2 • EDAC割り込みを有効にする
ポートの説明
表 2-1 • ポートの説明
| ポート名 | 方向 | パッド？ | 説明 |
| EDAC_バス[0] | 外 | いいえ | (ESRAM0_EDAC_1E & ESRAM0_EDAC_1E_EN) || (ESRAM0_EDAC_2E & ESRAM0_EDAC_2E_EN) |
| EDAC_バス[1] | 外 | いいえ | (ESRAM1_EDAC_1E & ESRAM1_EDAC_1E_EN) || (ESRAM1_EDAC_2E & ESRAM1_EDAC_2E_EN) |
| EDAC_バス[7] | 外 | いいえ | MDDR_ECC_INT & MDDR_ECC_INT_EN |
製品サポート
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ドキュメント / リソース
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