Microsemi IGLOO2 HPMS 單一錯誤修正/雙錯誤偵測
介紹
IGLOO2 HPMS 具有嵌入式 DDR 控制器 (HPMS DDR)。此 DDR 控制器設計用於控製片外 DDR 記憶體。 HPMS DDR 控制器可從 HPMS（使用 HPDMA）以及 FPGA 結構存取。
當您使用 System Builder 建置包含 HPMS DDR 的系統區塊時，System Builder 會根據您的輸入和選擇為您設定 HPMS DDR 控制器。
使用者無需單獨進行 HPMS DDR 配置。詳情請參閱 IGLOO2 System Builder 使用者指南。
系統生成器
配置選項
您可以從 System Builder SECDED 頁面設定 EDAC 選項，如圖 1-1 所示。
圖 1-1 • 設定 EDAC
公開 EDAC_ERROR 匯流排 – 使用此選項將 EDAC_ERROR 匯流排訊號公開給 FPGA 架構，您的設計可以在其中使用該訊號。
啟用 EDAC – 使用此選項可為以下每個模組啟用 EDAC 功能：
- eSRAM_0
- eSRAM_1
- 多寄存器
對於 eSRAM，EDAC 中斷可以透過四種方式之一進行設定（如圖 1-2 所示）：
- 無（無中斷）
- 1 位元錯誤（出現 1 位元錯誤時中斷）
- 2 位元錯誤（出現 2 位元錯誤時中斷）
- 1 位元和 2 位元錯誤（同時發生 1 位元錯誤和 2 位元錯誤時中斷）
圖 1-2 • 啟用 EDAC 中斷
連接埠說明
表 2-1 • 端口說明
| 連接埠名稱 | 方向 | 軟墊？ | 描述 |
| EDAC_匯流排[0] | 出去 | 不 | (ESRAM0_EDAC_1E 與 ESRAM0_EDAC_1E_EN) || （ESRAM0_EDAC_2E 和 ESRAM0_EDAC_2E_EN） |
| EDAC_匯流排[1] | 出去 | 不 | (ESRAM1_EDAC_1E 與 ESRAM1_EDAC_1E_EN) || （ESRAM1_EDAC_2E 和 ESRAM1_EDAC_2E_EN） |
| EDAC_匯流排[7] | 出去 | 不 | MDDR_ECC_INT 和 MDDR_ECC_INT_EN |
產品支援
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文件/資源
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Microsemi IGLOO2 HPMS 單一錯誤修正/雙錯誤偵測 [pdf] 使用者指南 IGLOO2 HPMS 單一錯誤修正雙錯誤偵測、IGLOO2、HPMS 單一錯誤修正雙錯誤偵測、雙錯誤偵測 |
