Microsemi SmartDesign MSS GPIO 設定
SmartFusion Microcontroller Subsystem (MSS) は、1 個の構成可能な GPIO を備えた GPIO ハード ペリフェラル (APB_32 サブ バス) を提供します。 各 GPIO の実際の動作 (入力、出力、および出力イネーブル レジスタ制御、割り込みモードなど) は、アクテルが提供する SmartFusion MSS GPIO ドライバーを使用して、アプリケーション レベルで定義できます。 ただし、GPIO を外部パッド (MSS I/O) に直接接続するか、FPGA ファブリックに直接接続するかを定義する必要があります。 デバイス構成のこの部分は、MSS GPIO コンフィギュレーターを使用して行われ、このドキュメントで説明されています。
MSS GPIO ハード ペリフェラルの詳細については、Actel SmartFusion Microcontroller Subsystem User's Guide を参照してください。
接続オプション
MSS I/O パッド – 選択した GPIO が外部専用パッド (MSS I/O) に接続されることを示すには、このオプションを選択します。 MSS I/O パッドの構成方法を定義する I/O バッファーのタイプ (INBUF、OUTBUF、TRIBUFF、および BIBUF) を選択する必要があります。 MSS I/O が別のペリフェラルまたはファブリックによって既に使用されている場合、このオプションは使用できない場合があることに注意してください (詳細については、MSS I/O 共有のセクションを参照してください)。
生地– 選択した GPIO が FPGA ファブリックに接続されることを示すには、このオプションを選択します。 ファブリックに接続するために、GPI (入力)、GPO (出力)、または GPI と GPO (入力/出力) の両方の接続を引き出すかどうかを選択する必要があります。 このオプションが選択されている場合、GPIO 出力イネーブル レジスタをファブリックに出力できないことに注意してください。 また、ファブリックに接続された GPI は、適切な割り込みイネーブル ビットがアプリケーションによって適切に設定されている場合 (MSS GPIO ドライバー初期化関数)、ユーザー ロジックから割り込みをトリガーできます。
MSS I/O 共有
SmartFusion アーキテクチャでは、MSS I/O は XNUMX つの MSS ペリフェラル間、または MSS ペリフェラルと FPGA ファブリック間で共有されます。 特定の MSS I/O が MSS ペリフェラルまたは FPGA ファブリックに既に接続されている場合、MSS GPIO は特定の MSS I/O に接続できない場合があります。 GPIO コンフィギュレーターは、GPIO を MSS I/O に接続できるかどうかに関する直接的なフィードバックを提供します。
GPIO [31：16]
GPIO[31:16] は、MSS I/O を共有している MSS ペリフェラルを示すグループに編成されています。 周辺機器が使用されている場合 (MSS キャンバスで有効になっている場合)、対応する共有 GPIO の MSS I/O パッド プルダウン メニューがグレー表示され、プルダウン メニューの横に情報アイコンが表示されます。 情報アイコンは、MSS I/O オプションが MSS ペリフェラルによって既に使用されているか、選択したパッケージに基づいてボンディングされていないため、選択できないことを示します。
Examp1 番目
MSS キャンバスでは、SPI_0、SPI_1、I2C_0、I2C_1、UART_0、および UART_1 が有効になっています。
- GPIO[31:16] は MSS I/O に接続できません。 グレー表示されたメニューと情報アイコンに注意してください (図 1-1)。
- GPIO[31:15] は引き続き FPGA ファブリックに接続できます。 この例ではampファイルでは、GPIO[31] は出力として、GPIO[30] は入力としてファブリックに接続されています。
Examp2 番目
I2C_0 と I2C_1 は MSS キャンバスで無効になっています。
- GPIO[31:30] と GPIO[23:22] は MSS I/O に接続できます (図 1-2 を参照)。
- この例ampファイルでは、GPIO[31] と GPIO[30] の両方が出力ポートとして MSS I/O に接続されています。
- この例amp図では、GPIO[23] は入力ポートとして MSS I/O に接続され、GPIO[22] は双方向ポートとして MSS I/O に接続されています。
- GPIO[29:24,21:16] は MSS I/O に接続できません。 グレー表示されたメニューと情報アイコンに注意してください。
- GPIO[29:24,21:16] は引き続き FPGA ファブリックに接続できます。 この例ではampファイルでは、GPIO[29] と GPIO[28] の両方が入力ポートとしてファブリックに接続されています。
GPIO [15：0]
GPIO[15:0] は、FPGA ファブリックに接続するように構成できる MSS I/O を共有します (この後の構成は、MSS I/O Configurator を使用して実行できます)。 MSS I/O が FPGA ファブリックに接続するように構成されている場合、対応する共有 GPIO の MSS I/O パッド プルダウン メニューがグレー表示され、プルダウン メニューの横に情報アイコンが表示されます。 情報アイコンは、MSS I/O オプションが既に使用されているか、選択したパッケージに基づいて結合されていないため、選択できないことを示します。
コンフィギュレーターの青色のテキストは、GPIO に関連付けられた各 MSS I/O のパッケージ ピン名を強調表示していることに注意してください。 この情報は、ボード レイアウトの計画に役立ちます。
Example
MSS I/O 構成と GPIO[15:0] 構成がどのように結合されているかを適切に示すために、図 1-3 に、次の構成で両方のコンフィギュレータを並べて示します。
- MSS I/O[15] は、FPGA ファブリックに接続された INBUF ポートとして使用されます。 したがって、GPIO[15] を MSS I/O に接続することはできません。
- GPIO[5] は入力として MSS I/O に接続されています。 したがって、MSS I/O[5] を使用して FPGA ファブリックに接続することはできません。
- GPIO[3] は FPGA ファブリックに出力として接続されます。 したがって、MSS I/O[3] を使用して FPGA ファブリックに接続することはできません。
ポートの説明
表 2-1 • GPIO ポートの説明
| ポート名 | 方向 | パッド？ | 説明 |
| GPIO_ _の | In | はい | GPIO[index] が MSS I/O として設定されている場合の GPIO ポート名 入力
ポート |
| GPIO_ _外 | 外 | はい | GPIO[index] が MSS I/O として設定されている場合の GPIO ポート名 出力
ポート |
| GPIO_ _TRI | 外 | はい | GPIO[index] が MSS I/O として設定されている場合の GPIO ポート名
トライステート ポート |
| GPIO_ _BI | インアウト | はい | GPIO[index] が MSS として設定されている場合の GPIO ポート名 I/O 双方向 ポート |
| F2M_GPI_ | In | いいえ | GPIO[index] が FPGA ファブリックに接続するように構成されている場合の GPIO ポート名 入力 ポート (F2M は、信号がファブリックから MSS に送信されていることを示します) |
| M2F_GPO_ | In | いいえ | GPIO[index] が FPGA ファブリックに接続するように構成されている場合の GPIO ポート名 出力 ポート (M2F は、信号が MSS からファブリックに送信されていることを示します) |
注記：
- PAD ポートは、デザイン階層全体で自動的に最上位に昇格されます。
- 非 PAD ポートを MSS コンフィギュレーター キャンバスから最上位レベルに手動で昇格させて、階層の次のレベルとして使用できるようにする必要があります。
製品サポート
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ドキュメント / リソース
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Microsemi SmartDesign MSS GPIO 設定 [pdf] ユーザーマニュアル SmartDesign MSS GPIO、設定、SmartDesign MSS GPIO 設定、SmartDesign MSS |
