Microsemi IGLOO2 HPMS DDR 控制器配置
介紹
IGLOO2 HPMS 具有嵌入式 DDR 控制器 (HPMS DDR)。此 DDR 控制器設計用於控製片外 DDR 記憶體。 HPMS DDR 控制器可從 HPMS（使用 HPDMA）以及 FPGA 結構存取。
當您使用 System Builder 建置包含 HPMS DDR 的系統區塊時，System Builder 會根據您的輸入和選擇為您設定 HPMS DDR 控制器。
使用者無需單獨進行 HPMS DDR 配置。詳情請參閱 IGLOO2 System Builder 使用者指南。
系統生成器
系統生成器
在 em Builder 中自動設定 HPMS DDR。
- 在 System Builder 的裝置功能標籤中，檢查 HPMS 外部 DDR 記憶體 (HPMS DDR)。
- 在“Memories”標籤中，選擇“DDR Memory Type”：
- DDR2
- DDR3
- LPDDR
- 選擇 DDR 記憶體的寬度：8、16 或 32
- 如果您想要為 DDR 使用 ECC，請檢查 ECC。
- 輸入DDR記憶體設定時間。這是 DDR 記憶體初始化所需的時間。
- 按一下匯入暫存器配置，從現有文字匯入 FDDR 的暫存器值 file 包含暫存器值。寄存器配置見表1 file 句法。
Libero 會自動將此設定資料儲存在 eNVM 中。 FPGA 重設後，此設定資料將自動複製到 HPMS DDR 中。
圖 1 • System Builder 與 HPMS DDR
表 1 • 暫存器配置 File 句法
- ddrc_dyn_soft_reset_CR 0x00；
- ddrc_dyn_refresh_1_CR 0x27DE；
- ddrc_dyn_refresh_2_CR 0x30F；
- ddrc_dyn_powerdown_CR 0x02；
- ddrc_dyn_debug_CR 0x00；
- ddrc_ecc_data_mask_CR 0x0000；
- ddrc_addr_map_col_1_CR 0x3333；
HPMS DDR 控制器配置
當您使用 HPMS DDR 控制器存取外部 DDR 記憶體時，必須在執行時初始化 DDR 控制器。這是透過將配置資料寫入專用 DDR 控制器配置暫存器來完成的。在IGLOO2中，eNVM儲存暫存器配置數據，在FPGA重設後，配置資料從eNVM複製到HPMS DDR的專用暫存器進行初始化。
HPMS DDR 控制暫存器
HPMS DDR 控制器有一組需要在執行時間設定的暫存器。這些暫存器的配置值代表不同的參數，例如 DDR 模式、PHY 寬度、突發模式和 ECC。有關 DDR 控制器配置暫存器的完整詳細信息，請參閱 Microsemi IGLOO2 使用者指南
HPMS MDDR 暫存器配置
若要指定 DDR 暫存器值：
- 使用 Libero SoC 之外的文本編輯器，準備一個文本 file 包含暫存器名稱和值，如圖1-1所示。
- 在系統產生器的「記憶體」標籤中，按一下「匯入暫存器配置」。
- 導航至註冊配置文字的位置 file 在步驟 1 中準備好並選擇 file 導入。
圖 1-1 • 暫存器設定資料 – 文字格式
HPMS DDR 初始化
您為 HPMS DDR 匯入的暫存器設定資料將會載入到 eNVM 中，並在 FPGA 重設時複製到 HPMS DDR 設定暫存器中。運行時無需使用者操作來初始化 HPMS DDR。這種自動初始化也在模擬中被建模。
連接埠說明
DDR PHY 接口
這些連接埠暴露在 System Builder 產生的區塊的頂層。有關詳細信息，請參閱 IGLOO2 System Builder 使用者指南。將這些連接埠連接到您的 DDR 記憶體。
表 2-1 • DDR PHY 接口
| 連接埠名稱 | 方向 | 描述 |
| MDDR_CAS_N | 出去 | 動態隨機存取存儲器 |
| MDDR_CKE | 出去 | 內存CKE |
| MDDR_時鐘 | 出去 | 時鐘，P側 |
| MDDR_CLK_N | 出去 | 時鐘，N 側 |
| MDDR_CS_N | 出去 | 動態隨機存取存儲器 |
| MDDR_ODT | 出去 | 動態隨機存取存儲器 |
| MDDR_RAS_N | 出去 | 動態隨機存取存儲器 |
| MDDR_RESET_N | 出去 | DDR3 的 DRAM 重置 |
| MDDR_WE_N | 出去 | 文德拉姆 |
| MDDR_ADDR[15:0] | 出去 | 內存地址位 |
| MDDR_BA[2:0] | 出去 | Dram 銀行地址 |
| MDDR_DM_RDQS ([3:0]/[1:0]/[0]) | 進出 | 數據掩碼 |
| MDDR_DQS ([3:0]/[1:0]/[0]) | 進出 | Dram 數據選通輸入/輸出 – P 側 |
| MDDR_DQS_N ([3:0]/[1:0]/[0]) | 進出 | Dram 數據選通輸入/輸出 – N 側 |
| MDDR_DQ ([31:0]/[15:0]/[7:0]) | 進出 | DRAM 數據輸入/輸出 |
| MDDR_DQS_TMATCH_0_IN | IN | FIFO 輸入信號 |
| MDDR_DQS_TMATCH_0_OUT | 出去 | FIFO輸出信號 |
| MDDR_DQS_TMATCH_1_IN | IN | 信號中的 FIFO（僅限 32 位） |
| MDDR_DQS_TMATCH_1_OUT | 出去 | FIFO 輸出信號（僅限 32 位） |
| MDDR_DM_RDQS_ECC | 進出 | DRAM ECC 數據掩碼 |
| MDDR_DQS_ECC | 進出 | Dram ECC 數據選通輸入/輸出 – P 側 |
| MDDR_DQS_ECC_N | 進出 | Dram ECC 數據選通輸入/輸出 – N 側 |
| MDDR_DQ_ECC ([3:0]/[1:0]/[0]) | 進出 | DRAM ECC 數據輸入/輸出 |
| MDDR_DQS_TMATCH_ECC_IN | IN | ECC FIFO 輸入信號 |
| MDDR_DQS_TMATCH_ECC_OUT | 出去 | ECC FIFO 輸出信號（僅限 32 位） |
某些連接埠的連接埠寬度會根據 PHY 寬度的選擇而改變。使用符號「[a:0]/[b:0]/[c:0]」來表示此類端口，其中「[a:0]」指的是選擇 32 位元 PHY 寬度時的端口寬度，「[b:0]」對應 16 位元 PHY 寬度，「[c:0]」對應 8 位元 PHY 寬度。
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文件/資源
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Microsemi IGLOO2 HPMS DDR 控制器配置 [pdf] 使用者指南 IGLOO2 HPMS DDR 控制器配置，IGLOO2，HPMS DDR 控制器配置，DDR 控制器配置，配置 |
