英特尔 AN 837 HDMI FPGA IP 设计指南
HDMI 英特尔® FPGA IP 设计指南
设计指南可帮助您使用 FPGA 设备实现高清多媒体接口 (HDMI) Intel FPGA IP。 这些指南有助于 HDMI 英特尔® FPGA IP 视频接口的电路板设计。
- HDMI Intel FPGA IP 用户指南
- 安 745： 英特尔 FPGA DisplayPort 接口设计指南
HDMI 英特尔 FPGA IP 设计指南
HDMI 英特尔 FPGA 接口具有最小化传输差分信号 (TMDS) 数据和时钟通道。 该接口还带有视频电子标准协会 (VESA) 显示数据通道 (DDC)。 TMDS 通道承载视频、音频和辅助数据。 DDC基于I2C协议。 HDMI 英特尔 FPGA IP 内核使用 DDC 读取扩展显示标识数据 (EDID) 并在 HDMI 源和接收器之间交换配置和状态信息。
HDMI 英特尔 FPGA IP 板设计技巧
在设计 HDMI Intel FPGA IP 系统时，请考虑以下电路板设计技巧。
- 每条迹线使用不超过两个过孔并避免过孔存根
- 将差分对阻抗与连接器和电缆组件的阻抗相匹配 (100 ohm ±10%)
- 最小化对间和对内偏移以满足 TMDS 信号偏移要求
- 避免在底层平面的间隙上布线差分对
- 使用标准的高速 PCB 设计实践
- 使用电平转换器来满足 TX 和 RX 的电气合规性
- 使用坚固的电缆，例如 HDMI 2 的 Cat2.0 电缆
示意图
所提供链接中的 Bitec 示意图说明了英特尔 FPGA 开发板的拓扑结构。 使用 HDMI 2.0 链路拓扑需要满足 3.3 V 电气合规性。 为了满足英特尔 FPGA 设备上的 3.3 V 合规性，您需要使用电平转换器。 使用直流耦合转接驱动器或重定时器作为发射器和接收器的电平转换器。
外部供应商设备是 TMDS181 和 TDP158RSBT，它们都在直流耦合链路上运行。 您需要在 CEC 线上进行适当的上拉，以确保在与其他消费类远程控制设备互操作时的功能。 Bitec 原理图经过 CTS 认证。 但是，认证是特定于产品级别的。 建议平台设计人员对最终产品的正确功能进行认证。
相关信息
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热插拔检测 (HPD)
HPD 信号取决于输入的 +5V 电源信号，例如amp例如，仅当检测到来自电源的 +5V 电源信号时，HPD 引脚才可能有效。 要与 FPGA 接口，您需要将 5V HPD 信号转换为 FPGA I/O voltage 电平 (VCCIO)，使用 voltage 电平转换器，例如 TI TXB0102，它没有集成上拉电阻。 HDMI 信号源需要拉低 HPD 信号，以便能够可靠地区分浮动 HPD 信号和高电压信号tage 级 HPD 信号。 HDMI 接收器 +5V 电源信号必须转换为 FPGA I/O voltage电平（VCCIO）。 必须使用电阻 (10K) 将信号弱下拉，以在未由 HDMI 源驱动时区分浮动的 +5V 电源信号。 一个HDMI源+5V电源信号，过流保护不超过0.5A。
HDMI 英特尔 FPGA IP 显示数据通道 (DDC)
HDMI 英特尔 FPGA IP DDC 基于 I2C 信号（SCL 和 SDA），需要上拉电阻。 要与 Intel FPGA 接口，您需要将 5V SCL 和 SDA 信号电平转换为 FPGA I/O voltage 电平 (VCCIO) 使用 voltage 电平转换器，例如用于 Bitec HDMI 0102 子卡的 TI TXS2.0。 TI TXS0102卷tag电平转换器设备集成了内部上拉电阻，因此不需要板载上拉电阻。
AN 837 的文档修订历史：HDMI Intel FPGA IP 的设计指南
| 文档版本 | 更改 |
| 2019.01.28 |
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| 日期 | 版本 | 更改 |
| 2018 年 XNUMX 月 | 2018.01.22 | 初始版本。
注意：本文档包含从 AN 745 中删除的 HDMI Intel FPGA 设计指南：DisplayPort 和 HDMI 接口的设计指南并重命名为 AN 745：Intel FPGA DisplayPort 接口的设计指南。 |
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ID： 683677
版本： 2019-01-28
文件/资源
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英特尔 AN 837 HDMI FPGA IP 设计指南 [pdf] 用户指南 AN 837 HDMI FPGA IP 设计指南、AN 837、HDMI FPGA IP 设计指南、HDMI FPGA IP 指南、HDMI FPGA IP |
